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CMOSPLA회로의스턱오픈고장검출용초기화패턴결합회로

  • 기술번호 : KST2015073463
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 내용 없음.
Int. CL H01L 27/00 (2006.01) H03K 19/177 (2006.01)
CPC G11C 19/184(2013.01) G11C 19/184(2013.01) G11C 19/184(2013.01)
출원번호/일자 1019890019314 (1989.12.22)
출원인 한국전자통신연구원, 주식회사 케이티
등록번호/일자
공개번호/일자 10-1991-0013533 (1991.08.08) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 거절
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (1989.12.22)
심사청구항수 2

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
2 주식회사 케이티 대한민국 경기도 성남시 분당구

발명자

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번호 이름 국적 주소
1 임태영 대한민국 서울시강남구

대리인

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번호 이름 국적 주소
1 김영길 대한민국 서울특별시 강남구 테헤란로 ***, 대흥빌딩 ***호 (역삼동)

최종권리자

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번호 이름 국적 주소
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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 대리인선임신고서
Notification of assignment of agent		 1989.12.22 수리 (Accepted) 1-1-1989-0112901-70
2 출원심사청구서
Request for Examination		 1989.12.22 수리 (Accepted) 1-1-1989-0112902-15
3 특허출원서
Patent Application		 1989.12.22 수리 (Accepted) 1-1-1989-0112900-24
4 의견제출통지서
Notification of reason for refusal		 1992.09.28 발송처리완료 (Completion of Transmission) 1-5-1989-0059856-17
5 거절사정서
Decision to Refuse a Patent		 1993.01.13 발송처리완료 (Completion of Transmission) 1-5-1989-0059857-63
6 출원인정보변경(경정)신고서
Notification of change of applicant's information		 1999.01.20 수리 (Accepted) 4-1-1999-0010652-29
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2000.01.14 수리 (Accepted) 4-1-2000-0005008-66
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.04.09 수리 (Accepted) 4-1-2002-0032774-13
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.03.13 수리 (Accepted) 4-1-2009-5047686-24
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2010.04.19 수리 (Accepted) 4-1-2010-5068437-23
14 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.01.10 수리 (Accepted) 4-1-2012-5005621-98
15 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.03.21 수리 (Accepted) 4-1-2012-5058926-38
16 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.06.08 수리 (Accepted) 4-1-2012-5122434-12
17 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2013.07.31 수리 (Accepted) 4-1-2013-5106568-91
18 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.02.11 수리 (Accepted) 4-1-2014-5018159-78
19 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1

COMS PLA의 자체선단이 가능하도록 시프트 레지스터 래치를 이용하여 설계된 회로에 있어서, 시프트 레지스터 래치(SRL1), (SRL2), (SRL3), (SRL4)를 직렬로 연결하여 이의 각 출력단에서 NOR 게이트(NO1)를 통하여 귀환연결 되도록 하면서, AND 게이트(A1), (A2), (A3), (A4)로 각각 출력되도록 하고, 시프트 레지스터 래치(SRL1)∼(SRL4)와 AND 게이트 (A1)∼(A4)로 출력단의 클럭이 인가되도록 구성한 CMOSPLA 회로의 스턱오픈 고장검출용 초기화 패턴 결합회로

2 2

제1항에 있어서, 시프트 레지스터 래치(L1)∼(L4)는 인버터(I1) (I2)와 NAND게이트(N1),(N2),(N3),(N4),(N5),(N6)로 이루어진 제1래치(11)와 난드게이트(N7),(N8),(N9),(N10)로 이루어진 제2래치(12)로 구성하여 제1래치(11)로의 클럭과 제2래치로의 입력(B)을 조절하면서 초기화 패턴(T1)과 테스트 패턴(T2)의 값을 선택하도록 구성한 CMOSPLA 회로의 스턱오픈 고장 검출용 초기화 패턴 결합회로

지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.