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8-비트 단위의 자기셀입력데이타를 자신의 FIFO에 저장한후 53옥텟 단위로 읽어내어 3옥텟의 헤더를 붙여서 32-비트 단위로 변환하여 데이터와 함께 자기셀 송신데이타 시작신호를 출력시키고, 서로 반대 방향의 2개의 링에 있어서 제1링 및 제1링 중 어느 링으로 보내는 송신데이타인지 확인하여 제1링 및 제2링 자기셀 송신데이타 쓰기신호를 발생하는 자기셀 송신수단(2-1)과, 수신측으로부터의 32-비트 단위의 우회셀 입력데이타를 자신의 FIFO에 저장한 후 14롱워드(53옥텟)단위로 읽어내어 32-비트 단위로 데이터와 함께 우회셀 송신데이타 시작신호를 출력시키고 2개의 링에 있어서 제1링 및 제2링중 어느 링으로 보내는 송신데이타인지 확인하여 제1링 및 제2링 우회셀 송신데이타 쓰기신호를 발생하는 우회셀 송신수단(2-2), 및 상기 자기셀 송신부(2-1)의 출력신호들과 우회셀 송신부(2-2)의 출력신호들을 입력으로 받아서 중재하여 제1링에 관한 신호이면 제1링으로 제1링 송신데이타 시작신호와 제1링 송신데이타와 제1링 송신데이타 쓰기신호를 출력시키고, 제2링에 관한 신호이면 제2링으로 링 송신데이타 시작신호와 링2 송신데이타와 링2 송신데이타 쓰기신호를 송신하는 신호중재수단(2-3)을 구비하는 것을 특징으로 하는 모듈통신을 수행하는 송신장치
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제1항에 있어서, 상기 자기셀 송신수단(1-1)은, 시스템 클럭과 리셋신호를 입력받으며, 자기셀쓰기신호의 입력에 따라 자기셀 클럭에 동기되게 자기셀시작신호와 자기셀 입력데이타를 수신하고, 자기셀 읽기 신호가 인가됨에 따라 자기셀출력시작신호와 자기셀 출력 데이터를 출력하여 자기셀입력데이타가 53옥텟 이상 저장되면 하이상태로 출력되는 프로그래머블 얼모스트 엠프티(Programmable Almost Empty)신호를 내장하는 9-비트 단위 병렬 동기 FIFO(2-1)와, 시스템 클럭과 리셋신호를 입력받으며 우회셀 송신부(1-2)로부터 엠프티신호와 우회셀 송신부 동작신호를 입력받고, 상기 9-비트 단위 병렬 동기 FIFO(2-1)로 부터 프로그래머블 얼모스트 엠프티신호를 입력받아 상기 프로그래머블 얼모스트 엠프티신호가 TTL레벨 1이고 우회셀 송신부의 엠프티신호가 엠티상태이며, 우회셀 송신부 동작중신호가 동작중이 아님을 나타내면, 시스템클럭에 동기되어 계수단을 시작하는 카운터 회로(2-2)와, 리셋신호와 상기 카운터회로(2-2)의 카운터 출력값을 입력받아 카운터 출력값이 증가하는 동안 계속해서 자기셀 읽기 신호를 9-비트 단위 병렬 동기 FIFO(2-2)에 출력하여 저장된 읽기신호를 9-비트 단위 병렬 동기 FIFO(2-1)에 출력하여 저장된 자기셀시작신호와 자기셀입력데이타가 시스템클럭에 동기되어 읽혀지게 하는 자기셀 읽기신호 발생회로(2-4)와, 시스템클럭과 리셋신호, 우회셀 송신부(1-2)로부터의 엠프티신호와 우회셀 송신부 동작신호를 입력받고, 상기 9-비트 단위 병렬 동기 FIFO(2-1)로부터 프로그래머블 얼모스트 엠프티신호를 입력받으며, 상기 자기셀 읽기신호 발생회로(2-4) 로부터 자기셀 읽기신호를 입력받아 프로그래머블 얼모스트 엠프티 신호가 TTL레벨1(53옥텟)이고 우회셀 송신부(1-2)의 엠프티신호가 엠프티상태이며 동작중신호가 동작중이 아님을 나타내면, 동작을 시작하여 32-비트단위변환을 하기 위한 출력신호와 32-비트 출력신호를 발생하며, 자기셀 송신부 동작중신호를 우회셀 송신부(1-2)로 전달하여 동작중임을 알리고 32-비트 데이터 쓰기신호, 링선택신호와 구간신호를 출력하는 단위변환 및 자기셀제어신호 발생회로(2-3)와, 리셋신호와, 9-비트 단위 병렬 동기 FIFO(2-1)와 단위변환 및 자기셀제어신호 발생회로(2-3)로부터 53옥텟크기의 자기셀 출력데이타와 자기셀출력시작신호와 32-비트 단위변환을 하기 위한 출력신호를 입력받아 자기셀에 물리계층의 물리매체접속과 관련된 프레임동기를 위해 취상위 3옥텟의 헤더를 데이터값과 무관하게 붙여서 32-비트 단위의 56옥텟 크기로 변환하여 32-비트 단위의 자기셀 송신데이타와 자기셀 송신데이타 시작신호를 출력하는 링선택회로(2-6)를 구비하는 것을 특징으로 하는 모듈통신을 수행하는 송신장치
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