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저전력 복소수 곱셈기

  • 기술번호 : KST2015078185
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 두 복소수 x = x0 + jx1 와 y = y0 + jy1 의 곱을 연산하는 복소수 곱셈기를 개시한다. 개시된 복소수 곱셈기는 상기 x의 실수부(x0)와 y의 실수부(y0)를 곱셈 연산하는 제 1 곱셈기, 상기 x의 허수부(x1)와 y의 허수부(y1)를 곱셈 연산하는 제 2 곱셈기, 상기 x의 실수부(x0)와 y의 허수부(y1)를 곱셈 연산하는 제 3 곱셈기, 상기 x의 허수부(x1)와 y의 실수부(y0)를 곱셈 연산하는 제 4 곱셈기, 상기 제 1 및 제 2 곱셈기의 출력값의 차를 연산하여, 복소수 곱의 실수부를 산출하는 감산기, 상기 제 3 및 제 4 곱셈기의 출력값의 합을 연산하여, 복소수 곱의 허수부를 산출하는 가산기, 상기 x의 실수부(x0)와 허수부(x1) 및/또는 y의 실수부(y0) 및 y의 허수부(y1)가 각각 동일한지를 비교하는 비교기, 및 상기 비교기의 결과에 따라, 상기 두 복소수 입력의 실수부와 허수부가 적어도 하나가 동일할 경우, 제 1 및 제 2 곱셈기의 출력값이 가산기에 입력되도록 하는 선택부를 포함한다.곱셈기, 복소수, 저전력
Int. CL G06F 7/44 (2006.01)
CPC G06F 7/4812(2013.01)
출원번호/일자 1020010078171 (2001.12.11)
출원인 한국전자통신연구원
등록번호/일자 10-0433627-0000 (2004.05.19)
공개번호/일자 10-2003-0047523 (2003.06.18) 문서열기
공고번호/일자 (20040531) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2001.12.11)
심사청구항수 4

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 박기혁 대한민국 대전광역시유성구
2 엄낙웅 대한민국 대전광역시유성구
3 김보우 대한민국 대전광역시유성구

대리인

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번호 이름 국적 주소
1 이영필 대한민국 서울 강남구 언주로 **길 **, *층, **층, **층, **층(도곡동, 대림아크로텔)(리앤목특허법인)
2 이해영 대한민국 서울 강남구 언주로 **길 **, *층, **층, **층, **층(도곡동, 대림아크로텔)(리앤목특허법인)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 2001.12.11 수리 (Accepted) 1-1-2001-0326698-10
2 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
3 선행기술조사의뢰서
Request for Prior Art Search		 2003.06.12 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search		 2003.07.15 수리 (Accepted) 9-1-2003-0029283-76
5 의견제출통지서
Notification of reason for refusal		 2003.08.29 발송처리완료 (Completion of Transmission) 9-5-2003-0336393-06
6 지정기간연장신청서
Request for Extension of Designated Period		 2003.10.29 수리 (Accepted) 1-1-2003-0407366-70
7 의견서
Written Opinion		 2003.11.24 수리 (Accepted) 1-1-2003-0443124-72
8 명세서 등 보정서
Amendment to Description, etc.		 2003.11.24 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2003-0443126-63
9 등록결정서
Decision to grant		 2004.04.20 발송처리완료 (Completion of Transmission) 9-5-2004-0150325-39
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1

두 복소수 x = x0 + jx1 와 y = y0 + jy1 의 곱을 연산하는 복소수 곱셈기에 있어서,

상기 x의 실수부(x0)와 y의 실수부(y0)를 곱셈 연산하는 제 1 곱셈기;

상기 x의 허수부(x1)와 y의 허수부(y1)를 곱셈 연산하는 제 2 곱셈기;

상기 x의 실수부(x0)와 y의 허수부(y1)를 곱셈 연산하는 제 3 곱셈기;

상기 x의 허수부(x1)와 y의 실수부(y0)를 곱셈 연산하는 제 4 곱셈기;

상기 제 1 및 제 2 곱셈기의 출력값의 차를 연산하여, 복소수 곱의 실수부를 산출하는 감산기;

상기 제 3 및 제 4 곱셈기의 출력값의 합을 연산하여, 복소수 곱의 허수부를 산출하는 가산기;

상기 x의 실수부(x0)와 허수부(x1) 및/또는 y의 실수부(y0) 및 y의 허수부(y1)가 각각 동일한지를 비교하는 비교기; 및

상기 비교기의 결과에 따라, 상기 두 복소수 입력의 실수부와 허수부가 적어도 하나가 동일할 경우, 제 1 및 제 2 곱셈기의 출력값이 가산기에 입력되도록 하는 선택부를 포함하는 것을 특징으로 하는 복소수 곱셈기

2 2

제 1 항에 있어서,

상기 선택부는,

상기 복소수의 실수부와 허수부가 동일할 경우, 제 1 곱셈기의 출력값을 가산기로 인가시키는 제 1 다중화기와,

상기 복소수의 실수부와 허수부가 동일할 경우, 제 2 곱셈기의 출력값을 제 3 다중화기로 인가시키는 제 2 다중화기와,

상기 두 복소수의 실수부와 허수부가 모두 동일할 경우, 상기 제 1 다중화기에서 출력된 제 1 곱셈기의 출력을 가산기로 보내는 제 3 다중화기를 포함하는 것을 특징으로 하는 복소수 곱셈기

3 3

제 1 항 또는 제 2 항에 있어서,

상기 제 2, 제 3 및 제 4 곱셈기는 상기 두 복소수 x = x0 + jx1 와 y = y0 + jy1의 실수부와 허수부가 동일할 경우, 곱셈기의 전원을 차단하는 스위치를 더 포함하는 것을 특징으로 하는 복소수 곱셈기

4 4

제 3 항에 있어서,

상기 비교기는 제 1, 제 2 및 제 3 다중화기와, 제 2, 제 3 및 제 4 곱셈기의 전원 차단 스위치를 제어하는 제어신호(s0, s1)을 출력하는 것을 특징으로 하는 복소수 곱셈기

지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.