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고에너지 효율 병렬 처리 데이터 패스 구조

  • 기술번호 : KST2015080146
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 고에너지 효율 병렬 처리 데이터 패스 구조에 관한 것으로, 특히 고에너지 효율을 위해 다수의 병렬 프로세스 유닛 및 이 프로세스 유닛을 구성하는 다수의 펑크션 유닛을 명령어에 의해 제어하여 병렬 처리로 성능을 향상시킬 수 있고, 필요한 프로세스 유닛 및 펑크션 유닛만 사용하므로 소비 전력을 줄여 에너지 효율을 향상시킬 수 있는 저 전력/고 성능 병렬 처리 데이터 패스 구조를 제공한다. 또한 간단한 명령어 포맷으로 성능과 소비 전력을 동시에 만족할 수 있는 고 에너지 효율 병렬 처리 데이터 패스 구조로서 프로그램에 의하여 하드웨어를 구성할 수 있어 하드웨어 유연성이 우수하다. 프로세서, 병렬 처리, 데이터 패스, 명령어 포맷
Int. CL G06F 13/00 (2006.01) G06F 9/38 (2006.01)
CPC
출원번호/일자 1020040097665 (2004.11.25)
출원인 한국전자통신연구원
등록번호/일자 10-0636596-0000 (2006.10.13)
공개번호/일자 10-2006-0058579 (2006.05.30) 문서열기
공고번호/일자 (20061023) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2004.11.25)
심사청구항수 5

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 양일석 대한민국 대전 유성구
2 노태문 대한민국 대전 유성구
3 이대우 대한민국 대전 유성구
4 이상흥 대한민국 대전 서구
5 김종대 대한민국 대전 서구

대리인

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번호 이름 국적 주소
1 신영무 대한민국 서울특별시 강남구 영동대로 ***(대치동) KT&G타워 *층(에스앤엘파트너스)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2004.11.25 수리 (Accepted) 1-1-2004-0553960-51
2 선행기술조사의뢰서
Request for Prior Art Search
2006.03.16 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2006.04.14 수리 (Accepted) 9-1-2006-0024456-10
4 의견제출통지서
Notification of reason for refusal
2006.04.21 발송처리완료 (Completion of Transmission) 9-5-2006-0226434-92
5 의견서
Written Opinion
2006.06.19 수리 (Accepted) 1-1-2006-0427394-10
6 명세서등보정서
Amendment to Description, etc.
2006.06.19 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2006-0427348-20
7 등록결정서
Decision to grant
2006.10.10 발송처리완료 (Completion of Transmission) 9-5-2006-0588707-41
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
복수의 프로세스 유닛을 구비하고 병렬 처리 데이터 패스 구조를 가지는 프로세스 유닛 어레이에 있어서, 상기 각 프로세스 유닛은,리셋 신호를 받고, 명령어 버스를 통해 입력되는 명령어를 제 1 클럭 신호에 동기하여 저장하는 명령어 레지스터;상기 제 1 클럭 신호 및 제 2 클럭 신호를 받고, 상기 명령어를 디코딩하며 상기 명령어에 상응하는 제 1, 제 2 및 제 3 제어 신호를 발생시키는 명령어 디코더;상기 리셋 신호를 받고, 상기 제 1 제어 신호에 응답하여 상기 디코딩된 명령어에 상응하는 레지스터 파일을 선택 및 제어하는 레지스터 파일;상기 제 1 및 제 2 클럭 신호를 받고, 상기 제 2 제어 신호에 응답하여 데이터 버스에 접속된 외부 메모리와의 데이터 입출력을 제어하며 상기 레지스터 파일과 데이터를 주고받는 인터페이스 유닛; 및상기 제 3 제어 신호에 응답하여 선택적으로 동작하고 그 출력을 상기 레지스터 파일에 각각 전달하는 제 1, 제 2 및 제 3 연산 로직 유닛을 포함하는 프로세스 유닛 어레이
2 2
제 1 항에 있어서,상기 프로세스 유닛 각각은 상기 각 레지스터 파일에 데이터를 쓰거나 상기 외부 메모리에서 상기 레지스터 파일의 상기 데이터를 읽을 수 있도록 상기 명령어 버스에 의하여 제어되는 레지스터 파일 선택 신호 및 레지스터 입력 신호를 상기 명령어 디코더에 구비하는 프로세스 유닛 어레이
3 3
제 1 항에 있어서,상기 프로세스 유닛 어레이는 응용에 따라서 동작하는 상기 프로세스 유닛을 결정할 수 있도록 상기 명령어 버스에 의하여 제어되는 프로세스 유닛 선택 신호 및 프로세스 유닛 입력 신호를 상기 각 프로세스 유닛 내의 상기 각 명령어 디코더에 구비하는 프로세스 유닛 어레이
4 4
제 1 항에 있어서,상기 제 1 내지 제 3 연산 로직 유닛은 덧셈 유닛, 쉬프터 유닛 및 곱셈 유닛을 포함하며, 상기 명령어 버스에 의해 제어되는 상기 제 3 제어 신호 내의 복수의 연산 로직 제어 신호들의 조합에 의해 적어도 하나의 연산 로직 유닛이 선택적으로 동작하는 프로세스 유닛 어레이
5 5
제 1 항 내지 제 4 항 중 어느 한 항에 있어서,상기 각 프로세스 유닛은 하나의 상기 명령어 버스에 병렬 접속되며 상기 데이터 버스를 통해 상기 외부 메모리에 각각 접속되는 데이터 패스를 구비하는 프로세스 유닛 어레이
6 5
제 1 항 내지 제 4 항 중 어느 한 항에 있어서,상기 각 프로세스 유닛은 하나의 상기 명령어 버스에 병렬 접속되며 상기 데이터 버스를 통해 상기 외부 메모리에 각각 접속되는 데이터 패스를 구비하는 프로세스 유닛 어레이
지정국 정보가 없습니다
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순번 패밀리번호 국가코드 국가명 종류
1 US07461235 US 미국 FAMILY
2 US20060112258 US 미국 FAMILY

DOCDB 패밀리 정보

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순번 패밀리번호 국가코드 국가명 종류
1 US2006112258 US 미국 DOCDBFAMILY
2 US7461235 US 미국 DOCDBFAMILY
국가 R&D 정보가 없습니다.