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모듈로 N 연산방법 및 그 장치

  • 기술번호 : KST2015086095
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 데이터 연산인 모듈로(modulo) N 연산에 관한 것으로, 일 실시예에 따른 임의의 양의 정수 X의 모듈로(modulo) N 연산 방법은 X를 이진수로 변환하고, 다음으로 양의 정수 N이 2의 n승에 1을 더하거나 뺀 값에 2의 m승을 곱한 값과 같도록 양의 정수 m, n을 계산하고, 다음으로 m, n 값에 따라 가변 되는 비트 단위별로 구분하여, 변환된 X의 이진수를 연산함으로써, 간단한 덧셈기와 논리회로를 이용하여 모듈로(modulo) 연산의 복잡도를 줄일 수 있다.
Int. CL G06F 7/52 (2006.01) G06F 7/57 (2006.01) G06F 7/552 (2006.01)
CPC
출원번호/일자 1020100063896 (2010.07.02)
출원인 한국전자통신연구원
등록번호/일자 10-1318992-0000 (2013.10.10)
공개번호/일자 10-2011-0068801 (2011.06.22) 문서열기
공고번호/일자 (20131016) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보 대한민국  |   1020090125665   |   2009.12.16
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2010.07.02)
심사청구항수 10

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 진은숙 대한민국 대전광역시 유성구
2 김일규 대한민국 충청북도 옥천군
3 정현규 대한민국 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 특허법인 신지 대한민국 서울특별시 강남구 테헤란로*길 **, *층 ***호실(역삼동, 청원빌딩)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2010.07.02 수리 (Accepted) 1-1-2010-0430082-80
2 선행기술조사의뢰서
Request for Prior Art Search
2013.08.01 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2013.08.26 수리 (Accepted) 9-1-2013-0070075-83
4 등록결정서
Decision to grant
2013.10.01 발송처리완료 (Completion of Transmission) 9-5-2013-0679902-92
5 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
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번호 청구항
1 1
임의의 양의 정수 X의 모듈로(modulo) N 연산 방법에 있어서,상기 X를 이진수로 변환하는 단계;상기 양의 정수 N이 2의 n승에 1을 더하거나 뺀 값에 2의 m승을 곱한 값과 같도록 양의 정수 m, n을 계산하는 단계; 및상기 m, n 값에 따라 가변 되는 비트 단위별로 구분하여, 상기 변환된 X의 이진수를 연산하는 단계;를 포함하는 모듈로(modulo) N 연산 방법
2 2
제 1항에 있어서,상기 변환된 X의 이진수의 전체 비트는,n 비트 단위가 r(r은 양의 정수)개 이고, 최하위 비트가 m 비트로 이루어지는 모듈로(modulo) N 연산 방법
3 3
제 2항에 있어서,상기 변환된 X의 이진수를 연산하는 단계는,상기 각각의 n 비트 단위별로 상위 비트를 추가한 수정 n 비트 단위를 계산하는 단계;상기 수정 n 비트 단위의 값을 멀티플렉서와 가산기를 이용하여 최종 n 비트를 계산하는 단계; 및상기 최종 n 비트에 상기 m 비트를 최하위 비트로 추가하여 이진 모듈로(modulo) 연산 값을 생성하는 단계;를 포함하는 모듈로(modulo) N 연산 방법
4 4
제 3항에 있어서,상기 최종 n 비트를 계산하는 단계는,각 n 비트 단위의 값이 2의 n승에 1을 더하거나 뺀 값보다 작은 경우에는 상기 n 비트 단위의 값을 제 1 비트 단위 값으로 출력하고, 큰 경우에는 상기 n 비트 단위의 값에 2의 n승에 1을 더하거나 뺀 값을 빼어 제 1 비트 단위 값으로 출력하는 단계; 및상기 제 1 비트 단위가 복수 개인 경우, 상기 출력된 제 1 비트 단위 값 각각을 더하여 제 2 비트 단위를 계산하는 단계;를 포함하는 모듈로(modulo) N 연산 방법
5 5
제 4항에 있어서,상기 최종 n 비트를 계산하는 단계는,상기 제 2 비트 단위가 최종 n 비트일 때까지 상기 단계를 반복하는 모듈로(modulo) N 연산 방법
6 6
임의의 양의 정수 X를 이진수로 변환하는 이진수 변환부;모듈로(modulo)인 양의 정수 N이 2의 n승에 1을 더하거나 뺀 값에 2의 m승을 곱한 값과 같도록 양의 정수 m, n을 계산하는 변수 계산부; 및상기 m, n 값에 따라 가변 되는 비트 단위별로 상기 변환된 X의 이진수를 연산하는 비트 단위 연산부;를 포함하는 모듈로(modulo) N 연산 장치
7 7
제 6항에 있어서,상기 이진수 변환부에 의해 변환된 X의 이진수의 전체 비트는,n 비트 단위가 r(r은 양의 정수)개 이고, 최하위 비트가 m 비트로 이루어지는 모듈로(modulo) N 연산 장치
8 8
제 7항에 있어서,상기 X의 비트 단위 연산부는,상기 n 비트 단위에 상위 비트를 추가한 수정 n 비트 단위를 계산하는 수정 n 비트 단위 계산부;상기 수정 n 비트 단위의 값을 멀티플렉서와 가산기를 이용하여 최종 n 비트를 계산하는 최종 n 비트 계산부; 및상기 최종 n 비트 계산부에 의해 계산된 최종 n 비트에 m 비트를 최하위 비트로 추가하는 비트 결합부;를 포함하는 모듈로(modulo) N 연산 장치
9 9
제 8항에 있어서,상기 최종 n 비트 계산부는,각 n 비트 단위의 값이 2의 n승에 1을 더하거나 뺀 값보다 작은 경우에는 상기 n 비트 단위의 값을 제 1 비트 단위 값으로 출력하고, 큰 경우에는 상기 n 비트 단위의 값에 2의 n승에 1을 더하거나 뺀 값을 빼어 제 1 비트 단위 값으로 출력하는 제 1 비트 단위 계산부; 및상기 제 1 비트 단위가 복수 개인 경우, 상기 출력된 제 1 비트 단위 값 각각을 더하여 제 2 비트 단위를 계산하는 제 2 비트 단위 계산부;를 포함하는 모듈로(modulo) N 연산 장치
10 10
제 9항에 있어서,상기 비트 결합부는,상기 제 2 비트 단위가 최종 n 비트가 될 때까지 상기 계산을 반복하는 모듈로(modulo) N 연산 장치
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1 지식경제부 한국전자통신연구원 IT성장동력기술개발 3GPP LTE 단말모뎀 칩셋 개발