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증폭기 공유 구조의 멀티-비트 파이프라인 아날로그-디지털변환기

  • 기술번호 : KST2015097743
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 증폭기 공유 구조의 멀티-비트 파이프라인 아날로그-디지털 변환기에 관한 것으로, 입력된 아날로그 전압을 샘플링 및 홀딩하여 입력 전압의 샘플링 오차를 제거하는 SHA; 아날로그 신호를 입력받아 디지털 신호로 변환하여 출력하는 제 1 내지 K (K≥2인 정수) 스테이지의 N(N≥1인 정수)-비트 플래시 ADC(Analog-to-Digital Converter); 상기 N-비트 플래시 ADC로부터 출력되는 디지털 신호와 이전 스테이지의 출력신호의 차이를 다시 아날로그 신호로 변환하여 출력하는 제 1 내지 K 스테이지의 N-비트 MDAC(Multiplying Digital-to-Analog Converter); 제 1 클럭에서 상기 제 1 스테이지의 N-비트 MDAC의 출력에 연결되고 제 2 클럭에서 상기 SHA의 출력에 연결되는 3단 증폭기를 포함하는 것을 특징으로 한다.본 발명에 따르면, 멀티-비트 파이프라인 ADC에 있어서 전력 소모가 많은 SHA와 제 1 스테이지의 MDAC간에 증폭기를 공유하는 것이 가능하게 되며, 이에 따라 전력 소모를 최소화하고 칩 면적을 감소시킬 수 있는 효과가 있다.파이프라인, 아날로그-디지털 변환기, ADC, 증폭기, 공유, SHA, MDAC
Int. CL H03M 1/12 (2006.01)
CPC
출원번호/일자 1020060089083 (2006.09.14)
출원인 한국전자통신연구원
등록번호/일자 10-0827268-0000 (2008.04.28)
공개번호/일자 10-2008-0024676 (2008.03.19) 문서열기
공고번호/일자 (20080507) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2006.09.14)
심사청구항수 5

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 전영득 대한민국 대전 중구
2 이승철 대한민국 대전 서구
3 김귀동 대한민국 대전 대덕구
4 권종기 대한민국 대전 서구
5 김종대 대한민국 대전 서구

대리인

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번호 이름 국적 주소
1 신영무 대한민국 서울특별시 강남구 영동대로 ***(대치동) KT&G타워 *층(에스앤엘파트너스)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 2006.09.14 수리 (Accepted) 1-1-2006-0664782-70
2 서지사항보정서
Amendment to Bibliographic items		 2007.02.26 수리 (Accepted) 1-1-2007-0165717-31
3 명세서등보정서
Amendment to Description, etc.		 2007.02.27 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2007-0168089-81
4 선행기술조사의뢰서
Request for Prior Art Search		 2007.04.09 수리 (Accepted) 9-1-9999-9999999-89
5 선행기술조사보고서
Report of Prior Art Search		 2007.05.10 수리 (Accepted) 9-1-2007-0027264-11
6 의견제출통지서
Notification of reason for refusal		 2007.10.31 발송처리완료 (Completion of Transmission) 9-5-2007-0589916-90
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2007.12.31 수리 (Accepted) 1-1-2007-0948668-91
8 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2007.12.31 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2007-0948678-47
9 등록결정서
Decision to grant		 2008.04.24 발송처리완료 (Completion of Transmission) 9-5-2008-0219875-17
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
입력된 아날로그 전압을 샘플링 및 홀딩하여 입력 전압의 샘플링 오차를 제거하는 SHA;아날로그 신호를 입력받아 디지털 신호로 변환하여 출력하는 제 1 내지 K (K≥2인 정수) 스테이지의 N(N≥1인 정수)-비트 플래시 ADC(Analog-to-Digital Converter);상기 N-비트 플래시 ADC로부터 출력되는 디지털 신호와 이전 스테이지의 출력신호의 차이를 다시 아날로그 신호로 변환하여 출력하는 제 1 내지 K 스테이지의 N-비트 MDAC(Multiplying Digital-to-Analog Converter);제 1 클럭에서 상기 제 1 스테이지의 N-비트 MDAC의 출력에 연결되고 제 2 클럭에서 상기 SHA의 출력에 연결되는 3단 증폭기를 포함하고, 상기 제 1 스테이지의 N-비트 MDAC은 상기 SHA와 증폭기를 공유하며, 상기 제 2 스테이지 내지 제 K-1 스테이지의 N-비트 MDAC은 다음 스테이지의 N-비트 MDAC과 증폭기를 각각 공유하는 것을 특징으로 하는 증폭기 공유 구조의 멀티-비트 파이프라인 아날로그-디지털 변환기
2 2
제 1항에 있어서, 상기 3단 증폭기의 두번째 증폭기와 세번째 증폭기 사이에 상기 제 1 클럭에 따라 온/오프되는 스위치가 추가된 것을 특징으로 하는 증폭기 공유 구조의 멀티-비트 파이프라인 아날로그-디지털 변환기
3 3
제 2항에 있어서, 상기 제 1 클럭에서 상기 3단 증폭기의 첫번째, 두번째 및 세번째 증폭기가 상기 제 1 스테이지의 N-비트 MDAC의 출력에 연결되고, 상기 제 2 클럭에서 상기 3단 증폭기의 첫번째 및 두번째 증폭기가 상기 SHA의 출력에 연결되는 것을 특징으로 하는 증폭기 공유 구조의 멀티-비트 파이프라인 아날로그-디지털 변환기
4 4
제 3항에 있어서, 상기 제 2 클럭에서, 상기 3단 증폭기의 세번째 증폭기에 인가되는 전력이 감소되는 것을 특징으로 하는 증폭기 공유 구조의 멀티-비트 파이프라인 아날로그-디지털 변환기
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제 1항에 있어서, 상기 제 1 클럭이 High인 경우, 상기 SHA는 샘플링 모드로, 상기 제 1 스테이지의 N-비트 MDAC은 증폭 모드로 동작하며, 상기 제 2 클럭이 High인 경우, 상기 SHA는 홀드 모드로, 상기 제 1 스테이지의 N-비트 MDAC은 샘플링 모드로 동작하는 것을 특징으로 하는 증폭기 공유 구조의 멀티-비트 파이프라인 아날로그-디지털 변환기
6 6
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2 US7397409 US 미국 DOCDBFAMILY
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