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데이터 통신 채널의 클럭 발생 장치

  • 기술번호 : KST2015097955
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 1. 청구범위에 기재된 발명이 속하는 기술분야본 발명은 데이터 통신 채널의 클럭 발생 장치에 관한 것임.2. 발명이 해결하고자 하는 기술적 과제본 발명은 간단한 회로 구성으로 안정된 클럭 및 타이밍 신호를 발생 시켜 보다 안정되고 신뢰성 높은 데이터의 직렬/병렬 변환, 추출 및 삽입이 가능하도록 할 수 있는 데이터 통신 채널의 클럭 발생 장치를 제공하는 그 목적이 있다. 3. 발명의 해결 방법의 요지본 발명은 소정 주기의 제 1 클럭 및 제 1 타이밍 신호를 출력하는 제 1 클럭 발생수단; 상기 제 1 클럭 및 제 1 타이밍 신호를 입력받아 제 1 오프셋 신호, 제 2 타이밍 신호 및 소정 주기의 제 2 클럭을 출력하는 제 2 클럭 발생수단; 및 상기 제 1 클럭 및 제 1 타이밍 신호를 입력받아 제 2 오프셋 신호, 제 3 타이밍 신호 및 소정 주기의 제 3 클럭을 출력하는 제 3 클럭 발생수단을 포함한다. 4. 발명의 중요한 용도본 발명은 STM-N 전송시스템에서 데이터 통신 채널에 사용되는 클럭을 발생하는데 이용됨.
Int. CL H03K 3/00 (2006.01)
CPC H04L 7/033(2013.01) H04L 7/033(2013.01)
출원번호/일자 1019970064105 (1997.11.28)
출원인 한국전자통신연구원, 주식회사 케이티
등록번호/일자
공개번호/일자 10-1999-0043119 (1999.06.15) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 포기
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (1997.11.28)
심사청구항수 27

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
2 주식회사 케이티 대한민국 경기도 성남시 분당구

발명자

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번호 이름 국적 주소
1 김종호 대한민국 대전광역시 유성구
2 이유경 대한민국 대전광역시 유성구
3 이태희 대한민국 서울특별시 송파구
4 고정훈 대한민국 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 신성특허법인(유한) 대한민국 서울특별시 송파구 중대로 ***, ID타워 ***호 (가락동)

최종권리자

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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
1997.11.28 수리 (Accepted) 1-1-1997-0201616-04
2 출원심사청구서
Request for Examination
1997.11.28 수리 (Accepted) 1-1-1997-0201618-95
3 대리인선임신고서
Notification of assignment of agent
1997.11.28 수리 (Accepted) 1-1-1997-0201617-49
4 출원인정보변경(경정)신고서
Notification of change of applicant's information
1999.01.20 수리 (Accepted) 4-1-1999-0010652-29
5 의견제출통지서
Notification of reason for refusal
1999.12.17 발송처리완료 (Completion of Transmission) 9-5-1999-0381077-86
6 출원인정보변경(경정)신고서
Notification of change of applicant's information
2000.01.14 수리 (Accepted) 4-1-2000-0005008-66
7 출원포기서
Abandonment of Application
2000.02.09 수리 (Accepted) 1-1-2000-5040724-95
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2002.04.09 수리 (Accepted) 4-1-2002-0032774-13
10 출원인정보변경(경정)신고서
Notification of change of applicant's information
2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
11 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.03.13 수리 (Accepted) 4-1-2009-5047686-24
12 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
13 출원인정보변경(경정)신고서
Notification of change of applicant's information
2010.04.19 수리 (Accepted) 4-1-2010-5068437-23
14 출원인정보변경(경정)신고서
Notification of change of applicant's information
2012.01.10 수리 (Accepted) 4-1-2012-5005621-98
15 출원인정보변경(경정)신고서
Notification of change of applicant's information
2012.03.21 수리 (Accepted) 4-1-2012-5058926-38
16 출원인정보변경(경정)신고서
Notification of change of applicant's information
2012.06.08 수리 (Accepted) 4-1-2012-5122434-12
17 출원인정보변경(경정)신고서
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2013.07.31 수리 (Accepted) 4-1-2013-5106568-91
18 출원인정보변경(경정)신고서
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2014.02.11 수리 (Accepted) 4-1-2014-5018159-78
19 출원인정보변경(경정)신고서
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2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
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번호 청구항
1 1

외부로부터 입력 클럭 및 프레임 위치 알림 신호를 입력받아 소정 주기의 제 1 클럭 및 제 1 타이밍 신호를 출력하는 제 1 클럭 발생수단;

상기 제 1 클럭 및 제 1 타이밍 신호를 입력받아 제 1 오프셋 신호, 제 2 타이밍 신호 및 소정 주기의 제 2 클럭을 외부로 출력하는 제 2 클럭 발생수단; 및

상기 제 1 클럭 및 제 1 타이밍 신호를 입력받아 제 2 오프셋 신호, 제 3 타이밍 신호 및 소정 주기의 제 3 클럭을 외부로 출력하는 제 3 클럭 발생수단

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

2 2

제 1 항에 있어서,

상기 제 1 클럭 발생수단은,

상기 프레임 위치 알림 신호를 반전시키기 위한 반전수단;

외부로부터 입력되는 선택신호에 의해 상기 반전수단의 출력신호 및 상기 프레임 위치 알림 신호를 선택적으로 출력하는 선택수단;

상기 입력 클럭과 상기 선택수단의 출력신호를 입력받아 리셋신호를 출력하는 리셋신호 발생수단;

상기 입력 클럭과 상기 리셋신호 발생수단의 출력신호에 따라, 외부로부터 입력된 입력 논리신호를 래치시키는 래치수단;

상기 입력 클럭을 카운트하여 출력하는 카운팅수단;

상기 입력 클럭에 따라 상기 래치수단의 출력신호와 상기 카운팅수단의 출력신호를 비교하여 출력하는 비교수단;

상기 비교수단의 출력신호와 상기 리셋신호 발생수단의 출력신호를 논리 연산하여 상기 래치수단 및 카운팅수단으로 출력하는 논리 연산수단;

상기 입력 클럭에 따라 상기 래치수단의 출력신호와 상기 카운팅수단의 출력신호를 입력받아 상기 제 1 클럭을 출력하는 클럭 출력수단; 및

상기 입력 클럭에 따라 상기 래치수단의 출력신호를 입력받아 제 1 타이밍신호를 출력하는 타이밍신호 발생수단

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

3 3

제 2 항에 있어서,

상기 래치수단은,

입력단자로 입력 논리신호를 입력받고, 클럭단자로 상기 입력 클럭을 입력받으며, 셋단자가 상기 리셋신호 발생수단의 출력단에 접속되고, 리셋단자가 상기 비교수단의 출력단에 접속되고, 출력단자가 상기 타이밍신호 발생수단의 입력단에 접속된 제 1 D-플립플롭;

입력단자로 상기 입력 논리신호를 입력받고, 클럭단자로 상기 입력 클럭을 입력받으며, 셋단자가 상기 비교수단의 출력단에 접속되고, 리셋단자가 상기 논리 연산수단의 출력단에 접속되고, 출력단자가 상기 비교수단 및 클럭 출력수단의 입력단에 접속된 제 2 D-플립플롭; 및

입력단자로 상기 입력 논리신호를 입력받고, 클럭단자로 상기 입력 클럭을 입력받으며, 셋단자가 상기 비교수단의 출력단에 접속되고, 리셋단자가 상기 논리 연산수단의 출력단에 접속되고, 출력단자가 상기 비교수단 및 클럭 출력수단의 입력단에 접속된 제 3 D-플립플롭

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

4 4

제 3 항에 있어서,

상기 카운팅수단은,

클럭단자로 상기 입력 클럭을 입력받고, 리셋단자가 상기 논리 연산수단의 출력단에 접속되고, 출력단자가 상기 비교수단의 입력단에 접속된 제 1 계수기; 및

클럭단자로 상기 입력 클럭을 입력받고, 셋단자가 상기 리셋신호 발생부의 출력단에 접속되고, 리셋단자가 상기 논리 연산수단의 출력단에 접속되고, 출력단자가 상기 비교수단의 입력단에 접속된 제 2 계수기

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

5 5

제 4 항에 있어서,

상기 비교수단은,

클럭단자로 상기 입력 클럭을 입력받고, 일입력단자가 상기 제 2 D-플립플롭의 출력단에 접속되며, 타입력단자가 상기 제 1 계수기의 출력단에 접속되고, 출력단자가 상기 논리 연산수단의 입력단에 접속된 제 1 비교기;

클럭단자로 상기 입력 클럭을 입력받고, 일입력단자가 상기 제 2 D-플립플롭의 출력단에 접속되며, 타입력단자가 상기 제 1 계수기의 출력단에 접속되고, 출력단자가 상기 제 1 D-플립플롭의 리셋단자와 상기 논리 연산수단의 입력단에 접속된 제 2 비교기;

클럭단자로 상기 입력 클럭을 입력받고, 일입력단자가 상기 제 3 D-플립플롭의 출력단에 접속되며, 타입력단자가 상기 제 2 계수기의 출력단에 접속되고, 출력단자가 상기 논리 연산수단의 입력단에 접속된 제 3 및 제 4 비교기

를 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

6 6

제 5 항에 있어서,

상기 논리 연산수단은,

입력단들로 각각 입력된 상기 리셋신호 발생수단의 출력신호와 상기 제 1 비교기의 출력신호를 논리곱하여 상기 제 2 D-플립플롭의 리셋단자로 출력하는 제 1 논리 연산부;

입력단들로 각각 입력된 상기 리셋신호 발생수단의 출력신호, 상기 제 1 비교기의 출력신호 및 상기 제 2 비교기의 출력신호를 논리곱하여 상기 제 1 계수기의 리셋단자로 출력하는 제 2 논리 연산부;

입력단들로 각각 입력된 상기 리셋신호 발생수단의 출력신호와 상기 제 3 비교기의 출력신호를 논리곱하여 상기 제 3 D-플립플롭의 리셋단자로 출력하는 제 3 논리 연산부; 및

입력들로 각각 입력된 상기 제 3 및 제 4 비교기의 출력신호를 논리곱하여 상기 제 2 계수기의 리셋단자로 출력하는 제 4 논리 연산부

를 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

7 7

제 6 항에 있어서,

상기 클럭 출력수단은,

상기 제 2 및 제 3 D-플립플롭의 출력신호를 배타적 논리합하여 출력하는 제 5 논리 연산부; 및

클럭단자로 상기 입력 클럭을 입력받고, 입력단자가 상기 제 5 논리 연산부의 출력단에 접속되며, 출력단자를 통해 상기 제 1 클럭을 출력하는 제 4 D-플립플롭

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

8 8

제 7 항에 있어서,

상기 타이밍신호 발생수단은,

클럭단자로 상기 입력 클럭을 입력받고, 입력단자가 상기 제 1 D-플립플롭의 출력단에 접속되며, 출력단자를 통해 상기 제 1 타이밍신호를 출력하는 제 5 D-플립플롭

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

9 9

제 1 항에 있어서,

상기 제 2 클럭 발생수단은,

상기 제 1 타이밍신호와 제 1 클럭을 입력받아 리셋신호를 제공하는 리셋신호 발생수단;

상기 제 1 클럭에 따라, 외부로부터 입력된 입력 논리신호를 이용하여 플립플롭 동작을 수행하는 래치수단;

상기 제 1 클럭에 따라 상기 래치수단의 출력신호들을 비교하여 출력하는 비교수단;

상기 비교수단의 출력신호를 카운트하여 출력하는 카운팅수단;

상기 리셋신호와 카운팅수단의 출력신호를 논리 조합하여 출력하는 논리 연산수단;

상기 제 1 클럭에 따라 상기 래치수단의 출력신호를 입력받아 상기 제 1 프레임 오프셋신호를 외부로 출력하는 프레임 오프셋신호 발생수단;

상기 제 1 클럭에 따라 상기 래치수단의 출력신호를 입력받아 상기 제 2 타이밍신호를 출력하는 타임이신호 발생수단; 및

상기 제 1 클럭에 따라 상기 래치수단의 출력신호를 입력받아 상기 제 2 클럭을 외부로 출력하는 클럭 발생수단

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

10 10

제 9 항에 있어서,

상기 래치수단은,

입력단자로 상기 입력 논리신호를 입력받고, 클럭단자로 상기 제 1 클럭을 입력받으며, 셋단자가 상기 리셋신호 발생수단의 출력단에 접속되고, 리셋단자가 상기 비교수단의 출력단에 접속되고, 출력단자가 상기 프레임 오프셋신호 발생수단의 입력단에 접속된 제 1 D-플립플롭;

입력단자로 상기 입력 논리신호를 입력받고, 클럭단자로 상기 제 1 클럭을 입력받으며, 셋단자가 상기 논리 연산수단의 출력단에 접속되고, 리셋단자가 상기 논리 연산수단의 출력단에 접속되며, 출력단자가 상기 타이밍신호 발생수단의 입력단에 접속된 제 2 D-플립플롭; 및

입력단자가 일출력단자에 접속되고, 클럭단자로 상기 제 1 클럭을 입력받으며, 리셋단자가 상기 리셋신호 발생수단의 출력단에 접속되며, 타출력단자가 상기 비교수단의 입력단에 접속된 제 3 D-플립플롭

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

11 11

제 10 항에 있어서,

상기 비교수단은,

클럭단자로 상기 클럭를 입력받아, 일입력단자로 입력된 상기 제 1 D-플립플롭의 출력신호와 타입력단자로 입력된 상기 제 2 D-플립플롭의 출력신호를 비교하여 비교값을 일출력단자를 통해 상기 제 1 D-플립플롭의 리셋단자로 출력하고, 타출력단자를 통해 상기 카운팅수단으로 출력하는 비교기

를 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

12 12

제 11 항에 있어서,

상기 카운팅수단은,

리셋단자가 상기 리셋신호 발생수단의 출력단에 접속되고, 클럭단자로 입력되는 상기 비교수단의 출력신호를 카운트하여 출력단자들을 통해 출력하는 계수기

를 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

13 13

제 12 항에 있어서,

상기 논리 연산수단은,

상기 카운팅수단의 출력신호들을 논리합하여 출력하는 제 1 논리 연산부; 및

상기 제 1 논리 연산부의 출력신호와 상기 리셋신호 발생수단의 출력신호를 논리곱하여 출력하는 제 2 논리 연산부

를 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

14 14

제 13 항에 있어서,

상기 프레임 오프셋신호 발생수단은,

클럭단자로 상기 제 1 클럭을 입력받고, 입력단자가 상기 제 1 D-플립플롭의 출력단에 접속되며, 출력단자를 통해 상기 제 2 프레임 오프셋신호를 출력하는 제 3 D-플립플롭

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

15 15

제 14 항에 있어서,

상기 타이밍신호 발생수단은,

클럭단자로 상기 제 1 클럭을 입력받고, 입력단자가 상기 제 2 D-플립플롭의 출력단에 접속되며, 출력단자를 통해 상기 제 2 타이밍신호를 출력하는 제 4 D-플립플롭

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

16 16

제 15 항에 있어서,

상기 클럭 출력수단은,

클럭단자로 상기 제 1 클럭을 입력받고, 입력단자가 상기 제 3 D-플립플롭의 출력단에 접속되며, 출력단자를 통해 상기 제 2 클럭을 출력하는 제 5 D-플립플롭

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

17 17

제 13항 내지 제 16 항 중 어느 한 항에 있어서,

상기 제 1 논리 연산부의 출력신호를 반전시키기 위한 반전수단

을 더 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

18 18

제 1 항에 있어서,

상기 제 3 클럭 발생수단은,

상기 제 1 타이밍신호와 제 1 클럭을 입력받아 리셋신호를 제공하는 리셋신호 발생수단;

상기 제 1 클럭에 따라, 외부로부터 입력된 입력 논리신호를 래치시키는 래치수단;

상기 제 1 클럭에 따라 상기 래치수단의 출력신호들을 비교하여 출력하는 비교수단;

상기 제 1 클럭 및 비교수단의 출력신호를 카운트하여 출력하는 카운팅수단;

상기 리셋신호와 카운팅수단의 출력신호를 논리 조합하여 출력하는 제 1 논리 연산수단;

상기 카운팅수단의 출력신호들을 논리 조합하여 출력하는 제 2 논리 연산수단;

상기 제 1 클럭에 따라 상기 래치수단의 출력신호를 입력받아 상기 제 2 프레임 오프셋신호를 외부로 출력하는 프레임 오프셋신호 발생수단;

상기 제 1 클럭에 따라 상기 래치수단의 출력신호를 입력받아 상기 제 3 타이밍신호를 출력하는 타임이신호 발생수단; 및

상기 제 1 클럭에 따라 상기 래치수단의 출력신호를 입력받아 상기 제 3 클럭을 외부로 출력하는 클럭 출력수단

를 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

19 19

제 18 항에 있어서,

상기 래치수단은,

입력단자로 상기 입력 논리신호를 입력받고, 클럭단자로 상기 제 1 클럭을 입력받으며, 셋단자가 상기 리셋신호 발생수단의 출력단에 접속되고, 리셋단자가 상기 비교수단의 출력단에 접속되고, 출력단자가 상기 프레임 오프셋신호 발생수단의 입력단에 접속된 제 1 D-플립플롭;

입력단자로 상기 입력 논리신호를 입력받고, 클럭단자로 상기 제 1 클럭을 입력받으며, 셋단자가 상기 제 1 논리 연산수단의 출력단에 접속되고, 리셋단자를 통해 상기 제 2 논리 수단의 출력신호를 입력받으며, 출력단자가 상기 타이밍신호 발생수단의 입력단에 접속된 제 2 D-플립플롭; 및

입력단자로 상기 입력 논리신호를 입력받고, 클럭단자로 상기 제 1 클럭을 입력받으며, 셋단자가 상기 비교수단의 출력단에 접속되고, 리셋단자가 상기 리셋신호 발생수단의 출력단에 접속되고, 출력단자가 상기 비교수단의 입력단에 접속된 제 3 D-플립플롭

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

20 20

제 18 항에 있어서,

상기 비교수단은,

클럭단자로 상기 제 1 클럭을 입력받아, 제 1 입력단자로 입력된 상기 제 1 D-플립플롭의 출력신호, 제 2 입력단자로 입력된 상기 제 3 D-플립플롭의 출력신호 및 상기 제 2 논리 연산수단의 출력신호를 비교하여 비교값을 일출력단자를 통해 상기 제 3 D-플립플롭의 셋단자 및 상기 제 1 논리 연산수단의 입력단으로 출력하고, 상기 비교값을 타출력단자를 통해 상기 카운팅수단의 입력단으로 출력하는 비교기

를 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

21 21

제 19 항에 있어서,

상기 카운팅수단은,

리셋단자가 상기 제 1 논리 연산수단의 출력단에 접속되고, 클럭단자로 입력되는 상기 비교수단의 출력신호를 카운트하여 출력단자들을 통해 출력하는 제 1 계수기; 및

리셋단자가 상기 리셋신호 발생수단의 출력단에 접속되고, 클럭단자를 통해 입력되는 상기 비교수단의 출력신호를 카운트하여 출력단자들을 통해 출력하는 제 2 계수기

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

22 22

제 20 항에 있어서,

상기 제 1 논리 연산수단은,

상기 리셋신호 발생수단의 출력신호와 상기 제 2 논리 연산수단의 출력신호를 논리곱하여 상기 제 2 D-플립플롭의 셋단자로 출력하는 제 1 논리 연산부;

상기 리셋신호 발생수단의 출력신호와 상기 비교수단의 출력신호를 논리곱하여 상기 제 3 D-플립플롭의 리셋단자로 출력하는 제 2 논리 연산부; 및

상기 리셋신호 발생수단의 출력신호와 상기 비교수단의 출력신호를 논리곱하여 상기 제 1 계수기의 리셋단자로 출력하는 제 3 논리 연산부

를 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

23 23

제 21 항에 있어서,

상기 제 2 논리 연산수단은,

상기 제 1 계수기의 출력단자들을 통해 출력된 신호들을 논리 곱하여 상기 비교수단의 입력단으로 출력하는 출력하는 제 4 논리 연산부; 및

상기 제 2 계수기의 출력단자들을 통해 출력된 신호들을 논리합하여 상기 제 2 D-플립플롭의 리셋단자로 출력하는 제 5 논리 연산부

를 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

24 24

제 22 항에 있어서,

상기 프레임 오프셋신호 발생수단은,

클럭단자로 상기 제 1 클럭을 입력받고, 입력단자가 상기 제 1 D-플립플롭의 출력단자에 접속되며, 출력단자를 통해 상기 제 2 프레임 오프셋신호를 출력하는 제 4 D-플립플롭

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

25 25

제 23 항에 있어서,

상기 타이밍신호 발생수단은,

클럭단자로 상기 제 1 클럭을 입력받고, 입력단자가 상기 제 2 D-플립플롭의 출력단자에 접속되며, 출력단자를 통해 제 3 타이밍신호를 출력하는 제 5 D-플립플롭

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

26 26

제 24 항에 있어서,

상기 클럭 출력수단은,

클럭단자로 상기 제 1 클럭을 입력받고, 입력단자가 상기 제 3 D-플립플롭의 출력단자에 접속되며, 출력단자를 통해 상기 제 3 클럭을 출력하는 제 6 D-플립플롭

을 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

27 27

제 18 항 내지 제 25 항 중 어느 한 항에 있어서,

상기 제 5 논리 연산부의 출력신호를 반전시키기 위한 제 1 반전수단; 및

상기 비교수단의 출력신호를 반전시키기 위한 제 2 반전수단

을 더 포함하여 이루어진 데이터 통신 채널의 클럭 발생 장치

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