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ＬＤＰＣ 부호기 및 복호기, 및 ＬＤＰＣ 부호화 방법 및복호화 방법
- 기술번호 : KST2015099669
- 담당센터 : 대전기술혁신센터
- 전화번호 : 042-610-2279
| 요약 | 본 발명은 저밀도 패리티 검사(low-density parity-check, 이하 LDPC라 함) 부호기 및 복호기, LDPC 부호화 방법 및 복호화 방법에 관한 발명으로서, 특히, 크기가 큰 LDPC 부호로부터 작은 LDPC 부호를 만듦으로써, 부호기 및 복호기의 메모리를 절감할 수 있는 LDPC 부호기 및 복호기, 및 LDPC 부호화 방법 및 복호화 방법에 관한 발명이다. 본 발명은 제 1 패리티 검사 행렬을 저장하는 메모리를 포함하며, 상기 제 1 패리티 검사 행렬의 적어도 한 행인 제 1 행을 상기 제 1 패리티 검사 행렬의 나머지 행들 중 적어도 한 행인 제 2 행에 합산하여 형성한 제 2 패리티 검사 행렬을 출력하는 부호 발생 회로; 및 상기 제 2 패리티 검사 행렬 및 정보어를 입력받아 LDPC 부호화된 부호어를 출력하는 부호화 회로를 포함하는 LDPC 부호기를 제공한다. 또한, 본 발명은 제 1 패리티 검사 행렬을 저장하는 메모리를 포함하며, 상기 제 1 패리티 검사 행렬의 적어도 한 행인 제 1 행을 상기 제 1 패리티 검사 행렬의 나머지 행들 중 적어도 한 행인 제 2 행에 합산하여 형성한 제 2 패리티 검사 행렬을 출력하는 부호 발생 회로; 및 상기 제 2 패리티 검사 행렬 및 부호어를 입력받아 LDPC 복호화된 정보어를 출력하는 복호화 회로를 포함하는 LDPC 복호기를 제공한다. |
|---|---|
| Int. CL | H03M 13/11 (2006.01) |
| CPC | |
| 출원번호/일자 | 1020050063905 (2005.07.14) |
| 출원인 | 한국전자통신연구원 |
| 등록번호/일자 | 10-0641052-0000 (2006.10.25) |
| 공개번호/일자 | 10-2006-0064491 (2006.06.13) 문서열기 |
| 공고번호/일자 | (20061102) 문서열기 |
| 국제출원번호/일자 | |
| 국제공개번호/일자 | |
| 우선권정보 |
대한민국 | 1020040103240 | 2004.12.08
|
| 법적상태 | 소멸 |
| 심사진행상태 | 수리 |
| 심판사항 | |
| 구분 | |
| 원출원번호/일자 | |
| 관련 출원번호 | |
| 심사청구여부/일자 | Y (2005.07.14) |
| 심사청구항수 | 28 |
출원인
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 한국전자통신연구원 | 대한민국 | 대전광역시 유성구 |
발명자
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 이상현 | 대한민국 | 대전 서구 |
| 2 | 안재영 | 대한민국 | 대전 유성구 |
대리인
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 신영무 | 대한민국 | 서울특별시 강남구 영동대로 ***(대치동) KT&G타워 *층(에스앤엘파트너스) |
최종권리자
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 한국전자통신연구원 | 대한민국 | 대전광역시 유성구 |
| 번호 | 서류명 | 접수/발송일자 | 처리상태 | 접수/발송번호 |
|---|---|---|---|---|
| 1 | 특허출원서 Patent Application |
2005.07.14 | 수리 (Accepted) | 1-1-2005-0382306-90 |
| 2 | 선행기술조사의뢰서 Request for Prior Art Search |
2006.08.09 | 수리 (Accepted) | 9-1-9999-9999999-89 |
| 3 | 선행기술조사보고서 Report of Prior Art Search |
2006.09.14 | 수리 (Accepted) | 9-1-2006-0060376-00 |
| 4 | 등록결정서 Decision to grant |
2006.10.23 | 발송처리완료 (Completion of Transmission) | 9-5-2006-0611402-62 |
| 5 | 출원인정보변경(경정)신고서 Notification of change of applicant's information |
2009.08.04 | 수리 (Accepted) | 4-1-2009-5150899-36 |
| 6 | 출원인정보변경(경정)신고서 Notification of change of applicant's information |
2015.02.02 | 수리 (Accepted) | 4-1-2015-0006137-44 |
| 번호 | 청구항 |
|---|---|
| 1 |
1 제 1 패리티 검사 행렬을 저장하는 메모리를 포함하며, 상기 제 1 패리티 검사 행렬의 적어도 한 행인 제 1 행을 상기 제 1 패리티 검사 행렬의 나머지 행들 중 적어도 한 행인 제 2 행에 합산하여 형성한 제 2 패리티 검사 행렬을 출력하는 부호 발생 회로; 및 상기 제 2 패리티 검사 행렬 및 정보어를 입력받아 LDPC 부호화된 부호어를 출력하는 부호화 회로를 포함하는 LDPC 부호기 |
| 2 |
2 제 1 항에 있어서, 입력되는 정보어에 적어도 한 비트의 0을 부가한 상기 정보어를 상기 부호화 회로에 전달하는 0 부가 회로; 및상기 부호화 회로에서 출력되는 상기 부호어에서 적어도 한 비트의 0을 제거하여 출력하는 0 제거 회로를 더 포함하는 LDPC 부호기 |
| 3 |
3 제 1 또는 2 항에 있어서, 상기 제 1 행은 상기 제 1 패리티 검사 행렬의 상단에 있는 행인 LDPC 부호기 |
| 4 |
4 제 1 또는 2 항에 있어서, 상기 합산은 논리합 연산인 LDPC 부호기 |
| 5 |
5 제 1 또는 2 항에 있어서, 상기 제 1 패리티 검사 행렬의 각 원소의 값은 0 또는 1인 LDPC 부호기 |
| 6 |
6 제 5 항에 있어서, 상기 메모리는 상기 제 1 패리티 검사 행렬의 원소들 중 1의 위치를 저장하는 LDPC 부호기 |
| 7 |
7 제 5 항에 있어서, 상기 제 1 행 및 상기 제 2 행에 있어서, 1의 위치가 서로 겹치지 아니하는 LDPC 부호기 |
| 8 |
8 제 5 항에 있어서, 상기 부호화 회로는 상기 제 2 패리티 검사 행렬의 일부와 상기 정보어를 곱하여 출력하는 제 1 곱셈기;상기 제 1 곱셈기의 출력을 행 단위로 합산한 제 1 누산값을 출력하는 제 1 누산기;상기 제 1 누산값과 제 2 누산값을 합하여 출력하는 덧셈기;상기 덧셈기의 출력으로부터 구해지는 패리티 비트들을 출력하는 버퍼;상기 제 2 패리티 검사 행렬의 나머지와 상기 버퍼에서 출력되는 패리티 비드들을 곱하여 출력하는 제 2 곱셈기;상기 제 2 곱셈기의 출력을 행 단위로 합산한 상기 제 2 누산값을 출력하는 제 2 누산기; 및상기 버퍼로부터 최종적으로 구해진 패리티 체크어와 상기 정보어로부터 부호어를 형성하여 출력하는 부호어 형성기를 포함하는 LDPC 부호기 |
| 9 |
9 제 1 또는 2 항에 있어서, 상기 제 1 패리티 검사 행렬의 각 원소의 값은 0 행렬 내지 (M-1) 행렬 및 i0 행렬 내지 i(M-1) 행렬(M은 2 이상의 자연수, 0 행렬 내지 (M-1) 행렬은 단위 행렬을 0 내지 M-1비트만큼 쉬프트한 행렬, i0 행렬 내지 i(M-1) 행렬은 단위 행렬을 좌우 대칭한 행렬을 0 내지 M-1비트만큼 쉬프트한 행렬) 및 0 행렬 중 어느 하나인 LDPC 부호기 |
| 10 |
10 제 9 항에 있어서, 상기 메모리는 상기 제 1 패리티 검사 행렬의 원소 중 0 행렬 내지 (M-1) 행렬 및 i0 행렬 내지 i(M-1) 행렬의 위치 및 그 값을 저장하는 LDPC 부호기 |
| 11 |
11 제 9 항에 있어서, 상기 제 1 행 및 상기 제 2 행에 있어서, 0 행렬 내지 (M-1) 행렬 및 i0 행렬 내지 i(M-1) 행렬의 위치가 서로 겹치지 아니하는 LDPC 부호기 |
| 12 |
12 제 9 항에 있어서, 상기 제 1 행 및 상기 제 2 행에 있어서, 0 행렬 내지 (M-1) 행렬 및 i0 행렬 내지 i(M-1) 행렬의 위치가 서로 겹치는 경우, 겹치는 곳에 열당 1의 개수가 2인 M행 M열의 행렬을 위치시키는 LDPC 부호기 |
| 13 |
13 제 9 항에 있어서, 상기 부호화 회로는 상기 제 2 패리티 검사 행렬의 우측에 위치한 하삼각 형태의 행렬을 제외한 나머지에 대응하여 상기 정보어를 쉬프트 연산하여 출력하는 제 1 쉬프터;상기 제 1 곱셈기의 출력을 합산한 제 1 누산값을 출력하는 제 1 누산기;상기 제 1 누산값과 제 2 누산값을 합하여 출력하는 덧셈기;상기 덧셈기의 출력을 상기 제 2 패리티 검사 행렬의 우측에 위치한 하삼각 형태의 행렬의 대각선에 위치한 값에 대응하여 쉬프트 연산하여 출력하는 제 2 쉬프터;상기 제 2 쉬프터의 출력으로부터 구해지는 패리티 비트들을 출력하는 버퍼;상기 제 2 패리티 검사 행렬의 우측에 위치한 하삼각 형태의 행렬에 대응하여 상기 버퍼에서 출력되는 패리티 비트들을 쉬프트 연산하여 출력하는 제 3 쉬프터;상기 제 3 쉬프터의 출력을 합산한 상기 제 2 누산값을 출력하는 제 2 누산기; 및상기 버퍼로부터 최종적으로 구해진 패리티 체크어와 상기 정보어로부터 부호어를 형성하여 출력하는 부호어 형성기를 포함하는 LDPC 부호기 |
| 14 |
14 제 1 패리티 검사 행렬을 저장하는 메모리를 포함하며, 상기 제 1 패리티 검사 행렬의 적어도 한 행인 제 1 행을 상기 제 1 패리티 검사 행렬의 나머지 행들 중 적어도 한 행인 제 2 행에 합산하여 형성한 제 2 패리티 검사 행렬을 출력하는 부호 발생 회로; 및 상기 제 2 패리티 검사 행렬 및 부호어를 입력받아 LDPC 복호화된 정보어를 출력하는 복호화 회로를 더 포함하는 LDPC 복호기 |
| 15 |
15 제 14 항에 있어서, 입력되는 부호어에 적어도 한 비트의 0를 부가한 상기 부호어를 상기 복호화 회로에 전달하는 0 부가 회로; 및상기 복호화 회로에서 출력되는 상기 복호어에서 적어도 한 비트의 0를 제거하여 출력하는 0 제거 회로를 더 포함하는 LDPC 복호기 |
| 16 |
16 제 14 또는 15 항에 있어서, 상기 제 1 행은 상기 제 1 패리티 검사 행렬의 상단에 있는 행인 LDPC 복호기 |
| 17 |
17 제 14 또는 15 항에 있어서, 상기 합산은 논리합 연산인 LDPC 복호기 |
| 18 |
18 제 14 또는 15 항에 있어서, 상기 제 1 패리티 검사 행렬의 각 원소의 값은 0 또는 1인 LDPC 복호기 |
| 19 |
19 제 18 항에 있어서, 상기 메모리는 상기 제 1 패리티 검사 행렬의 원소들 중 1의 위치를 저장하는 LDPC 복호기 |
| 20 |
20 제 18 항에 있어서, 상기 제 1 행 및 상기 제 2 행에 있어서, 1의 위치가 서로 겹치지 아니하는 LDPC 복호기 |
| 21 |
21 제 14 또는 15 항에 있어서, 상기 제 1 패리티 검사 행렬의 각 원소의 값은 0 행렬 내지 (M-1) 행렬 및 i0 행렬 내지 i(M-1) 행렬(M은 2 이상의 자연수, 0 행렬 내지 (M-1) 행렬은 단위 행렬을 0 내지 M-1비트만큼 쉬프트한 행렬, i0 행렬 내지 i(M-1) 행렬은 단위 행렬을 좌우 대칭한 행렬을 0 내지 M-1비트만큼 쉬프트한 행렬) 및 0 행렬 중 어느 하나인 LDPC 복호기 |
| 22 |
22 제 21 항에 있어서, 상기 메모리는 상기 제 1 패리티 검사 행렬의 원소 중 0 행렬 내지 (M-1) 행렬 및 i0 행렬 내지 i(M-1) 행렬의 위치 및 그 값을 저장하는 LDPC 복호기 |
| 23 |
23 제 21 항에 있어서, 상기 제 1 행 및 상기 제 2 행에 있어서, 0 행렬 내지 (M-1) 행렬 및 i0 행렬 내지 i(M-1) 행렬의 위치가 서로 겹치지 아니하는 LDPC 복호기 |
| 24 |
24 제 21 항에 있어서, 상기 제 1 행 및 상기 제 2 행에 있어서, 0 행렬 내지 (M-1) 행렬 및 i0 행렬 내지 i(M-1) 행렬의 위치가 서로 겹치는 경우, 겹치는 곳에 열당 1의 개수가 2인 M행 M열의 행렬을 위치시키는 LDPC 복호기 |
| 25 |
25 제 1 패리티 검사 행렬을 저장하는 메모리를 포함하며, 상기 제 1 패리티 검사 행렬의 적어도 한 행인 제 1 행을 제거하여 형성한 제 2 패리티 검사 행렬을 출력하는 부호 발생 회로; 및 상기 제 2 패리티 검사 행렬 및 정보어를 입력받아 LDPC 부호화된 부호어를 출력하는 부호화 회로를 포함하는 LDPC 부호기 |
| 26 |
26 제 1 패리티 검사 행렬을 저장하는 메모리를 포함하며, 상기 제 1 패리티 검사 행렬의 적어도 한 행인 제 1 행을 제거하여 형성한 제 2 패리티 검사 행렬을 출력하는 부호 발생 회로; 및 상기 제 2 패리티 검사 행렬 및 부호어를 입력받아 LDPC 복호화된 정보어를 출력하는 복호화 회로를 더 포함하는 LDPC 복호기 |
| 27 |
27 제 1 패리티 검사 행렬을 메모리에 저장하는 단계;상기 제 1 패리티 검사 행렬의 적어도 한 행인 제 1 행을 상기 제 1 패리티 검사 행렬의 나머지 행들 중 적어도 한 행인 제 2 행에 합산함으로써, 제 2 패리티 검사 행렬을 형성하는 단계; 및 상기 제 2 패리티 검사 행렬 및 정보어를 입력받아 LDPC 부호화하는 단계를 포함하는 부호화 방법 |
| 28 |
28 제 1 패리티 검사 행렬을 메모리에 저장하는 단계;상기 제 1 패리티 검사 행렬의 적어도 한 행인 제 1 행을 상기 제 1 패리티 검사 행렬의 나머지 행들 중 적어도 한 행인 제 2 행에 합산함으로써, 제 2 패리티 검사 행렬을 형성하는 단계; 및 상기 제 2 패리티 검사 행렬 및 부호어를 입력받아 LDPC 복호화하는 단계를 포함하는 복호화 방법 |
| 지정국 정보가 없습니다 |
|---|
| 순번 | 패밀리번호 | 국가코드 | 국가명 | 종류 |
|---|---|---|---|---|
| 1 | CN101073205 | CN | 중국 | FAMILY |
| 2 | EP01820275 | EP | 유럽특허청(EPO) | FAMILY |
| 3 | US07882418 | US | 미국 | FAMILY |
| 4 | US20090249159 | US | 미국 | FAMILY |
| 5 | WO2006062351 | WO | 세계지적재산권기구(WIPO) | FAMILY |
DOCDB 패밀리 정보
| 순번 | 패밀리번호 | 국가코드 | 국가명 | 종류 |
|---|---|---|---|---|
| 1 | CN101073205 | CN | 중국 | DOCDBFAMILY |
| 2 | CN101073205 | CN | 중국 | DOCDBFAMILY |
| 3 | US2009249159 | US | 미국 | DOCDBFAMILY |
| 4 | US7882418 | US | 미국 | DOCDBFAMILY |
| 국가 R&D 정보가 없습니다. |
|---|
- 본 등록정보는 참고용으로 법적증빙자료로 사용할 수 없습니다.
- 데이터 이관에 따른 소요기간(1일)으로 인하여 등록원부와 일부 차이가 발생할 수 있으며, 일부 정보(부기, 상세 주소 등)를 제공하지 않고 있습니다.
- 법적증빙자료로 활용하시거나 더 자세한 정보를 보시려면 등록원부를 발급받아 사용하시기 바랍니다.
| 특허 등록번호 | 10-0641052-0000 |
|---|
권리란
| 표시번호 | 사항 |
|---|---|
| 1 |
출원 연월일 : 20050714 출원 번호 : 1020050063905 공고 연월일 : 20061102 공고 번호 : 특허결정(심결)연월일 : 20061023 청구범위의 항수 : 28 유별 : H03M 13/11 발명의 명칭 : ＬＤＰＣ 부호기 및 복호기, 및 ＬＤＰＣ 부호화 방법 및복호화 방법 존속기간(예정)만료일 : 20121026 |
특허권자란
| 순위번호 | 사항 |
|---|---|
| 1 |
(권리자) 한국전자통신연구원 대전광역시 유성구... |
등록료란
| 제 1 - 3 년분 | 금 액 | 796,500 원 | 2006년 10월 26일 | 납입 |
| 제 4 년분 | 금 액 | 656,000 원 | 2009년 10월 01일 | 납입 |
| 제 5 년분 | 금 액 | 656,000 원 | 2010년 10월 01일 | 납입 |
| 제 6 년분 | 금 액 | 656,000 원 | 2011년 10월 07일 | 납입 |
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- 해당 서비스는 점검으로 인해 매주 일요일 00:00 ~ 02:00까지 이용이 중단됩니다.
| 번호 | 서류명 | 접수/발송일자 | 처리상태 | 접수/발송번호 |
|---|---|---|---|---|
| 1 | 특허출원서 | 2005.07.14 | 수리 (Accepted) | 1-1-2005-0382306-90 |
| 2 | 선행기술조사의뢰서 | 2006.08.09 | 수리 (Accepted) | 9-1-9999-9999999-89 |
| 3 | 선행기술조사보고서 | 2006.09.14 | 수리 (Accepted) | 9-1-2006-0060376-00 |
| 4 | 등록결정서 | 2006.10.23 | 발송처리완료 (Completion of Transmission) | 9-5-2006-0611402-62 |
| 5 | 출원인정보변경(경정)신고서 | 2009.08.04 | 수리 (Accepted) | 4-1-2009-5150899-36 |
| 6 | 출원인정보변경(경정)신고서 | 2015.02.02 | 수리 (Accepted) | 4-1-2015-0006137-44 |
| 기술정보가 없습니다 |
|---|
| 과제고유번호 | 1440001561 |
|---|---|
| 세부과제번호 | iita2004-S-098 |
| 연구과제명 | 40G모듈 |
| 성과구분 | 등록 |
| 부처명 | 지식경제부 |
| 연구관리전문기관명 | 정보통신연구진흥원 |
| 연구주관기관명 | 한국전자통신연구원 |
| 성과제출연도 | 2004 |
| 연구기간 | 200202~200501 |
| 기여율 | 1 |
| 연구개발단계명 | 개발연구 |
| 6T분류명 | IT(정보기술) |
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| [KST2016006888][한국전자통신연구원] | 길이가 16200이며, 부호율이 2/15인 LDPC 부호화기 및 이를 이용한 LDPC 부호화 방법(LOW DENSITY PARITY CHECK ENCODER WITH 16200 LENGTH AND 2/15 RATE, AND METHOD USING THE SAME) | 새창보기 |
| [KST2016014108][한국전자통신연구원] | 길이가 64800이며, 부호율이 4/15인 LDPC 부호어 및 QPSK를 위한 비트 인터리버 및 이를 이용한 비트 인터리빙 방법(BIT INTERLEAVER FOR QPSK AND LOW DENSITY PARITY CHECK CODEWORD WITH 64800 LENGTH, 4/15 RATE, AND METHOD USING THE SAME) | 새창보기 |
| [KST2016016170][한국전자통신연구원] | 가변 길이 시그널링 정보 부호화를 위한 패리티 인터리빙 장치 및 이를 이용한 패리티 인터리빙 방법(APPARATUS OF PARITY INTERLEAVING FOR ENCODING VARIABLE-LENGTH SIGNALING INFORMATION AND METHOD USING THE SAME) | 새창보기 |
| [KST2016016172][한국전자통신연구원] | 고정 길이 시그널링 정보 부호화를 위한 패리티 인터리빙 장치 및 이를 이용한 패리티 인터리빙 방법(APPARATUS OF PARITY INTERLEAVING FOR ENCODING FIXED-LENGTH SIGNALING INFORMATION AND METHOD USING THE SAME) | 새창보기 |
| [KST2016014367][한국전자통신연구원] | 길이가 16200이며, 부호율이 2/15인 LDPC 부호어 및 16-심볼 맵핑을 위한 비트 인터리버 및 이를 이용한 비트 인터리빙 방법(BIT INTERLEAVER FOR 16-SYMBOL MAPPING AND LOW DENSITY PARITY CHECK CODEWORD WITH 16200 LENGTH, 2/15 RATE, AND METHOD USING THE SAME) | 새창보기 |
| [KST2016016167][한국전자통신연구원] | 가변 길이 시그널링 정보 부호화를 위한 패리티 펑처링 장치 및 이를 이용한 패리티 펑처링 방법(APPARATUS OF PARITY PUNCTURING FOR ENCODING VARIABLE-LENGTH SIGNALING INFORMATION AND METHOD USING THE SAME) | 새창보기 |
| [KST2016015491][한국전자통신연구원] | 길이가 64800이며, 부호율이 2/15인 LDPC 부호어 및 16-심볼 맵핑을 위한 비트 인터리버 및 이를 이용한 비트 인터리빙 방법(BIT INTERLEAVER FOR 16-SYMBOL MAPPING AND LOW DENSITY PARITY CHECK CODEWORD WITH 64800 LENGTH, 2/15 RATE, AND METHOD USING THE SAME) | 새창보기 |
| [KST2016014378][한국전자통신연구원] | 길이가 16200이며, 부호율이 2/15인 LDPC 부호어 및 256-심볼 맵핑을 위한 비트 인터리버 및 이를 이용한 비트 인터리빙 방법(BIT INTERLEAVER FOR 256-SYMBOL MAPPING AND LOW DENSITY PARITY CHECK CODEWORD WITH 16200 LENGTH, 2/15 RATE, AND METHOD USING THE SAME) | 새창보기 |
| [KST2016014380][한국전자통신연구원] | 길이가 64800이며, 부호율이 4/15인 LDPC 부호어 및 64-심볼 맵핑을 위한 비트 인터리버 및 이를 이용한 비트 인터리빙 방법(BIT INTERLEAVER FOR 64-SYMBOL MAPPING AND LOW DENSITY PARITY CHECK CODEWORD WITH 64800 LENGTH, 4/15 RATE, AND METHOD USING THE SAME) | 새창보기 |
| [KST2016006883][한국전자통신연구원] | 길이가 64800이며, 부호율이 3/15인 LDPC 부호화기 및 이를 이용한 LDPC 부호화 방법(LOW DENSITY PARITY CHECK ENCODER WITH 64800 LENGTH AND 3/15 RATE, AND METHOD USING THE SAME) | 새창보기 |
| [KST2016006884][한국전자통신연구원] | 길이가 64800이며, 부호율이 4/15인 LDPC 부호화기 및 이를 이용한 LDPC 부호화 방법(LOW DENSITY PARITY CHECK ENCODER WITH 64800 LENGTH AND 4/15 RATE, AND METHOD USING THE SAME) | 새창보기 |
| [KST2016014118][한국전자통신연구원] | 길이가 64800이며, 부호율이 2/15인 LDPC 부호어 및 QPSK를 위한 비트 인터리버 및 이를 이용한 비트 인터리빙 방법(BIT INTERLEAVER FOR QPSK AND LOW DENSITY PARITY CHECK CODEWORD WITH 64800 LENGTH, 2/15 RATE, AND METHOD USING THE SAME) | 새창보기 |
| [KST2016016169][한국전자통신연구원] | 고정 길이 시그널링 정보 부호화를 위한 제로 패딩 장치 및 이를 이용한 제로 패딩 방법(APPARATUS OF ZERO PADDING FOR ENCODING FIXED-LENGTH SIGNALING INFORMATION AND METHOD USING THE SAME) | 새창보기 |
| [KST2016016171][한국전자통신연구원] | 가변 길이 시그널링 정보 부호화를 위한 제로 패딩 장치 및 이를 이용한 제로 패딩 방법(APPARATUS OF ZERO PADDING FOR ENCODING VARIABLE-LENGTH SIGNALING INFORMATION AND METHOD USING THE SAME) | 새창보기 |
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