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잔류전압의 오차교정이 가능한 다중 디지털 아날로그변환회로 및 샘플/홀드 회로

  • 기술번호 : KST2015118768
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 가변 캐패시터를 이용하여 연산증폭기의 충분하지 못한 이득에 의한 오차를 줄일 수 있도록 함으로써 잔류전압의 오차교정이 가능한 다중 디지털 아날로그 변환회로 및 샘플/홀드 회로를 제공하며, 본 발명의 잔류전압의 오차교정이 가능한 다중 디지털 아날로그 변환회로는 샘플링 캐패시터에 병렬로 연결되며, 샘플링 위상시 아날로그 입력신호를 샘플링하고 증폭 위상시 복수개의 서로 다른 기준전압에 연결되어 연산증폭기의 이득을 보정하는 제1 이득보정수단; 샘플링 캐패시터 및 귀환 캐패시터에 각각 병렬로 연결되며, 샘플링 위상시 아날로그 입력신호를 샘플링하고 증폭 위상시 소정 고정 전압에 연결되어 연산증폭기의 이득을 보정하는 제2 이득보정수단; 및 외부로부터의 스위치 제어신호에 따라 샘플링 위상과 증폭 위상시 상기 샘플링 캐패시터, 귀환 캐패시터 및 제1, 제2 이득보정수단이 아날로그 입력신호를 샘플링하거나 또는 해당하는 소정 전압에 연결될 수 있도록 스위칭되는 스위칭 수단;으로 구성됨을 특징으로 하며, 이러한 본 발명은 구성이 간단하고 추가적인 회로가 많지 않아 추가 전력소모 증가없이 오차를 교정할 수 있게 된다.MDAC, 샘플/홀드회로, 가변 캐패시터, 오차 보상, 잔류전압, 파이프라인
Int. CL H03M 1/70 (2006.01)
CPC H03M 1/1023(2013.01) H03M 1/1023(2013.01) H03M 1/1023(2013.01) H03M 1/1023(2013.01) H03M 1/1023(2013.01)
출원번호/일자 1020050051818 (2005.06.16)
출원인 한국과학기술원
등록번호/일자 10-0756426-0000 (2007.08.31)
공개번호/일자 10-2006-0131395 (2006.12.20) 문서열기
공고번호/일자 (20070907) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2005.06.16)
심사청구항수 8

출원인

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번호 이름 국적 주소
1 한국과학기술원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 조규형 대한민국 충남 공주시
2 김이경 대한민국 대전 유성구
3 곽태우 대한민국 대구 달서구
4 이광찬 대한민국 전남 보성군
5 김성은 대한민국 충남 천안시

대리인

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번호 이름 국적 주소
1 이원희 대한민국 서울특별시 강남구 테헤란로 ***, 성지하이츠빌딩*차 ***호 (역삼동)

최종권리자

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번호 이름 국적 주소
1 주식회사 아이카이스트 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 2005.06.16 수리 (Accepted) 1-1-2005-0318458-86
2 선행기술조사의뢰서
Request for Prior Art Search		 2006.07.10 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search		 2006.08.11 수리 (Accepted) 9-1-2006-0051301-86
4 의견제출통지서
Notification of reason for refusal		 2006.09.29 발송처리완료 (Completion of Transmission) 9-5-2006-0572670-21
5 지정기간연장신청서
Request for Extension of Designated Period		 2006.11.29 수리 (Accepted) 1-1-2006-0885073-90
6 지정기간연장신청서
Request for Extension of Designated Period		 2006.12.26 수리 (Accepted) 1-1-2006-0960134-70
7 지정기간연장신청서
Request for Extension of Designated Period		 2007.01.26 수리 (Accepted) 1-1-2007-0079962-60
8 지정기간연장신청서
Request for Extension of Designated Period		 2007.02.28 수리 (Accepted) 1-1-2007-0173228-59
9 의견서
Written Opinion		 2007.03.28 수리 (Accepted) 1-1-2007-0243003-69
10 명세서등보정서
Amendment to Description, etc.		 2007.03.28 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2007-0243001-78
11 등록결정서
Decision to grant		 2007.08.29 발송처리완료 (Completion of Transmission) 9-5-2007-0468143-54
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2013.02.01 수리 (Accepted) 4-1-2013-5019983-17
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.12.24 수리 (Accepted) 4-1-2014-5157968-69
14 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.12.24 수리 (Accepted) 4-1-2014-5157993-01
15 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.12.24 수리 (Accepted) 4-1-2014-5158129-58
16 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.04.24 수리 (Accepted) 4-1-2019-5081392-49
17 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2020.05.15 수리 (Accepted) 4-1-2020-5108396-12
18 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2020.06.12 수리 (Accepted) 4-1-2020-5131486-63
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
연산증폭기와, 상기 연산증폭기의 반전 입력단에 각각 병렬로 연결된 샘플링 커패시터와 귀한 커패시터를 포함하는 다중 디지털 아날로그 변환회로에 있어서, 상기 샘플링 캐패시터에 병렬로 연결되며, 샘플링 위상시에는 아날로그 입력신호를 샘플링하고 증폭 위상시에는 아날로그 디지털 변환회로에서 변환되어 출력된 복수개의 서로 다른 기준전압 중 어느 하나에 선택적으로 연결되어 상기 연산증폭기의 이득을 보정하는 이득보정수단; 및 외부로부터의 스위치 제어신호에 따라 샘플링 위상과 증폭 위상시 상기 샘플링 캐패시터, 귀환 캐패시터 및 이득보정수단이 아날로그 입력신호를 샘플링하거나 또는 해당하는 소정 전압에 연결될 수 있도록 스위칭되는 스위칭 수단;을 포함하여 구성됨을 특징으로 하는 잔류전압의 오차교정이 가능한 다중 디지털 아날로그 변환회로
2 2
제 1 항에 있어서, 상기 이득보정수단은 가변 캐패시터로 구성됨을 특징으로 하는 잔류전압의 오차교정이 가능한 다중 디지털 아날로그 변환회로
3 3
연산증폭기와, 상기 연산증폭기의 반전 입력단에 각각 병렬로 연결된 샘플링 커패시터와 귀한 커패시터를 포함하는 다중 디지털 아날로그 변환회로에 있어서, 상기 샘플링 캐패시터에 병렬로 연결되며, 샘플링 위상시에는 아날로그 입력신호를 샘플링하고 증폭 위상시에는 아날로그 디지털 변환회로에서 변환되어 출력된 복수개의 서로 다른 기준전압 중 어느 하나에 선택적으로 연결되어 상기 연산증폭기의 이득을 보정하는 제1 이득보정수단; 상기 샘플링 캐패시터 및 귀환 캐패시터에 각각 병렬로 연결되며, 샘플링 위상시 아날로그 입력신호를 샘플링하고 증폭 위상시 아날로그 디지털 변환회로에서 변환되어 출력된 기준전압에 연결되어 상기 연산증폭기의 이득을 보정하는 제2 이득보정수단; 및 외부로부터의 스위치 제어신호에 따라 샘플링 위상과 증폭 위상시 상기 샘플링 캐패시터, 귀환 캐패시터 및 제1, 제2 이득보정수단이 아날로그 입력신호를 샘플링하거나 또는 해당하는 소정 전압에 연결될 수 있도록 스위칭되는 스위칭 수단;을 포함하여 구성됨을 특징으로 하는 잔류전압의 오차교정이 가능한 다중 디지털 아날로그 변환회로
4 4
제 3 항에 있어서, 상기 제1, 제2 이득보정수단은 가변 캐패시터로 구성됨을 특징으로 하는 잔류전압의 오차교정이 가능한 다중 디지털 아날로그 변환회로
5 5
샘플링 캐패시터와 귀환 캐패시터 및 연산증폭기를 이용하여 아날로그 입력신호를 샘플링하는 전하재분배방식의 샘플/홀드 회로에 있어서, 상기 샘플링 캐패시터에 병렬로 연결되며, 샘플링 위상시 아날로그 입력신호를 샘플링하고 증폭 위상시 소정 고정 전압에 연결되어 상기 연산증폭기의 이득을 보정하는 이득보정수단을 더 포함함과 더불어 상기 샘플링 캐패시터는 귀환 캐패시터보다 큰 용량을 갖도록 구성됨을 특징으로 하는 샘플/홀드 회로
6 6
제 5 항에 있어서, 상기 이득보정수단은 가변 캐패시터로 구성되는 것을 특징으로 하는 샘플/홀드 회로
7 7
샘플링 캐패시터와 귀환 캐패시터 및 연산증폭기를 이용하여 아날로그 입력신호를 샘플링하는 전하재분배방식의 샘플/홀드 회로에 있어서, 상기 샘플링 캐패시터에 병렬로 연결되며, 샘플링 위상시 아날로그 입력신호를 샘플링하고 증폭 위상시 소정 고정 전압에 연결되어 상기 연산증폭기의 이득을 보정하는 제1 이득보정수단; 상기 샘플링 캐패시터 및 귀환 캐패시터에 각각 병렬로 연결되며, 샘플링 위상시 아날로그 입력신호를 샘플링하고 증폭 위상시 소정 고정 전압에 연결되어 상기 연산증폭기의 이득을 보정하는 제2 이득보정수단; 및 외부로부터의 스위치 제어신호에 따라 샘플링 위상과 증폭 위상시 상기 샘플링 캐패시터, 귀환 캐패시터 및 제1, 제2 이득보정수단이 아날로그 입력신호를 샘플링하거나 또는 소정 고정 전압에 연결될 수 있도록 스위칭되는 스위칭 수단;을 포함하여 이루어지는 것을 특징으로 하는 샘플/홀드 회로
8 8
제 7 항에 있어서, 상기 제1, 제2 이득보정수단은 가변 캐패시터로 구성됨을 특징으로 하는 샘플/홀드 회로
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.