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액정 디스플레이 픽셀 구조

  • 기술번호 : KST2015190560
  • 담당센터 : 대구기술혁신센터
  • 전화번호 : 053-550-1450
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 액정 디스플레이 픽셀 구조에 대한 기술이 개시(disclosure)된다. 일 실시 예에 있어서, 액정 디스플레이 픽셀 구조는 서로 이격되어 평행하게 배치된 제1 게이트 라인과 제2 게이트 라인, 상기 제1 및 제2 게이트 라인과 서로 교차하도록 배치된 데이터 라인, 상기 제1 게이트 라인과 전기적으로 연결되는 게이트 전극 및 상기 데이터 라인과 전기적으로 연결되는 드레인 전극을 포함하는 NMOS 트랜지스터, 상기 제2 게이트 라인과 전기적으로 연결되는 게이트 전극, 상기 데이터 라인과 전기적으로 연결되는 소스 전극 및 상기 NMOS 트랜지스터의 소스 전극과 전기적으로 연결되는 드레인 전극을 포함하는 PMOS 트랜지스터 및 상기 NMOS 트랜지스터의 상기 소스 전극과 전기적으로 연결되는 액정 커패시터를 포함한다.
Int. CL G02F 1/133 (2006.01) G09G 3/36 (2006.01)
CPC G09G 3/3648(2013.01) G09G 3/3648(2013.01) G09G 3/3648(2013.01) G09G 3/3648(2013.01)
출원번호/일자 1020090132518 (2009.12.29)
출원인 재단법인대구경북과학기술원
등록번호/일자
공개번호/일자 10-2011-0075944 (2011.07.06) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 거절
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2009.12.29)
심사청구항수 7

출원인

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번호 이름 국적 주소
1 재단법인대구경북과학기술원 대한민국 대구 달성군 현

발명자

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번호 이름 국적 주소
1 최병대 대한민국 대구 수성구
2 이용환 대한민국 서울특별시 송파구
3 정훈주 대한민국 경상북도 구미시
4 도윤선 대한민국 대구광역시 서구
5 양기정 대한민국 대구 북구
6 류홍근 대한민국 대구광역시 달성군 화원읍

대리인

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번호 이름 국적 주소
1 남정길 대한민국 서울특별시 강남구 테헤란로**길 **, 인화빌딩 *층 (삼성동)(특허법인(유한)아이시스)

최종권리자

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번호 이름 국적 주소
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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2009.12.29 수리 (Accepted) 1-1-2009-0810603-67
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2010.01.13 수리 (Accepted) 4-1-2010-5006262-09
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2010.04.06 수리 (Accepted) 4-1-2010-5060059-92
4 출원인정보변경(경정)신고서
Notification of change of applicant's information
2011.01.13 수리 (Accepted) 4-1-2011-5007932-94
5 선행기술조사의뢰서
Request for Prior Art Search
2011.02.11 수리 (Accepted) 9-1-9999-9999999-89
6 선행기술조사보고서
Report of Prior Art Search
2011.03.15 수리 (Accepted) 9-1-2011-0021712-52
7 의견제출통지서
Notification of reason for refusal
2011.04.07 발송처리완료 (Completion of Transmission) 9-5-2011-0188715-08
8 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)
2011.06.07 수리 (Accepted) 1-1-2011-0426645-70
9 보정요구서
Request for Amendment
2011.06.16 발송처리완료 (Completion of Transmission) 1-5-2011-0053192-33
10 [출원서등 보정]보정서(납부자번호)
[Amendment to Patent Application, etc.] Amendment(Payer number)
2011.06.20 수리 (Accepted) 1-1-2011-0455140-05
11 거절결정서
Decision to Refuse a Patent
2011.08.24 발송처리완료 (Completion of Transmission) 9-5-2011-0474827-99
12 출원인정보변경(경정)신고서
Notification of change of applicant's information
2012.07.31 수리 (Accepted) 4-1-2012-5164104-34
13 출원인정보변경(경정)신고서
Notification of change of applicant's information
2012.07.31 수리 (Accepted) 4-1-2012-5164108-16
14 출원인정보변경(경정)신고서
Notification of change of applicant's information
2013.11.11 수리 (Accepted) 4-1-2013-5149764-85
15 출원인정보변경(경정)신고서
Notification of change of applicant's information
2018.12.18 수리 (Accepted) 4-1-2018-5260250-39
16 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.06.18 수리 (Accepted) 4-1-2020-5134633-04
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
액정 디스플레이 픽셀 구조에 있어서, 서로 이격되어 평행하게 배치된 제1 게이트 라인과 제2 게이트 라인; 상기 제1 및 제2 게이트 라인과 서로 교차하도록 배치된 데이터 라인; 상기 제1 게이트 라인과 전기적으로 연결되는 게이트 전극 및 상기 데이터 라인과 전기적으로 연결되는 드레인 전극을 포함하는 NMOS 트랜지스터; 상기 제2 게이트 라인과 전기적으로 연결되는 게이트 전극, 상기 데이터 라인과 전기적으로 연결되는 소스 전극 및 상기 NMOS 트랜지스터의 소스 전극과 전기적으로 연결되는 드레인 전극을 포함하는 PMOS 트랜지스터; 및 상기 NMOS 트랜지스터의 상기 소스 전극과 전기적으로 연결되는 액정 커패시터를 포함하는 액정 디스플레이 픽셀 구조
2 2
액정 디스플레이 픽셀 구조에 있어서, 게이트 라인 및 상기 게이트 라인과 서로 교차하도록 배치된 데이터 라인; 상기 게이트 라인의 신호를 입력받아 역변환 신호를 출력하는 인버터; 상기 게이트 라인과 전기적으로 연결되는 게이트 전극 및 상기 데이터 라인과 전기적으로 연결되는 드레인 전극을 포함하는 NMOS 트랜지스터; 상기 인버터의 출력단과 전기적으로 연결되는 게이트 전극, 상기 데이터 라인과 전기적으로 연결되는 소스 전극 및 상기 NMOS 트랜지스터의 소스 전극과 전기적으로 연결되는 드레인 전극을 포함하는 PMOS 트랜지스터; 및 상기 NMOS 트랜지스터의 상기 소스 전극과 전기적으로 연결되는 액정 커패시터를 포함하는 액정 디스플레이 픽셀 구조
3 3
액정 디스플레이 픽셀 구조에 있어서, 게이트 라인 및 상기 게이트 라인과 서로 교차하도록 배치된 데이터 라인; 상기 게이트 라인의 신호를 입력받아 역변환 신호를 출력하는 인버터; 상기 게이트 라인과 전기적으로 연결되는 게이트 전극 및 상기 데이터 라인과 전기적으로 연결되는 소스 전극을 포함하는 PMOS 트랜지스터; 상기 인버터의 출력단과 전기적으로 연결되는 게이트 전극, 상기 데이터 라인과 전기적으로 연결되는 드레인 전극 및 상기 PMOS 트랜지스터의 드레인 전극과 전기적으로 연결되는 소스 전극을 포함하는 NMOS 트랜지스터; 및 상기 NMOS 트랜지스터의 상기 소스 전극과 전기적으로 연결되는 액정 커패시터를 포함하는 액정 디스플레이 픽셀 구조
4 4
제1항 내지 제3항 중 어느 한 항에 있어서, 상기 NMOS 트랜지스터의 상기 소스 전극과 전기적으로 연결되는 저장 커패시터를 더 포함하는 액정 디스플레이 픽셀 구조
5 5
제1항 내지 제3항 중 어느 한 항에 있어서, 상기 NMOS 트랜지스터 및 상기 PMOS 트랜지스터 각각은 단결정 실리콘 기판에 집적된 트랜지스터를 포함하는 액정 디스플레이 픽셀 구조
6 6
제1항 내지 제3항 중 어느 한 항에 있어서, 상기 NMOS 트랜지스터 및 상기 PMOS 트랜지스터 각각은 다결정 실리콘 박막에 집적된 트랜지스터를 포함하는 액정 디스플레이 픽셀 구조
7 7
제1항 내지 제3항 중 어느 한 항에 있어서, 상기 액정 디스플레이는 실리콘 액정(liquid crystal on silicon) 디스플레이를 포함하는 액정 디스플레이 픽셀 구조
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.