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내장형 자체테스트 패턴 생성시의 하드웨어 오버헤드축소방법 및 장치

  • 기술번호 : KST2015209824
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 결정패턴 생성 전에도 두 하드웨어가 많은 역할을 수행하도록 하여, 기존의 의사무작위 패턴 생성에 필요한 하드웨어를 줄이면서도, 전혀 테스트 시간이 증가되지 않도록 하는 방법을 제공함을 목적으로 한다. 스캔체인을 이용하여 CUT를 테스트하는 내장형 자체테스트 방법으로서, LFSR을, N비트의 패턴카운터 및 비트카운터의 N비트중 한 비트를 제외한 (N-1)비트중 한 비트만 스캔체인으로 보내도록 구성하는 것을 특징으로 한다. BIST, LFSR, 테스트패턴
Int. CL G06F 11/26 (2006.01)
CPC G06F 11/27(2013.01) G06F 11/27(2013.01)
출원번호/일자 1020040104761 (2004.12.13)
출원인 학교법인연세대학교
등록번호/일자
공개번호/일자 10-2006-0066233 (2006.06.16) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 거절
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2004.12.13)
심사청구항수 10

출원인

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번호 이름 국적 주소
1 학교법인연세대학교 대한민국 서울특별시 서대문구

발명자

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번호 이름 국적 주소
1 강성호 대한민국 서울시 서대문구
2 송동섭 대한민국 서울시 서대문구

대리인

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번호 이름 국적 주소
1 리앤목특허법인 대한민국 서울 강남구 언주로 **길 **, *층, **층, **층, **층(도곡동, 대림아크로텔)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2004.12.13 수리 (Accepted) 1-1-2004-0585458-36
2 대리인변경신고서
Agent change Notification
2006.01.13 수리 (Accepted) 1-1-2006-0025556-03
3 선행기술조사의뢰서
Request for Prior Art Search
2006.03.16 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search
2006.04.14 수리 (Accepted) 9-1-2006-0024727-99
5 의견제출통지서
Notification of reason for refusal
2006.04.18 발송처리완료 (Completion of Transmission) 9-5-2006-0215890-30
6 거절결정서
Decision to Refuse a Patent
2006.08.30 발송처리완료 (Completion of Transmission) 9-5-2006-0508173-17
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2010.11.05 수리 (Accepted) 4-1-2010-5207014-07
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2010.11.29 수리 (Accepted) 4-1-2010-5224078-51
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
스캔체인을 이용하여 CUT를 테스트하는 내장형 자체테스트 방법으로서, 테스트패턴을 생성해서 스캐체인으로 보내는 LFSR과, 스캔체인에 시프트 과정이 끝나고 테스트 대상 회로에 패턴을 가하는 시점을 알려주는 비트카운터와, 패턴을 생성하고 의사무작위 테스트가 끝나는 시점을 알려주는 패턴카운터를 포함하며, 상기 LFSR은 N비트의 패턴카운터 및 비트카운터의 N비트중 한 비트를 제외한 (N-1)비트중 한 비트만 스캔체인으로 보내는 것을 특징으로 하는, 내장형 자체테스트 패턴 생성시의 하드웨어 오버헤드 축소방법
2 2
제1항에 있어서, 상기 LFSR이 N비트의 패턴카운터 및 비트카운터의 N비트중 한 비트를 제외한 (N-1)비트중 한 비트만 스캔체인으로 보내는 것은 멀티플렉서를 이용하여 수행되는 것을 특징으로 하는, 내장형 자체테스트 패턴 생성시의 하드웨어 오버헤드 축소방법
3 3
제1항에 있어서, 상기 패턴카운터와 비트카운터는 각각 일반 카운터 형태인 것을 특징으로 하는, 내장형 자체테스트 패턴 생성시의 하드웨어 오버헤드 축소방법
4 4
제1항에 있어서, 상기 패턴카운터와 비트카운터는 각각 LFSR 형태인 것을 특징으로 하는, 내장형 자체테스트 패턴 생성시의 하드웨어 오버헤드 축소방법
5 5
제4항에 있어서, 상기 패턴카운터는 XOR 게이트가 내부에 포함되어 있는 LFSR인 것을 특징으로 하는, 내장형 자체테스트 패턴 생성시의 하드웨어 오버헤드 축소방법
6 6
스캔체인을 이용하여 CUT를 테스트하는 내장형 자체테스트 방법으로서, 테스트패턴을 생성해서 스캐체인으로 보내는 LFSR과, 스캔체인에 시프트 과정이 끝나고 테스트 대상 회로에 패턴을 가하는 시점을 알려주는 비트카운터와, 패턴을 생성하고 의사무작위 테스트가 끝나는 시점을 알려주는 패턴카운터를 포함하되, 상기 LFSR은 N비트의 패턴카운터 및 비트카운터의 N비트중 한 비트를 제외한 (N-1)비트중 한 비트만 스캔체인으로 보내는 것을 특징으로 하는, 내장형 자체테스트 패턴 생성시의 하드웨어 오버헤드 축소장치
7 7
제6항에 있어서, 상기 LFSR이 N비트의 패턴카운터 및 비트카운터의 N비트중 한 비트를 제외한 (N-1)비트중 한 비트만 스캔체인으로 보내기 위한 멀티플렉서가 추가로 포함되는 것을 특징으로 하는, 내장형 자체테스트 패턴 생성시의 하드웨어 오버헤드 축소장치
8 8
제6항에 있어서, 상기 패턴카운터와 비트카운터는 각각 일반 카운터 형태인 것을 특징으로 하는, 내장형 자체테스트 패턴 생성시의 하드웨어 오버헤드 축소장치
9 9
제6항에 있어서, 상기 패턴카운터와 비트카운터는 각각 LFSR 형태인 것을 특징으로 하는, 내장형 자체테스트 패턴 생성시의 하드웨어 오버헤드 축소장치
10 10
제9항에 있어서, 상기 패턴카운터는 XOR 게이트가 내부에 포함되어 있는 LFSR인 것을 특징으로 하는, 내장형 자체테스트 패턴 생성시의 하드웨어 오버헤드 축소장치
11 10
제9항에 있어서, 상기 패턴카운터는 XOR 게이트가 내부에 포함되어 있는 LFSR인 것을 특징으로 하는, 내장형 자체테스트 패턴 생성시의 하드웨어 오버헤드 축소장치
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.