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128비트 확장된 데이터 블록을 갖는 HIGHT 암호화/복호화 장치(HIGHT encoding/decoding apparatus having extended data block of 128bits)

  • 기술번호 : KST2017000170
  • 담당센터 : 서울동부기술혁신센터
  • 전화번호 : 02-2155-3662
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 128비트 HIGHT 암호화/복호화 장치가 개시된다. 128비트 HIGHT 암호화/복호화 장치는 128비트 마스터 키를 입력하여 암호화 및 복호화를 위한 화이트닝 키 및 서브키를 발생하는 키 스케줄러; 모드 신호 그리고 상기 키 스케줄러에서 제공되는 화이트닝 키 및 서브키에 따라 128비트 입력의 상위 64비트에 대한 HIGHT 암호화/복호화 처리를 수행하는 제1라운드 블록; 모드 신호 그리고 상기 키 스케줄러에서 제공되는 화이트닝 키 및 서브키에 따라 128비트 입력의 하위 64비트에 대한 HIGHT 암호화/복호화 처리를 수행하는 제2라운드 블록; 및 상기 키 스케줄러, 제1라운드 함수 블록, 제2라운드 함수 블록의 동작을 제어하는 모드 신호를 발생하는 제어기; 를 포함한다.
Int. CL H04L 9/06 (2006.01) H04W 84/18 (2009.01) H04L 9/08 (2006.01)
CPC H04L 9/0631(2013.01) H04L 9/0631(2013.01) H04L 9/0631(2013.01)
출원번호/일자 1020150089387 (2015.06.24)
출원인 강원대학교산학협력단
등록번호/일자
공개번호/일자 10-2017-0000836 (2017.01.04) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2015.06.24)
심사청구항수 3

출원인

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번호 이름 국적 주소
1 강원대학교산학협력단 대한민국 강원도 춘천시

발명자

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번호 이름 국적 주소
1 이제훈 대한민국 강원도 삼척시
2 김승열 대한민국 충북 청주시 서원구

대리인

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번호 이름 국적 주소
1 조현석 대한민국 충청남도 예산군 대술면 송석백제울길 ***(지우국제특허법률사무소)

최종권리자

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번호 이름 국적 주소
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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2015.06.24 수리 (Accepted) 1-1-2015-0609835-89
2 의견제출통지서
Notification of reason for refusal
2016.06.27 발송처리완료 (Completion of Transmission) 9-5-2016-0460304-33
3 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)
2016.08.29 수리 (Accepted) 1-1-2016-0836638-94
4 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)
2016.09.26 수리 (Accepted) 1-1-2016-0927049-13
5 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2016.10.26 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2016-1040958-19
6 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2016.10.26 수리 (Accepted) 1-1-2016-1040971-14
7 거절결정서
Decision to Refuse a Patent
2017.01.23 발송처리완료 (Completion of Transmission) 9-5-2017-0059247-67
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.11.05 수리 (Accepted) 4-1-2019-5230938-29
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
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128비트 확장된 데이터 블록을 갖는 HIGHT 암호화/복호화 장치에 있어서,128비트 마스터 키를 입력하여 암호화 및 복호화를 위한 화이트닝 키 및 서브키를 발생하는 키 스케줄러;모드 신호 그리고 상기 키 스케줄러에서 제공되는 화이트닝 키 및 서브키에 따라 128비트 입력의 상위 64비트에 대한 HIGHT 암호화/복호화 처리를 수행하는 제1라운드 블록;모드 신호 그리고 상기 키 스케줄러에서 제공되는 화이트닝 키 및 서브키에 따라 128비트 입력의 하위 64비트에 대한 HIGHT 암호화/복호화 처리를 수행하는 제2라운드 블록; 및상기 키 스케줄러, 제1라운드 함수 블록, 제2라운드 함수 블록의 동작을 제어하는 모드 신호를 발생하는 제어기;를 포함하며 여기서, 상기 제1라운드 블록 및 상기 제2라운드 블록은 상기 키 스케줄러를 공유하며 상기 제1라운드 함수 블록의 처리 결과 및 상기 제2라운드 블록의 처리 결과를 합성하여 128비트 확장된 데이터 블록을 갖는 HIGHT 암호화/복호화 장치
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제1항에 있어서, 상기 키 스케줄러는라운드 함수 작동시 초기값과 라운드값의 입력을 선택하게 하는 마스터키 선택 신호에 따라 마스터 키 혹은 재귀값을 멀티플렉싱하는 제1멀티플렉서; 상기 제1멀티플렉서의 출력을 래치하는 레지스터; 키 선택 신호(sel_key)에 따라 128비트의 마스터키로부터 분할된 4개의 32비트 중의 하나를 선택하여 출력하는 제2멀티플렉서;함수값(δi)를 발생하는 함수(δi) 생성; 상기 함수(δi) 생성기에서 발생된 함수값(δi)와 마스터 키 값을 모듈러 28덧셈하여 서브키를 생성하는 모듈러 28 덧셈기; 마스터 키를 바이트 단위로 회전하는 바이트단위 회전 블록(bytewise rotation block); 마스터 키를 바이트 단위로 역회전하는 역바이트단위 회전 블록(Inverse bytewise rotation block); 상기 바이트단위 회전 블록 및 상기 역바이트단위 회전 블록의 출력을 상기 레지스터에 재귀값으로서 제공하는 제3멀티플렉서를 포함하는 것을 특징으로 하는 128비트 확장된 데이터 블록을 갖는 HIGHT 암호화/복호화 장치
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제2항에 있어서, 상기 바이트단위 회전블록 및 상기 역바이트단위 회전블록은 입력과 출력 사이를 잇는 와이어로 구성된 것을 특징으로 하는 128비트 확장된 데이터 블록을 갖는 HIGHT 암호화/복호화 장치
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.