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SiC 반도체의 깊은 준위 결함 제거 방법

  • 기술번호 : KST2020004212
  • 담당센터 : 부산기술혁신센터
  • 전화번호 : 051-606-6561
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 낮은 깊은 준위 결함 밀도의 에피택셜층을 갖는 반도체 소자의 제조 방법에 관한 것이다. 본 발명은 제1 도전형의 SiC 단결정 기판을 제공하는 단계; 상기 기판 상에 제1 도펀트 농도를 갖는 제1 도전형의 에피택셜층을 형성하는 단계; 및 상기 에피택셜층 내의 최소한 일부에 제1 도펀트 농도보다 높은 제2 도펀트 농도의 제2 도펀트를 제1 깊이로 이온주입하는 단계;를 포함하는 SiC 반도체 소자의 제조 방법을 제공한다. 본 발명에 따르면, 깊은 준위 결함 밀도를 감소시켜 고전류 밀도와 높은 신뢰성을 갖는 SiC 반도체 소자를 제공할 수 있게 된다.
Int. CL H01L 29/47 (2006.01.01) H01L 21/265 (2006.01.01) H01L 21/02 (2006.01.01) H01L 29/16 (2006.01.01) H01L 29/772 (2006.01.01) H01L 29/872 (2006.01.01) H01L 29/868 (2006.01.01) H01L 29/739 (2006.01.01) H01L 29/74 (2006.01.01) H01L 29/78 (2006.01.01) H01L 29/73 (2006.01.01)
CPC H01L 29/47(2013.01) H01L 29/47(2013.01) H01L 29/47(2013.01) H01L 29/47(2013.01) H01L 29/47(2013.01) H01L 29/47(2013.01) H01L 29/47(2013.01) H01L 29/47(2013.01) H01L 29/47(2013.01) H01L 29/47(2013.01) H01L 29/47(2013.01) H01L 29/47(2013.01) H01L 29/47(2013.01)
출원번호/일자 1020180119346 (2018.10.05)
출원인 한국전기연구원
등록번호/일자
공개번호/일자 10-2020-0039905 (2020.04.17) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 6

출원인

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번호 이름 국적 주소
1 한국전기연구원 대한민국 경상남도 창원시 성산구

발명자

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번호 이름 국적 주소
1 문정현 경상남도 김해시 율하*로 **, *
2 방욱 경상남도 창원시 성산구
3 강인호 경상남도 진주시 강남로 **,
4 석오균 부산광역시 강서구
5 김형우 경상남도 창원시 성산구

대리인

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번호 이름 국적 주소
1 특허법인충정 대한민국 서울특별시 강남구 역삼로***,*층(역삼동,성보역삼빌딩)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2018.10.05 수리 (Accepted) 1-1-2018-0986760-54
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번호 청구항
1 1
제1 도전형의 SiC 단결정 기판을 제공하는 단계;상기 기판 상에 제1 도펀트 농도를 갖는 제1 도전형의 에피택셜층을 형성하는 단계; 및상기 에피택셜층 내의 최소한 일부에 제1 도펀트 농도보다 높은 제2 도펀트 농도의 제2 도펀트를 제1 깊이로 이온주입하는 단계;를 포함하는 SiC 반도체 소자의 제조 방법
2 2
제1항에 있어서,상기 제1 도펀트는 질소이고, 제1 도펀트 농도는 105~1015/cm3인 것을 특징으로 하는 SiC 반도체 소자의 제조 방법
3 3
제1항에 있어서,상기 제2 도펀트는 질소이고 제2 도펀트 농도는 1013~1018/cm3인 것을 특징으로 하는 SiC 반도체 소자의 제조 방법
4 4
제1항에 있어서,상기 반도체 소자는 쇼트키 배리어 다이오드이고, 상기 이온주입 단계 이후에,상기 에피택셜층 상에 쇼트키 컨택트를 형성하는 단계; 및상기 반도체 기판의 배면에 오믹 컨택트를 형성하는 단계를 포함하는 것을 특징으로 하는 SiC 반도체 소자의 제조 방법
5 5
제1항에 있어서,상기 반도체 소자는 핀 다이오드, MOSFET, JFET, BJT, Thyristor 또는 IGBT인 것을 특징으로 하는 SiC 반도체 소자의 제조 방법
6 6
제1항에 있어서,상기 제1 깊이는 상기 에피택셜층의 두께보다 작은 것을 특징으로 하는 SiC 반도체 소자의 제조 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 과학기술정보통신부 한국전기연구원 HVDC 기술 개발 사업 고전압, 고전류밀도 SiC기반 차세대 전력소자 개발