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비터비 복호기에서 2 비트 레벨 파이프라인구조를 사용한고속 가산-비교-선택 연산 장치

  • 기술번호 : KST2014009354
  • 담당센터 : 인천기술혁신센터
  • 전화번호 : 032-420-3580
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명에 따른 비터비 복호기에서 2 비트 레벨 파이프라인구조를 사용한 고속 가산-비교-선택 연산 장치는 길쌈 부호를 기초로 오류값을 구하기 위하여 최상위 비트에서 최하위 비트까지 2 비트씩 연산하는 파이프라인 구조로 연결된 하나 이상의 기본 블록을 포함하되, 상기 기본 블록은 가지값 BM[n+1] 및 상태값 S[n+1]을 기초로 결정되는 가산, 감산, 비교 연산을 수행하는 ACS 연산 장치를 기초로, 2비트 별로 가산 연산을 하는 전가산기; 시간 tn+1의 가지값과 상태값을 이용하여 2비트를 하나의 그룹으로 파이프라인 처리되어 최대값을 결정하는 연산을 수행하는 최대값 선택 모듈(MS); 및 하위 비트에서 가산 연산을 통해 발생할 수 있는 캐리들의 영향으로 인한 결정 비트의 결과 값의 연산 상의 오류를 방지하는 최대 위치 모듈(MP)를 각각 포함하여 구성되어 연산 속도를 향상 할 수 있으며, 2비트 단위로 ACS 연산 회로가 파이프라인 처리되어 있기 때문에 ACS 연산 회로의 연산 비트의 증가에 따른 임계 경로의 연산 지연 시간이 늘어나지 않는 효과가 있다. 비터비 복호기, 2 비트 레벨 파이프라인 ACS 연산 회로, ACS 연산 회로
Int. CL G06F 9/38 (2006.01) G06F 7/505 (2006.01)
CPC H03M 13/1555(2013.01) H03M 13/1555(2013.01) H03M 13/1555(2013.01)
출원번호/일자 1020080045045 (2008.05.15)
출원인 인하대학교 산학협력단
등록번호/일자 10-0945155-0000 (2010.02.24)
공개번호/일자 10-2009-0119167 (2009.11.19) 문서열기
공고번호/일자 (20100308) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2008.05.15)
심사청구항수 5

출원인

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번호 이름 국적 주소
1 인하대학교 산학협력단 대한민국 인천광역시 미추홀구

발명자

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번호 이름 국적 주소
1 이한호 대한민국 인천시 연수구
2 구용제 대한민국 경기도 김포시

대리인

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번호 이름 국적 주소
1 이원희 대한민국 서울특별시 강남구 테헤란로 ***, 성지하이츠빌딩*차 ***호 (역삼동)

최종권리자

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번호 이름 국적 주소
1 인하대학교 산학협력단 대한민국 인천광역시 남구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2008.05.15 수리 (Accepted) 1-1-2008-0345154-48
2 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2008.06.12 수리 (Accepted) 4-1-2008-5093865-89
3 선행기술조사의뢰서
Request for Prior Art Search		 2008.10.07 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search		 2008.11.11 수리 (Accepted) 9-1-2008-0070150-47
5 의견제출통지서
Notification of reason for refusal		 2009.08.31 발송처리완료 (Completion of Transmission) 9-5-2009-0364057-99
6 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2009.10.16 수리 (Accepted) 1-1-2009-0634719-70
7 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2009.10.16 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2009-0634718-24
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.11.17 수리 (Accepted) 4-1-2009-5220324-82
9 등록결정서
Decision to grant		 2010.02.23 발송처리완료 (Completion of Transmission) 9-5-2010-0075604-87
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.07.22 수리 (Accepted) 4-1-2015-5098802-16
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2016.09.05 수리 (Accepted) 4-1-2016-5127132-49
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2018.03.02 수리 (Accepted) 4-1-2018-5036549-31
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2018.12.27 수리 (Accepted) 4-1-2018-5266647-91
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
길쌈 부호를 기초로 오류값을 구하기 위하여 최상위 비트에서 최하위 비트까지 2 비트씩 연산하는 파이프라인 구조로 연결된 하나 이상의 기본 블록을 포함하되, 상기 기본 블록들은, 가지값 BM[n+1] 및 상태값 S[n+1]을 기초로 결정되는 가산, 감산, 비교 연산을 수행하는 ACS 연산 장치를 기초로, 2비트 별로 가산 연산을 하는 전가산기; 시간 tn+1의 가지값과 상태값을 이용하여 2비트를 하나의 그룹으로 파이프라인 처리되어 최대값을 결정하는 연산을 수행하는 최대값 선택 모듈(MS); 및 하위 비트에서 가산 연산을 통해 발생할 수 있는 캐리들의 영향으로 인한 결정 비트의 결과 값의 연산 상의 오류를 방지하는 최대 위치 모듈(MP)를 각각 포함하고, 상기 기본 블록들 중 첫 번째 기본 블록의 입력은 시간 tn+1에 받은 가지값 BM[n+1], 상태값 S[n+1]의 상위 2비트, 시간 tn-1에 연산되어 선택된 2비트 크기의 최대 상태값 Smax[n], 시간 tn에 최대 상태값의 위치를 선택 연산한 d[n] 이며, 상기 기본 블록에서 출력되는 최대 상태값 Smax[n+1]과 최대 상태값과 동일한 위치의 결정 비트 d[n+1]를 하위 비트로 전달하는 것을 특징으로 하는 비터비 복호기에서 2 비트 레벨 파이프라인구조를 사용한 고속 가산-비교-선택 연산 장치
2 2
청구항 1에 있어서, 상기 최대 위치 모듈(MP)은 시간 tn+1에 가지값 BMa[n+1], BMb[n+1], BMc[n+1], BMd[n+1]과 상태값 Sa[n+1], Sb[n+1], Sc[n+1], Sd[n+1]의 가산 결과에서 캐리가 발생했을 때, 시간 tn에 선택된 최대 상태값 또는 시간 tn에서 선택된 최대 상태값 보다 1이 작은 상태의 위치를 찾는 연산을 수행하는 부분 결정부(PD)를 포함하는 것을 특징으로 하는 비터비 복호기에서 2 비트 레벨 파이프라인구조를 사용한 고속 가산-비교-선택 연산 장치
3 3
청구항 2에 있어서, 상기 최대 위치 모듈(MP)은 시간 tn+1에 시간 tn의 최대 상태값 Smax[n]과 시간 tn에 입력된 4개의 가지값 BMa[n], BMb[n], BMc[n], BMd[n]과 시간 tn의 4개의 상태값 Sa[n], Sb[n], Sc[n], Sd[n]과 가산 연산된 결과 값의 캐리 C[n+1]과 비교하여 같은 값을 갖고 있는 위치를 찾는 최대 위치 검출부(MPD)를 더 포함하는 것을 특징으로 하는 비터비 복호기에서 2 비트 레벨 파이프라인구조를 사용한 고속 가산-비교-선택 연산 장치
4 4
청구항 3에 있어서, 상기 최대 위치 모듈(MP)은 시간 tn에 연산된 최대 상태값과 시간 tn에 가산 연산된 4 개의 상태값과 같은 위치를 갖는 신호와 최대 상태값 보다 1이 작은 값을 갖는 상태의 값을 갖는 신호 및 시간 tn+1에 가산 연산된 4개의 상태의 캐리를 이용하여 실제 최대 상태값을 갖는 위치를 찾는 최대 위치 선택부(MPS)를 더 포함하는 것을 특징으로 하는 비터비 복호기에서 2 비트 레벨 파이프라인구조를 사용한 고속 가산-비교-선택 연산 장치
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청구항 1에 있어서, 상기 최대값 선택 모듈(MS)은 시간 tn+1에 입력된 가지값 가산 연산된 4개의 상태 값과 시간 tn의 연산된 최대 상태값과 같은 값을 갖는 위치의 상태를 선택한 신호를 이용하여 시간 tn+1 에 4개의 상태값 중에서 최대값을 갖는 상태를 선택하는 것을 특징으로 하는 비터비 복호기에서 2 비트 레벨 파이프라인구조를 사용한 고속 가산-비교-선택 연산 장치
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.