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연속 시간 도메인에서 광대역의 입력 신호를 수신하고 로우 패스 필터링하는 상향 변환부; 및 이산 시간 도메인에서 국부발진신호에 따라 상기 상향 변환부의 출력 신호를 샘플링 및 홀딩하고 로우 패스 필터링하는 하향 변환부를 포함하고,상기 상향 변환부는 광대역의 입력 신호를 수신하고 증폭하는 광대역 저잡음 증폭부; 및 상기 입력 신호의 주파수에 따라 차단 주파수를 변경하면서, 상기 입력 신호를 로우 패스 필터링하는 하나 이상의 동조가능 로우 패스 필터를 포함하며, 상기 하나 이상의 동조가능 로우 패스 필터 각각은입력단과 출력단 사이에 직렬 연결된 제1 및 제2 저항;상기 출력단과 상기 제2 저항의 접점과 접지사이에 연결된 제1 캐패시터;상기 제1 저항과 상기 제2 저항의 접점과 접지사이에 연결된 제2 캐패시터 및 출력 저항; 및 상기 출력단과 상기 제2 캐패시터과 상기 출력 저항의 접점 사이에 연결된 버퍼를 포함하는 것을 특징으로 하는 광대역 수신기
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제1항에 있어서, 상기 버퍼는 이득이 1인 연산 증폭기로 구현되는 것을 특징으로 하는 광대역 수신기
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제1항에 있어서, 상기 하나 이상의 동조가능 로우 패스 필터 각각은상기 제1 내지 제 2 저항(R1~R2)과 상기 제1 및 제 2 캐패시터 중 하나 이상의 소자값을 변경하여, 차단 주파수를 변경하는 것을 특징으로 하는 광대역 수신기
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제1항에 있어서, 상기 하나 이상의 동조가능 로우 패스 필터 각각은상기 입력단에 연결되는 게이트와 구동 전압이 인가되는 소스를 가지는 제1 도전형의 제1 트랜지스터;상기 제1 도전형의 제1 트랜지스터의 드레인에 공통 연결된 게이트 및 드레인을 가지는 제2 도전형의 제1 트랜지스터; 및상기 출력단에 공통 연결된 게이트와 드레인과 상기 구동 전압에 연결된 소스를 가지는 제1 도전형의 제2 트랜지스터를 더 포함하는 것을 특징으로 하는 광대역 수신기
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제6항에 있어서, 상기 버퍼는 상기 제1 캐패시터에 연결된 게이트와 상기 제1 도전형의 제2 트랜지스터의 드레인에 연결된 드레인과 상기 제2 캐패시터에 연결된 소스를 가지는 제2 도전형의 제2 트랜지스터로 구현되는 것을 특징으로 하는 광대역 수신기
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제1항에 있어서, 상기 하향 변환부는 클록을 생성하는 클록 생성기; 상기 클록을 90°의 위상차로 천이시켜 I/Q 신호 복원에 필요한 상기 국부발진 신호를 발생하는 위상 천이기;이산 시간 도메인에서 상기 국부발진신호에 따라 상기 상향 변환부의 출력 신호를 샘플링 및 홀딩하여, 상기 상향 변환부의 출력 신호를 기저대역으로 하향 변환하고 이산 시간 도메인의 신호로 변환하는 두개의 샘플 및 홀드부; 및 이산 시간 도메인에서 상기 두개의 샘플 및 홀드부의 출력을 로우 패스 필터링하는 두개의 이산 시간 로우 패스 필터를 포함하는 것을 특징으로 하는 광대역 수신기
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제8항에 있어서, 상기 두개의 샘플 및 홀드부 각각은 제1 입력단과 연결되는 드레인과 국부발진 신호가 입력되는 게이트를 가지는 제1 트랜지스터;제2 입력단과 연결되는 드레인과 상기 국부발진 신호가 입력되는 게이트를 가지는 제2 트랜지스터;제1 트랜지스터의 소스에 연결되는 드레인과 국부발진 반전신호가 입력되는 게이트와 출력단에 연결되는 소스를 가지는 제3 트랜지스터;상기 제2 트랜지스터의 소스에 연결되는 드레인과 상기 국부발진 반전신호가 입력되는 게이트과 바이어스 전압에 연결되는 소스를 가지는 제4 트랜지스터;상기 출력단에 연결되는 드레인과 상기 국부발진 신호가 입력되는 게이트를 가지는 제5 트랜지스터;상기 제1 트랜지스터의 소스와 상기 제2 트랜지스터의 소스 사이에 연결되는 제1 캐패시터;상기 출력단과 상기 제5 트랜지스터의 소스 사이에 연결되는 제2 캐패시터; 및상기 제2 캐패시터와 접지 사이에 연결되는 제3 캐패시터를 포함하는 것을 특징으로 하는 광대역 수신기
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제9항에 있어서, 상기 두개의 샘플 및 홀드부 각각은 상기 제1 및 제2 입력단을 통해 상기 상향 변환부의 출력 신호를 차동 신호쌍 형태로 입력받는 것을 특징으로 하는 광대역 수신기
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제8항에 있어서, 상기 클록 생성기는 상기 클록의 주파수를 가변할 수 있는 것을 특징으로 광대역 수신기
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