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전력 증폭기의 전치 왜곡 장치와 방법

  • 기술번호 : KST2014032300
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 전치 왜곡 장치와 방법에 관한 것으로, 더욱 상세하게는 전력 증폭기에서 출력되는 출력 신호의 왜곡을 최소화할 수 있는 전치 왜곡 장치와 방법에 관한 것이다.본 발명은, 전력 증폭기의 전치 왜곡 장치에 있어서, 입력 신호의 크기를 계산하는 입력 신호 크기 계산부와, 상기 계산된 입력 신호의 크기를 양자화하고, 상기 양자화된 데이터를 미리 저장된 메모리 주소들 중 어느 하나의 메모리 주소에 매핑하여 상기 매핑된 메모리 주소를 출력하는 양자화 매퍼와, 상기 출력된 메모리 주소를 제공받아 상기 메모리 주소가 지시하는 복소 보정 계수와 바이어스 전압 값을 출력하는 룩업 테이블과, 상기 출력된 복소 보정 계수와 상기 입력 신호를 곱하여 전치 왜곡 신호를 생성하고, 상기 생성된 전치 왜곡 신호를 상기 전력 증폭기의 입력으로 제공하는 곱셈기를 구비하는 전치 왜곡부; 및 상기 전력 증폭기의 출력 신호와 상기 입력 신호를 비교하여 오차 신호를 생성하고, 상기 생성된 오차 신호의 크기가 최소가 되도록 상기 복소 보정 계수를 갱신하는 복소 보정 계수 갱신부를 포함하고, 상기 전치 왜곡부는, 상기 복소 보정 계수가 갱신되는 동안 상기 입력 신호의 크기에 해당하는 일정한 바이어스 전압 값을 상기 전력 증폭기의 바이어스로 제공한다.
Int. CL H03F 3/24 (2006.01) H03F 1/32 (2006.01)
CPC H03F 1/3247(2013.01) H03F 1/3247(2013.01) H03F 1/3247(2013.01) H03F 1/3247(2013.01) H03F 1/3247(2013.01)
출원번호/일자 1020100062781 (2010.06.30)
출원인 한국전자통신연구원
등록번호/일자 10-1348275-0000 (2013.12.30)
공개번호/일자 10-2011-0030287 (2011.03.23) 문서열기
공고번호/일자 (20140108) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보 대한민국  |   1020090088208   |   2009.09.17
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2010.06.30)
심사청구항수 6

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 정재호 대한민국 대전광역시 유성구
2 조권도 대한민국 대전광역시 서구
3 김영훈 대한민국 대전광역시 유성구
4 오정훈 대한민국 대전광역시 유성구
5 이광천 대한민국 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 신성특허법인(유한) 대한민국 서울특별시 송파구 중대로 ***, ID타워 ***호 (가락동)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2010.06.30 수리 (Accepted) 1-1-2010-0423514-48
2 선행기술조사의뢰서
Request for Prior Art Search
2013.08.20 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2013.08.29 수리 (Accepted) 9-1-2013-0073146-41
4 의견제출통지서
Notification of reason for refusal
2013.09.02 발송처리완료 (Completion of Transmission) 9-5-2013-0616012-62
5 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)
2013.11.04 수리 (Accepted) 1-1-2013-1001145-55
6 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2013.11.13 수리 (Accepted) 1-1-2013-1033434-39
7 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2013.11.13 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2013-1033433-94
8 등록결정서
Decision to grant
2013.12.24 발송처리완료 (Completion of Transmission) 9-5-2013-0895485-54
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
삭제
2 2
전력 증폭기의 전치 왜곡 장치에 있어서,입력 신호의 크기를 계산하는 입력 신호 크기 계산부와, 상기 계산된 입력 신호의 크기를 양자화하고, 상기 양자화된 데이터를 미리 저장된 메모리 주소들 중 어느 하나의 메모리 주소에 매핑하여 상기 매핑된 메모리 주소를 출력하는 양자화 매퍼와, 상기 출력된 메모리 주소를 제공받아 상기 메모리 주소가 지시하는 복소 보정 계수와 바이어스 전압 값을 출력하는 룩업 테이블과, 상기 출력된 복소 보정 계수와 상기 입력 신호를 곱하여 전치 왜곡 신호를 생성하고, 상기 생성된 전치 왜곡 신호를 상기 전력 증폭기의 입력으로 제공하는 곱셈기를 구비하는 전치 왜곡부; 및상기 전력 증폭기의 출력 신호와 상기 입력 신호를 비교하여 오차 신호를 생성하고, 상기 생성된 오차 신호의 크기가 최소가 되도록 상기 복소 보정 계수를 갱신하는 복소 보정 계수 갱신부를 포함하고,상기 전치 왜곡부는, 상기 복소 보정 계수가 갱신되는 동안 상기 입력 신호의 크기에 해당하는 일정한 바이어스 전압 값을 상기 전력 증폭기의 바이어스로 제공하는, 전치 왜곡 장치
3 3
전력 증폭기의 전치 왜곡 장치에 있어서,입력 신호의 크기를 계산하고, 상기 입력 신호의 크기에 해당하는 복소 보정 계수를 출력하여 상기 입력 신호의 전치 왜곡 신호를 생성하며, 상기 생성된 전치 왜곡 신호를 상기 전력 증폭기의 입력으로 제공하는 전치 왜곡부와,상기 입력 신호를 미리 결정된 시간만큼 지연시키는 지연필터와, 상기 지연된 입력 신호에서 상기 전력 증폭기의 출력 신호를 차감하여 오차 신호를 생성하는 비교기와, 상기 생성된 오차 신호를 제공받아 상기 오차 신호가 최소가 되도록 하는 적응 알고리즘을 이용하여 복소 보정 계수를 갱신하는 적응 알고리즘 수행기를 구비하는 복소 보정 계수 갱신부를 포함하고,상기 전치 왜곡부는, 상기 복소 보정 계수가 갱신되는 동안 상기 입력 신호의 크기에 해당하는 일정한 바이어스 전압 값을 상기 전력 증폭기의 바이어스로 제공하는, 전치 왜곡 장치
4 4
제 3 항에 있어서, 상기 적응 알고리즘은,최소 자승법의 알고리즘인, 전치 왜곡 장치
5 5
삭제
6 6
전력 증폭기의 전치 왜곡 방법에 있어서,입력 신호의 크기를 계산하는 과정과,상기 계산된 입력 신호의 크기를 양자화하는 과정과,상기 양자화된 데이터를 미리 저장된 메모리 주소들 중 어느 하나의 메모리 주소에 매핑하여 상기 매핑된 메모리 주소를 출력하는 과정과,상기 출력된 메모리 주소가 지시하는 복소 보정 계수와 상기 전력 증폭기의 바이어스 전압 값을 출력하는 과정과,상기 복소 보정 계수가 갱신되는 동안 상기 바이어스 전압 값을 상기 전력 증폭기의 바이어스로 제공하는 과정과,상기 복소 보정 계수와 상기 입력 신호를 곱하여 전치 왜곡 신호를 생성하는 과정과,상기 전력 증폭기의 출력 신호와 상기 입력 신호를 비교하여 오차 신호를 생성하는 과정과,상기 생성된 오차 신호의 크기가 최소가 되도록 상기 복소 보정 계수를 갱신하는 과정을 포함하는 전치 왜곡 방법
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전력 증폭기의 전치 왜곡 방법에 있어서,입력 신호의 크기를 계산하는 과정과,상기 입력 신호의 크기에 해당하는 복소 보정 계수와 상기 전력 증폭기의 바이어스 전압 값을 출력하는 과정과,상기 복소 보정 계수가 갱신되는 동안 상기 바이어스 전압 값을 상기 전력 증폭기의 바이어스로 제공하는 과정과,상기 복소 보정 계수와 상기 입력 신호를 곱하여 전치 왜곡 신호를 생성하는 과정과,상기 입력 신호를 미리 결정된 시간만큼 지연시키는 과정과,상기 지연된 입력 신호에서 상기 전력 증폭기의 출력 신호를 차감하여 오차 신호를 생성하는 과정과,상기 생성된 오차 신호의 크기가 최소가 되도록 상기 복소 보정 계수를 갱신하는 과정을 포함하는 전치 왜곡 방법
8 8
전력 증폭기의 전치 왜곡 방법에 있어서,입력 신호의 크기를 계산하는 과정과,상기 입력 신호의 크기에 해당하는 복소 보정 계수와 상기 전력 증폭기의 바이어스 전압 값을 출력하는 과정과,상기 복소 보정 계수가 갱신되는 동안 상기 바이어스 전압 값을 상기 전력 증폭기의 바이어스로 제공하는 과정과,상기 복소 보정 계수와 상기 입력 신호를 곱하여 전치 왜곡 신호를 생성하는 과정과,상기 전력 증폭기의 출력 신호와 상기 입력 신호를 비교하여 오차 신호를 생성하는 과정과,상기 생성된 오차 신호를 제공받아 상기 오차 신호가 최소가 되도록 하는 최소 자승법 알고리즘을 이용하여 상기 복소 보정 계수를 갱신하는 과정을 포함하는 전치 왜곡 방법
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1 US08018278 US 미국 FAMILY
2 US20110063026 US 미국 FAMILY

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1 US2011063026 US 미국 DOCDBFAMILY
2 US8018278 US 미국 DOCDBFAMILY
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