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이차원 ＩＮＬ ｂｏｕｎｄｅｄ 스위칭 기법을 사용하는 ＤＡＣ (Digital-to-Analog Converter using 2D INL bounded switching scheme)

  • 기술번호 : KST2014034389
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명의 기술분야는 Digital-to-Analog Converter(DAC)에 관한 것으로, 보다 상세하게는 INL bounded 스위칭 기법을 적용하는 DAC에 관한 것이며, 특히 INL bounded 스위칭 기법을 적용함에 있어 기존의 INL bounded 스위칭 기법을 변경하여 사용하는 DAC에 관한 것이다.본 명세서에서 개시하는 DAC는 전류 셀 매트릭스 구조 기반의 이차원 INL bounded 스위칭 기법을 사용하며, 상기 DAC에 입력되는 디지털 신호를 아날로그 출력 신호로 변환시키기 위한 상기 매트릭스를 구성하는 각 전류 셀의 스위칭(선택)을 행과 열 디코딩 방식을 통해 구현하되, 상기 디코딩 방식을 통한 상기 스위칭은 상기 셀 매트릭스를 위아래로 2등분 및 좌우로 2등분 총 4등분하여 상기 셀 매트릭스의 제1 사분면과 제3 사분면에 위치하는 셀들이 우선적으로 스위칭되고, 제2 사분면과 제4 사분면에 위치하는 셀들이 차후에 스위칭되도록 하여 본 발명의 과제를 해결한다.
Int. CL H03M 1/66 (2006.01)
CPC H03M 1/66(2013.01) H03M 1/66(2013.01) H03M 1/66(2013.01) H03M 1/66(2013.01) H03M 1/66(2013.01)
출원번호/일자 1020100079077 (2010.08.17)
출원인 서강대학교산학협력단
등록번호/일자 10-1226899-0000 (2013.01.22)
공개번호/일자 10-2012-0021772 (2012.03.09) 문서열기
공고번호/일자 (20130128) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2010.08.17)
심사청구항수 4

출원인

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번호 이름 국적 주소
1 서강대학교산학협력단 대한민국 서울특별시 마포구

발명자

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번호 이름 국적 주소
1 이승훈 대한민국 서울특별시 용산구

대리인

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번호 이름 국적 주소
1 특허법인충현 대한민국 서울특별시 서초구 동산로 **, *층(양재동, 베델회관)

최종권리자

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번호 이름 국적 주소
1 서강대학교산학협력단 서울특별시 마포구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2010.08.17 수리 (Accepted) 1-1-2010-0527146-55
2 선행기술조사의뢰서
Request for Prior Art Search		 2011.06.14 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search		 2011.07.19 수리 (Accepted) 9-1-2011-0062264-04
4 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment		 2011.10.14 수리 (Accepted) 1-1-2011-0804587-86
5 의견제출통지서
Notification of reason for refusal		 2012.01.31 발송처리완료 (Completion of Transmission) 9-5-2012-0061436-10
6 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)		 2012.03.29 수리 (Accepted) 1-1-2012-0253828-50
7 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)		 2012.04.30 수리 (Accepted) 1-1-2012-0346382-47
8 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)		 2012.05.29 수리 (Accepted) 1-1-2012-0427303-84
9 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)		 2012.06.28 수리 (Accepted) 1-1-2012-0517053-08
10 지정기간연장관련안내서
Notification for Extension of Designated Period		 2012.07.02 발송처리완료 (Completion of Transmission) 1-5-2012-0082642-92
11 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2012.07.31 수리 (Accepted) 1-1-2012-0613123-25
12 등록결정서
Decision to grant		 2012.12.26 발송처리완료 (Completion of Transmission) 9-5-2012-0788688-04
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2017.01.11 수리 (Accepted) 4-1-2017-5005781-67
14 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.01.22 수리 (Accepted) 4-1-2019-5014626-89
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
전류 셀 매트릭스(current cell matrix) 구조 기반의 이차원 INL bounded 스위칭 기법을 사용하는 Digital-to-Analog Converter(DAC)에 있어서:상기 DAC에 입력되는 디지털 신호를 아날로그 출력 신호로 변환시키기 위한 상기 매트릭스를 구성하는 각 전류 셀의 스위칭(선택)을 행과 열 디코딩(row-column decoding) 방식을 통해 구현하되,상기 디코딩 방식을 통한 상기 스위칭은 상기 셀 매트릭스를 위아래로 2등분 및 좌우로 2등분 총 4등분하여 상기 셀 매트릭스의 제1 사분면과 제3 사분면에 위치하는 셀들이 우선적으로 스위칭되고, 제2 사분면과 제4 사분면에 위치하는 셀들이 차후에 스위칭되도록 이루어지는 것을 특징으로 하는 이차원 INL bounded 스위칭 기법을 사용하는 DAC
2 2
제 1 항에 있어서, 상기 각 전류 셀의 스위칭은상기 매트릭스의 열에 대해 부여된 스위칭 순서에 기반하고, 동일한 행 스위칭 순서를 갖는 상기 제1 사분면의 셀들과 상기 제3 사분면의 셀들이 셀 단위로 교차적으로 스위칭된 후, 상기 제2 사분면과 상기 제4 사분면의 셀들은 상기 제1 사분면의 셀들과 상기 제3 사분면의 셀들이 스위칭되는 방식과 동일한 방식으로 스위칭되는 것을 특징으로 하는 이차원 INL bounded 스위칭 기법을 사용하는 DAC
3 3
제 2 항에 있어서,상기 열 디코딩과 행 디코딩은 상기 입력 디지털 신호의 비트수를 반씩 나누어서 이루어지는 것을 특징으로 하는 이차원 INL bounded 스위칭 기법을 사용하는 DAC
4 4
제 3 항에 있어서,상기 DAC에 적용되는 디글리칭(deglitching) 회로는 마스터-슬레이브 디글리칭 회로(master-slave deglitching circuit)이며,상기 마스터-슬레이브 디글리칭 회로는 두 개의 서로 교차된 인버터로 구현되는 마스터 래치와 NMOS와 PMOS로 구현된 슬레이브 래치로 이루어진 것을 특징으로 하는 이차원 INL bounded 스위칭 기법을 사용하는 DAC
지정국 정보가 없습니다
패밀리정보가 없습니다
순번, 연구부처, 주관기관, 연구사업, 연구과제의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 국가R&D 연구정보 정보 표입니다.
순번 연구부처 주관기관 연구사업 연구과제
1 교육과학기술부 서강대학교 산학협력단 한국연구재단 일반연구자지원사업 선택적 SHA 기반의 저전력 12비트 100MS/s 급 0.13um CMOS ADC 연구
2 지식경제부 서강대학교 산학협력단 지식경제부 대학 IT연구센터 육성지원사업 차세대 융복합 시스템용 아날로그 IP 핵심설계기술 개발