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질화물계 반도체 소자 및 그의 제조 방법

  • 기술번호 : KST2014036708
  • 담당센터 : 경기기술혁신센터
  • 전화번호 : 031-8006-1570
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 질화물계 반도체 소자 및 그의 제조 방법에 관한 것으로, 낮은 접촉 저항을 가지면서 표면 거칠기가 개선된 오믹 접합을 구현하기 위한 것이다. 본 발명에 따르면, 베이스 기판 위에 질화물계 에피층이 형성된다. 에피층 위에 일정 간격을 두고 Au계열의 한 쌍의 제1 오믹 금속이 형성된다. 한 쌍의 제1 오믹 금속 중 채널을 형성하는 쪽의 제1 오믹 금속 부분을 덮도록 Al계열의 한 쌍의 제2 오믹 금속을 형성한다. 이때 에피층 위에 Au계열의 제1 오믹 금속을 형성함으로써, Al계열 만으로 형성된 오믹 접합에 비해서 접촉 저항을 낮출 수 있다. 또한 Au계열의 제1 오믹 금속을 형성한 이후에, 채널을 형성하는 제1 오믹 금속 부분을 덮도록 Al계열의 제2 오믹 금속을 형성하여 오믹 접합을 구현함으로써, 오믹 접합의 표면 거칠기를 개선하여 소스 전극 및 드레인 전극 간의 거리를 일정하게 유지할 수 있다. 또한 오믹 접합의 표면 거칠기를 개선함으로써, 항복 전압 특성이 떨어지는 문제를 해소하고, 소스 전극 및 드레인 전극에 형성되는 다른 배선과의 접합 신뢰성을 향상시킬 수 있다.
Int. CL H01L 29/778 (2006.01)
CPC H01L 29/7783(2013.01) H01L 29/7783(2013.01) H01L 29/7783(2013.01)
출원번호/일자 1020100135766 (2010.12.27)
출원인 전자부품연구원
등록번호/일자 10-1154870-0000 (2012.06.04)
공개번호/일자
공고번호/일자 (20120618) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2010.12.27)
심사청구항수 15

출원인

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번호 이름 국적 주소
1 한국전자기술연구원 대한민국 경기도 성남시 분당구

발명자

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번호 이름 국적 주소
1 최홍구 대한민국 경기도 하남시 덕풍북로 ***
2 한철구 대한민국 경기도 성남시 분당구

대리인

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번호 이름 국적 주소
1 박종한 대한민국 서울특별시 구로구 디지털로**길 * (구로동, 에이스하이엔드타워*차) ***호(한림특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 한국전자기술연구원 경기도 성남시 분당구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2010.12.27 수리 (Accepted) 1-1-2010-0863426-26
2 선행기술조사의뢰서
Request for Prior Art Search
2012.03.13 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2012.04.19 수리 (Accepted) 9-1-2012-0031449-62
4 등록결정서
Decision to grant
2012.05.23 발송처리완료 (Completion of Transmission) 9-5-2012-0301651-83
5 출원인정보변경(경정)신고서
Notification of change of applicant's information
2013.04.17 수리 (Accepted) 4-1-2013-0013766-37
6 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.08.24 수리 (Accepted) 4-1-2020-5189497-57
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번호 청구항
1 1
베이스 기판;상기 베이스 기판 위에 형성된 질화물계 에피층;상기 에피층 위에 형성된 소스 전극;상기 에피층 위에 형성되며 상기 소스 전극과 일정 간격을 두고 형성된 드레인 전극;을 포함하며,상기 소스 전극 및 드레인 전극은 각각,상기 에피층 위에 형성된 Au계열의 제1 오믹 접합;채널을 형성하는 쪽의 상기 제1 오믹 접합 부분을 덮도록 형성된 Al계열의 제2 오믹 접합;을 포함하는 것을 특징으로 하는 질화물계 반도체 소자
2 2
제1항에 있어서, 상기 제2 오믹 접합은,적어도 상기 채널을 형성하는 쪽에 위치하는 상기 제1 오믹 접합의 측면 부분을 덮도록 형성되는 것을 특징으로 하는 질화물계 반도체 소자
3 3
제1항에 있어서, 상기 제2 오믹 접합은,상기 채널을 형성하는 쪽에 위치하는 상기 제1 오믹 접합의 측면과, 상기 측면에 이웃하는 상기 제1 오믹 접합의 상부면의 적어도 일부를 덮도록 형성되는 것을 특징으로 하는 질화물계 반도체 소자
4 4
제2항 또는 제3항에 있어서,상기 제1 오믹 접합은 Ti/Al/M/Au 순으로 적층되고(여기서 M은 Ni, Ti, Pt, Mo 및 Ta 중에 하나),상기 제2 오믹 접합은 Ti/Al 순으로 적층된 것을 특징으로 질화물계 반도체 소자
5 5
제4항에 있어서,상기 제2 오믹 접합은 Al 위에 적층된 Ni, Ti, Pt, Mo 및 Ta 중에 하나를 더 포함하는 것을 특징으로 하는 질화물계 반도체 소자
6 6
제1항에 있어서, 상기 소스 전극 및 드레인 전극은,제1 오믹 금속과 제2 오믹 금속을 증착한 이후에 열처리하여 상기 제1 및 제2 오믹 접합을 형성하거나, 제1 오믹 금속을 증착한 이후에 열처리하여 상기 제1 오믹 접합을 형성하고 제2 오믹 금속을 증착한 후 열처리하여 상기 제2 오믹 접합을 형성한 것을 특징으로 하는 질화물계 반도체 소자
7 7
제1항에 있어서,상기 소스 전극과 상기 드레인 전극 사이의 상기 에피층 위에 형성된 게이트 전극;을 더 포함하는 것을 특징으로 하는 질화물계 반도체 소자
8 8
제1항에 있어서, 상기 질화물계 에피층은,상기 베이스 기판 위에 형성된 GaN층;상기 GaN층 위에 형성되어 상기 GaN층과 계면 부분에 2-차원 전자 가스(2DEG)층을 형성하는 AlGaN층;을 포함하는 것을 특징으로 하는 질화물계 반도체 소자
9 9
베이스 기판을 준비하는 준비 단계;상기 베이스 기판 위에 질화물계 에피층을 형성하는 에피층 형성 단계;상기 에피층 위에 일정 간격을 두고 Au계열의 한 쌍의 제1 오믹 금속을 형성하는 제1 오믹 금속 형성 단계;상기 한 쌍의 제1 오믹 금속 중 채널을 형성하는 쪽의 제1 오믹 금속 부분을 덮도록 Al계열의 한 쌍의 제2 오믹 금속을 형성하는 제2 오믹 금속 형성 단계;를 포함하는 것을 특징으로 하는 질화물계 반도체 소자의 제조 방법
10 10
베이스 기판을 준비하는 준비 단계;상기 베이스 기판 위에 질화물계 에피층을 형성하는 에피층 형성 단계;상기 에피층 위에 일정 간격을 두고 Au계열의 한 쌍의 제1 오믹 접합을 형성하는 제1 오믹 접합 형성 단계;상기 한 쌍의 제1 오믹 접합 중 채널을 형성하는 쪽의 제1 오믹 접합 부분을 덮도록 Al계열의 한 쌍의 제2 오믹 접합을 형성하여 소스 전극 및 드레인 전극을 형성하는 제2 오믹 접합 형성 단계;를 포함하는 것을 특징으로 하는 질화물계 반도체 소자의 제조 방법
11 11
제10항에 있어서, 상기 제1 오믹 접합 형성 단계는,상기 에피층 위에 일정 간격을 두고 Au계열의 한 쌍의 제1 오믹 금속을 형성하는 제1 오믹 금속 형성 단계와, 상기 한 쌍의 제1 오믹 금속을 열처리하는 단계를 포함하고,상기 제2 오믹 접합 형성 단계는,상기 한 쌍의 제1 오믹 금속 중 채널을 형성하는 쪽의 제1 오믹 금속 부분을 덮도록 Al계열의 한 쌍의 제2 오믹 금속을 형성하는 제2 오믹 금속 형성 단계와, 상기 한 쌍의 제2 오믹 금속을 열처리하는 단계를 포함하는 것을 특징으로 하는 질화물계 반도체 소자의 제조 방법
12 12
제9항 또는 11항에 있어서, 상기 제2 오믹 금속 형성 단계에서,상기 한 쌍의 제1 오믹 금속 중 채널을 형성하는 쪽은 상기 한 쌍의 제1 오믹 금속이 서로 마주보는 쪽인 것을 특징으로 하는 질화물계 반도체 소자의 제조 방법
13 13
제9항 또는 제11항에 있어서, 상기 제2 오믹 금속 형성 단계에서,상기 채널을 형성하는 쪽에 위치하는 상기 제1 오믹 금속의 측면과, 상기 측면에 이웃하는 상기 제1 오믹 금속의 상부면의 적어도 일부를 덮도록 상기 제2 오믹 금속을 형성하는 것을 특징으로 하는 질화물계 반도체 소자의 제조 방법
14 14
제9항에 있어서,상기 제2 오믹 금속 형성 단계 이후에 수행되는,상기 제1 및 제2 오믹 금속을 열처리하여 소스 전극 및 드레인 전극을 형성하는 단계;를 더 포함하는 것을 특징으로 하는 질화물계 반도체 소자의 제조 방법
15 15
제9항 또는 10항에 있어서, 상기 에피층 형성 단계는,상기 베이스 기판 위에 GaN층을 형성하는 단계; 상기 GaN층과 계면 부분에 2-차원 전자 가스(2DEG)층을 형성하는 AlGaN층을 상기 GaN층 위에 형성하는 단계;를 포함하는 것을 특징으로 하는 질화물계 반도체 소자의 제조 방법
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순번 연구부처 주관기관 연구사업 연구과제
1 지식경제부 한국전자통신연구원 산업원천기술개발사업 차세대 이동통신 기지국용 Class-S 전력증폭기 기술연구