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복수의 이종 코어를 포함하는 멀티코어 프로세서 시스템 및 그 제어 방법

  • 기술번호 : KST2014040382
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 복수의 이종(heterogeneous) 코어를 포함하는 멀티코어 프로세서 시스템 및 그 제어 방법이 개시된다. 개시된 멀티코어 프로세서 시스템은 상기 멀티코어 프로세서 시스템에서 정의되는 상위 명령어인 메타 명령어를 실행할 코어를 상기 복수의 이종 코어 중에서 선택하는 선택부; 상기 메타 명령어를 상기 선택된 코어에서 실행 가능한 하위 명령어로 변환하여 상기 선택된 코어로 전달하는 변환부를 포함한다. 본 발명에 따르면, 복수의 이종 코어를 이용하여 2 이상의 명령어를 동시에 처리할 수 있게 된다.
Int. CL G06F 9/28 (2017.01.01) G06F 9/30 (2018.01.01) G06F 9/38 (2006.01.01)
CPC G06F 9/28(2013.01) G06F 9/28(2013.01) G06F 9/28(2013.01)
출원번호/일자 1020100052259 (2010.06.03)
출원인 한양대학교 산학협력단
등록번호/일자 10-1191530-0000 (2012.10.09)
공개번호/일자 10-2011-0132749 (2011.12.09) 문서열기
공고번호/일자 (20121015) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2010.06.03)
심사청구항수 11

출원인

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번호 이름 국적 주소
1 한양대학교 산학협력단 대한민국 서울특별시 성동구

발명자

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번호 이름 국적 주소
1 정기석 대한민국 서울특별시 용산구
2 조걸 대한민국 부산광역시 북구
3 황영시 대한민국 경기도 의정부시 회

대리인

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번호 이름 국적 주소
1 최관락 대한민국 서울특별시 강남구 강남대로**길 ** (역삼동) 동림빌딩 *층(아이피즈국제특허법률사무소)
2 민영준 대한민국 서울특별시 강남구 남부순환로 ****, *층(도곡동, 차우빌딩)(맥스국제특허법률사무소)
3 송인호 대한민국 서울특별시 강남구 강남대로**길 ** (역삼동) 동림빌딩 *층(아이피즈국제특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 한양대학교 산학협력단 서울특별시 성동구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2010.06.03 수리 (Accepted) 1-1-2010-0356249-93
2 선행기술조사의뢰서
Request for Prior Art Search
2011.04.11 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2011.05.20 수리 (Accepted) 9-1-2011-0045760-95
4 의견제출통지서
Notification of reason for refusal
2011.12.23 발송처리완료 (Completion of Transmission) 9-5-2011-0765046-95
5 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2012.02.23 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2012-0148534-02
6 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2012.02.23 수리 (Accepted) 1-1-2012-0148543-13
7 등록결정서
Decision to grant
2012.08.30 발송처리완료 (Completion of Transmission) 9-5-2012-0513646-15
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.06.05 수리 (Accepted) 4-1-2014-5068294-39
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.16 수리 (Accepted) 4-1-2015-5022074-70
10 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.08.05 수리 (Accepted) 4-1-2019-5155816-75
11 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.08.06 수리 (Accepted) 4-1-2019-5156285-09
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
복수의 이종(heterogeneous) 코어를 포함하는 멀티코어 프로세서 시스템에 있어서, 상기 멀티코어 프로세서 시스템에서 정의되는 상위 명령어인 메타 명령어를 실행할 코어를 상기 복수의 이종 코어 중에서 선택하는 선택부;상기 메타 명령어를 상기 선택된 코어에서 실행 가능한 하위 명령어로 변환하여 상기 선택된 코어로 전달하는 변환부를 포함하되, 상기 선택부는 상기 복수의 이종 코어 각각의 상태 정보, 상기 복수의 이종 코어 각각의 메타 명령어 실행 성능 평가 정보, 및 상기 복수의 이종 코어 각각에 포함되는 캐시의 상태 정보 중에서 적어도 하나에 기초하여 상기 메타 명령어를 실행할 코어를 선택하는 것을 특징으로 하는 멀티코어 프로세서 시스템
2 2
제1항에 있어서, 메모리로부터 상기 메타 명령어를 수신하여 저장하는 임시 저장부를 더 포함하되, 상기 선택부는 상기 임시 저장부로부터 하나 이상의 메타 명령어를 독출하고, 상기 독출된 하나 이상의 메타 명령어를 실행할 코어를 선택하는 것을 특징으로 하는 멀티코어 프로세서 시스템
3 3
제2항에 있어서, 상기 임시 저장부는 큐(Queue)를 포함하는 것을 특징으로 하는 멀티코어 프로세서 시스템
4 4
삭제
5 5
제1항에 있어서,상기 복수의 이종 코어 각각의 상태 정보는 상기 코어가 아이들 상태에 있음을 나타내는 아이들 상태 정보 및 상기 코어가 비지 상태에 있음을 나타내는 비지 상태 정보 중에서 어느 하나를 포함하는 것을 특징으로 하는 멀티코어 프로세서 시스템
6 6
제1항에 있어서,상기 복수의 이종 코어 각각의 메타 명령어 실행 성능 평가 정보는 상기 복수의 이종 코어 각각에 의해 미리 실행된 메타 명령어의 실행 성능을 평가하여 생성되거나 또는 상기 복수의 이종 코어 각각에 의해 실행되는 메타 명령어에 대해 실시간으로 실행 성능을 평가하여 생성되는 것을 특징으로 하는 멀티코어 프로세서 시스템
7 7
제1항에 있어서,상기 변환부는 상기 복수의 이종 코어와 각각 연결되고, 상기 메타 명령어를 자신과 연결된 코어에서 실행 가능한 하위 명령어로 변환하여 전달하는 복수의 변환 모듈을 포함하는 것을 특징으로 하는 멀티코어 프로세서 시스템
8 8
제7항에 있어서,상기 선택부는 상기 복수의 변환 모듈 중에서 상기 메타 명령어를 실행할 코어와 연결된 변환 모듈을 선택하는 선택 모듈; 및 상기 선택된 변환 모듈로 상기 메타 명령어를 전달하는 전달 모듈을 포함하는 것을 특징으로 하는 멀티코어 프로세서 시스템
9 9
제1항에 있어서,상기 변환부는 하나의 메타 명령어를 적어도 하나의 하위 명령어로 변환하거나 또는 적어도 하나의 메타 명령어를 하나의 하위 명령어로 변환하는 것을 특징으로 하는 멀티코어 프로세서 시스템
10 10
복수의 이종 코어를 포함하는 멀티코어 프로세서 시스템의 제어 방법에 있어서, 상기 멀티코어 프로세서 시스템에서 정의되는 상위 명령어인 메타 명령어를 실행할 코어를 상기 복수의 이종 코어 중에서 선택하는 단계; 및 상기 메타 명령어를 상기 선택된 코어에서 실행 가능한 하위 명령어로 변환하여 상기 선택된 코어로 전달하는 단계를 포함하되, 상기 선택하는 단계는 상기 복수의 이종 코어 각각의 상태 정보, 상기 복수의 이종 코어 각각의 메타 명령어 실행 성능 평가 정보, 및 상기 복수의 이종 코어 각각에 포함되는 캐시의 상태 정보 중에서 적어도 하나에 기초하여 상기 메타 명령어를 실행할 코어를 선택하는 것을 특징으로 하는 멀티코어 프로세서 시스템의 제어 방법
11 11
제10항에 있어서, 메모리로부터 상기 메타 명령어를 수신하여 큐에 저장하는 단계를 더 포함하되, 상기 선택하는 단계는 상기 큐로부터 하나 이상의 메타 명령어를 독출하고, 상기 독출된 하나 이상의 메타 명령어 각각을 실행할 코어를 선택하는 것을 특징으로 하는 멀티코어 프로세서 시스템의 제어 방법
12 12
삭제
13 13
제10항에 있어서,상기 선택하는 단계는 상기 복수의 이종 코어와 각각 연결되고, 상기 메타 명령어를 자신과 연결된 코어에서 실행 가능한 하위 명령어로 변환하여 전달하는 복수의 변환 모듈 중에서 상기 메타 명령어를 실행할 코어와 연결된 변환 모듈을 선택하는 단계; 및 선택된 변환 모듈로 상기 메타 명령어를 전달하는 단계를 포함하고, 상기 변환하는 단계는 상기 선택된 변환 모듈을 통해 상기 메타 명령어를 상기 선택된 변환 모듈과 연결된 코어의 하위 명령어로 변환하는 것을 특징으로 하는 멀티코어 프로세서 시스템의 제어 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.