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저전압 용 디지털 차동 신호 송신기 회로

  • 기술번호 : KST2014042689
  • 담당센터 : 대구기술혁신센터
  • 전화번호 : 053-550-1450
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 저전압 동작을 위한 디지털 차동 신호 송신기에 관한 것으로서, 보다 상세하게는 두 신호 경로를 통하여 전송되는 디지털 신호가 차동 신호의 위상 관계를 갖도록 보정하는 위상 보정회로와, 공정과 공급전압 및 온도 등의 변화에 불구하고 신호 보존성을 지닐 수 있도록 보정하는 듀티 사이클 보정회로를 두 신호 경로 상에 구비하여 디지털 차동 신호의 왜곡을 보정하고, 송신기 끝단에서의 전력 소모를 줄이며, 송신기와 전송 선로의 임피던스를 매칭함으로써, 동작환경에 둔감하게 동작할 수 있게 한 저전압용 디지털 차동 신호 송신기 회로에 관한 것이다. 차동 신호, 송신기, 위상 보정, 듀티 사이클
Int. CL H04L 25/02 (2006.01) H04B 1/04 (2006.01)
CPC
출원번호/일자 1020090039419 (2009.05.06)
출원인 포항공과대학교 산학협력단
등록번호/일자 10-1043997-0000 (2011.06.17)
공개번호/일자 10-2010-0120551 (2010.11.16) 문서열기
공고번호/일자 (20110624) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2009.05.06)
심사청구항수 14

출원인

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번호 이름 국적 주소
1 포항공과대학교 산학협력단 대한민국 경상북도 포항시 남구

발명자

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번호 이름 국적 주소
1 배준현 대한민국 경상북도 포항시 남구
2 박홍준 대한민국 경북 포항시 남구

대리인

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번호 이름 국적 주소
1 이철희 대한민국 서울특별시 강남구 삼성로***길 *, ***호 가디언국제특허법률사무소 (삼성동, 우경빌딩)

최종권리자

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번호 이름 국적 주소
1 포항공과대학교 산학협력단 대한민국 경상북도 포항시 남구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2009.05.06 수리 (Accepted) 1-1-2009-0272340-89
2 의견제출통지서
Notification of reason for refusal		 2011.01.03 발송처리완료 (Completion of Transmission) 9-5-2011-0000027-41
3 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2011.02.22 수리 (Accepted) 1-1-2011-0125456-10
4 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2011.02.22 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2011-0125458-12
5 등록결정서
Decision to grant		 2011.05.29 발송처리완료 (Completion of Transmission) 9-5-2011-0288235-17
6 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2013.06.13 수리 (Accepted) 4-1-2013-0025573-58
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.02.25 수리 (Accepted) 4-1-2014-5024386-11
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.11.20 수리 (Accepted) 4-1-2019-5243581-27
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.11.22 수리 (Accepted) 4-1-2019-5245997-53
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.11.25 수리 (Accepted) 4-1-2019-5247115-68
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
두 신호 경로에 각각 구비되어 입력 차동 신호와 클락 신호 중 하나를 선택하여 각 신호 경로로 출력하는 멀티플렉서로 이루어진 신호 선택 스위치(MUX); 상기 두 신호 경로 사이에 설치되어, 두 신호 경로에서 출력되는 신호를 입력받아 출력 시간을 지연시키며 두 신호 간의 위상 차이를 보정하는 차동 위상 보정회로(PHASE ALIGN); 위상 보정 후 각 신호 경로에서 전송된 신호의 에지를 검출하여 펄스를 생성하고, 상기 펄스에 의해 출력신호를 증감시키는 스위치를 제어하여 각 신호 경로에서 출력되는 신호의 듀티 사이클을 일정하게 보정하는 듀티 사이클 보정회로(PRE_DCC); 및 상기 입력 차동 신호를 수신기로 전송하는 전송 선로와 동일한 임피던스를 갖는 기준 저항을 이용하여 출력 구동부의 임피던스를 매칭한 후, 상기 듀티 사이클이 보정된 입력 차동 신호를 전송 선로로 출력하는 최종 출력단을 포함하되, 상기 차동 위상 보정회로는, 상기 신호 선택 스위치를 통하여 두 신호 경로에서 각각 전송되는 신호를 입력받아 두 신호가 180°의 위상 차이를 갖도록 출력을 지연시키는 가변 지연 회로와, 상기 듀티 사이클 보정회로에서 출력되는 신호를 피드백 받아 상기 가변 지연 회로의 제어코드를 생성하는 위상 제어기를 포함하여 구성되는 것을 특징으로 하는 저전압용 디지털 차동 신호 송신기 회로
2 2
제1항에 있어서, 상기 신호 선택 스위치는 보정 기능 활성화신호(CAL_ON)에 의해 위상 차이 보정과 듀티 사이클 보정이 이루어지는 기간 동안, 클락 신호를 출력하도록 구성되는 것을 특징으로 하는 저전압용 디지털 차동 신호 송신기 회로
3 3
삭제
4 4
삭제
5 5
제1항에 있어서, 상기 가변 지연 회로는 각 신호 경로마다 구비되며, 상기 가변 지연 회로 중 하나는 상기 위상 제어기에서 출력되는 제어코드(CTRL)에 의해 출력신호의 지연시간을 증가시키고, 상기 가변 지연 회로 중 다른 하나는 상기 제어코드와 상보성을 지닌 제어코드(CTRLB)에 의해 출력신호의 지연시간을 감소시키도록 구성되는 것을 특징으로 하는 저전압용 디지털 차동 신호 송신기 회로
6 6
제1항에 있어서, 상기 듀티 사이클 보정회로는, 상기 차동 위상 보정회로에서 입력되는 신호의 상승 에지를 검출하여 펄스를 생성하는 에지 검출기; 상기 에지 검출기에서 생성된 펄스에 의하여 상기 최종 출력단으로 전송하고자 하는 출력신호를 증가시키는 피모스(PMOS) 스위치와, 상기 펄스에 의하여 상기 최종 출력단으로 전송하고자 하는 출력신호를 감소시키는 엔모스(NMOS) 스위치로 이루어진 모스 스위치; 상기 피모스 스위치와 엔모스 스위치에 공통 연결된 출력단자에 연결되어 있는 크로스 커플드 인버터; 및 송신기에서의 최종 출력의 듀티 사이클이 50%가 되도록 상기 에지 검출기에서 지연되는 지연시간을 제어하는 비교기와 카운터가 구비된 제어회로를 포함하여 구성되는 것을 특징으로 하는 저전압용 디지털 차동 신호 송신기 회로
7 7
제6항에 있어서, 상기 에지 검출기는, 상기 차동 위상 보정회로에서 입력되는 신호를 수신하는 버퍼와, 하나의 입력 단자에는 상기 버퍼의 출력이 직접 입력되고 다른 하나의 입력단자에는 상기 버퍼의 출력이 인버터를 경유하여 입력되는 낸드 게이트로 이루어진 제1에지검출기; 및 상기 버퍼의 입력단자에 공통 연결되어 상기 차동 위상 보정회로에서 입력되는 신호를 수신하는 지연회로와, 하나의 입력 단자에는 상기 지연회로의 출력이 직접 입력되고 다른 하나의 입력단자에는 상기 지연회로의 출력이 인버터를 경유하여 입력되는 낸드 게이트로 이루어진 제2에지검출기를 포함하여 구성되는 것을 특징으로 하는 저전압용 디지털 차동 신호 송신기 회로
8 8
제7항에 있어서, 상기 피모스 스위치는 게이트 단자에 상기 제1에지검출기에서 출력되는 신호가 인가되고, 일 단자가 공급전원에 연결되며, 다른 일 단자는 상기 듀티 사이클 보정회로의 출력단에 연결되어 구성되며; 상기 엔모스 스위치는 게이트 단자에 상기 제2에지검출기에서 출력되는 신호가 인가되고, 일 단자가 상기 피모스 스위치의 다른 일 단자에 연결되어 상기 듀티 사이클 보정회로의 출력단으로 연결되며, 다른 일 단자는 접지전원에 연결되어 구성되는 것을 특징으로 하는 저전압용 디지털 차동 신호 송신기 회로
9 9
제8항에 있어서, 상기 제어회로는, 송신기에서 출력되는 최종 출력의 50% 듀티 사이클에 해당하는 VTT/2 전압과 저역통과필터를 이용하여 구해진 최종 출력의 평균 전압을 비교하여, 송신기 최종 출력의 듀티 사이클이 50%가 되도록 상기 에지 검출기에서 지연되는 지연시간을 제어하는 것을 특징으로 하는 저전압용 디지털 차동 신호 송신기 회로
10 10
제9항에 있어서, 상기 카운터는 출력단자가 상기 제2에지 검출기에 구비된 지연회로에 연결되는 것을 특징으로 하는 저전압용 디지털 차동 신호 송신기 회로
11 11
제1항에 있어서, 상기 최종 출력단은, 전송 선로와 동일한 임피던스인 기준 저항을 이용하여 출력 구동부에 구비된 풀업(pull-up) 부분의 임피던스를 보정하는 풀업 보정부와, 보정된 풀업 부분의 임피던스를 이용하여 풀다운(pull-down) 부분의 임피던스를 상기 보정된 풀업 부분의 임피던스와 동일하게 보정하는 풀다운 보정부를 구비하는 임피던스 매칭 보정회로(IMPEDANCE MATCHING CALIBRATION); 및 위상 보정 및 듀티 사이클 보정이 완료된 신호를 전송 선로를 통하여 송신하며, 엔모스(NMOS) 트랜지스터로 이루어진 4개의 스위치와, 상기 임피던스 매칭 보정회로에 의하여 보정된 가변 저항을 구비하는 출력 구동부를 포함하여 구성되는 것을 특징으로 하는 저전압용 디지털 차동 신호 송신기 회로
12 12
제11항에 있어서, 상기 풀업 보정부는, 상기 전송 선로의 임피던스와 동일한 임피던스를 가지며 임피던스 매칭의 기준이 되는 기준 저항; 외부의 기준신호와 상기 기준 저항 일단의 전압을 비교하는 비교기; 상기 비교기의 출력을 이용하여 상기 풀업 부분에 구비된 가변저항 값을 조절하는 풀업 제어신호(PU_CTRL)를 생성하여 임피던스 매칭을 수행하는 풀업 매칭 카운터; 상기 풀업 매칭 카운터의 출력단자에 공통으로 연결되어 상기 풀업 제어신호(PU_CTRL)를 입력받아 상기 풀업 부분과 동일하게 임피던스가 조절되는 가변저항으로 이루어진 제1하프 레플리카(half-replica); 및 일 단자에 상기 제1하프 레플리카를 이루는 가변저항이 연결되고 다른 일 단자에 상기 기준 저항이 연결되며 게이트에 전원(VDD)이 연결된 트랜지스터를 포함하여 구성되는 것을 특징으로 하는 저전압용 디지털 차동 신호 송신기 회로
13 13
제12항에 있어서, 상기 풀업 매칭 카운터의 출력인 풀업 제어신호(PU_CTRL)는 상기 풀업 부분에 구비된 가변저항과 상기 제1하프 레플리카에 공통으로 인가되며, 상기 기준 저항은 상기 트랜지스터와 접지전원 사이에 구비되고, 상기 제1하프 레플리카를 이루는 가변저항은 공급전원(VTT)과 상기 트랜지스터 사이에 구비되는 것을 특징으로 하는 저전압용 디지털 차동 신호 송신기 회로
14 14
제13항에 있어서, 상기 풀다운 보정부는, 상기 풀다운 부분의 임피던스가 상기 풀업 부분에서 보정된 임피던스와 동일하게 되도록, 상기 풀업 제어신호(PU_CTRL)에 의해 상기 풀업 부분과 동일하게 임피던스가 조절되는 가변저항으로 이루어진 제2하프 레플리카(half-replica); 비교기; 상기 비교기의 출력을 이용하여 상기 풀다운 부분에 구비된 가변저항 값을 조절하는 풀다운 제어신호(PD_CTRL)를 생성하여 임피던스 매칭을 수행하는 풀다운 매칭 카운터; 상기 풀다운 매칭 카운터의 출력단자에 공통으로 연결되어 상기 풀다운 제어신호(PD_CTRL)를 입력받아 상기 풀다운 부분과 동일하게 임피던스가 조절되는 가변저항으로 이루어진 제3하프 레플리카(half-replica); 및 상기 제2하프 레플리카와 제3하프 레플리카 사이에 구비된 트랜지스터를 포함하여 구성되는 것을 특징으로 하는 저전압용 디지털 차동 신호 송신기 회로
15 15
제14항에 있어서, 상기 풀다운 제어신호(PD_CTRL)는 상기 풀다운 부분에 구비된 가변저항과 상기 제3하프 레플리카에 공통으로 인가되며, 상기 제2하프 레플리카는 공급전원(VTT)과 트랜지스터의 일 단자 사이에 구비되고, 상기 제3하프 레플리카는 다른 트랜지스터의 다른 일 단자와 접지전원 사이에 구비되며, 상기 제2 및 제3하프 레플리카 사이에 구비된 2개의 트랜지스터의 공통 단자는 상기 비교기의 입력단자로 연결되어 상기 외부의 기준신호와 비교하도록 구성되는 것을 특징으로 하는 저전압용 디지털 차동 신호 송신기 회로
16 16
제11항에 있어서, 상기 출력 구동부는 제1전원(VDD)에서 제2전원(VSS)에 이르는 진폭을 갖고 구동되는 입력신호를 0
지정국 정보가 없습니다
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1 US08401098 US 미국 FAMILY
2 US20100284489 US 미국 FAMILY

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1 US2010284489 US 미국 DOCDBFAMILY
2 US8401098 US 미국 DOCDBFAMILY
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