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다상 스위칭 기반의 Ｃｌａｓｓ-Ｄ 출력단 회로
- 기술번호 : KST2015000991
- 담당센터 : 서울서부기술혁신센터
- 전화번호 : 02-6124-6930
| 요약 | 본 발명은Class-D 출력단 회로에 관한 것으로서 출력단 트랜지스터 쌍을 복수의 단으로 나누어 순차적으로 스위칭하는 것을 특징으로 함으로써, 고속의 스위칭 동작시 출력전압의 큰 오버슈트 및 언더슈트를 줄일 수 있다. |
|---|---|
| Int. CL | H03F 3/217 (2006.01) |
| CPC | H03F 3/2171(2013.01) H03F 3/2171(2013.01) H03F 3/2171(2013.01) H03F 3/2171(2013.01) H03F 3/2171(2013.01) |
| 출원번호/일자 | 1020120131674 (2012.11.20) |
| 출원인 | 서강대학교산학협력단 |
| 등록번호/일자 | 10-1431014-0000 (2014.08.11) |
| 공개번호/일자 | 10-2014-0064385 (2014.05.28) 문서열기 |
| 공고번호/일자 | (20140820) 문서열기 |
| 국제출원번호/일자 | |
| 국제공개번호/일자 | |
| 우선권정보 | |
| 법적상태 | 소멸 |
| 심사진행상태 | 수리 |
| 심판사항 | |
| 구분 | 신규 |
| 원출원번호/일자 | |
| 관련 출원번호 | |
| 심사청구여부/일자 | Y (2012.11.20) |
| 심사청구항수 | 9 |
출원인
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 서강대학교산학협력단 | 대한민국 | 서울특별시 마포구 |
발명자
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 이승훈 | 대한민국 | 서울 용산구 |
| 2 | 안태지 | 대한민국 | 서울 마포구 |
| 3 | 조석희 | 대한민국 | 서울특별시 은평구 |
대리인
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 특허법인충현 | 대한민국 | 서울특별시 서초구 동산로 **, *층(양재동, 베델회관) |
최종권리자
| 번호 | 이름 | 국적 | 주소 |
|---|---|---|---|
| 1 | 서강대학교산학협력단 | 서울특별시 마포구 |
| 번호 | 서류명 | 접수/발송일자 | 처리상태 | 접수/발송번호 |
|---|---|---|---|---|
| 1 | [특허출원]특허출원서 [Patent Application] Patent Application |
2012.11.20 | 수리 (Accepted) | 1-1-2012-0955483-78 |
| 2 | 선행기술조사의뢰서 Request for Prior Art Search |
2013.07.03 | 수리 (Accepted) | 9-1-9999-9999999-89 |
| 3 | 선행기술조사보고서 Report of Prior Art Search |
2013.08.08 | 수리 (Accepted) | 9-1-2013-0064073-06 |
| 4 | 의견제출통지서 Notification of reason for refusal |
2013.12.18 | 발송처리완료 (Completion of Transmission) | 9-5-2013-0877263-14 |
| 5 | [지정기간연장]기간연장(단축, 경과구제)신청서 [Designated Period Extension] Application of Period Extension(Reduction, Progress relief) |
2014.02.14 | 수리 (Accepted) | 1-1-2014-0144422-73 |
| 6 | [명세서등 보정]보정서 [Amendment to Description, etc.] Amendment |
2014.03.04 | 보정승인간주 (Regarded as an acceptance of amendment) | 1-1-2014-0212420-11 |
| 7 | [거절이유 등 통지에 따른 의견]의견(답변, 소명)서 [Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation) |
2014.03.04 | 수리 (Accepted) | 1-1-2014-0212404-80 |
| 8 | 등록결정서 Decision to grant |
2014.07.18 | 발송처리완료 (Completion of Transmission) | 9-5-2014-0491070-91 |
| 9 | 출원인정보변경(경정)신고서 Notification of change of applicant's information |
2017.01.11 | 수리 (Accepted) | 4-1-2017-5005781-67 |
| 10 | 출원인정보변경(경정)신고서 Notification of change of applicant's information |
2019.01.22 | 수리 (Accepted) | 4-1-2019-5014626-89 |
| 번호 | 청구항 |
|---|---|
| 1 |
1 출력단 트랜지스터 쌍은 상단 스위치 (high-side switch, HSS) 및 하단 스위치 (low-side switch, LSS)로 구성된 복수의 단으로 나누어 순차적으로 스위칭하고,상기 상단 스위치의 풀-업 (pull-up) 구동회로는,입력신호를 받아 상단 스위치의 게이트 전압을 상단 스위치의 소스 전압까지 상승시켜 상단스위치를 열어주어, 상기 하단 스위치에 의해 출력전압을 낮추며, 제 1 트랜지스터를 이용하여 큰 전류를 흘려보내 빠른 풀-업 동작을 완료한 후, 제 2 트랜지스터를 이용하여 소정의 전류를 이용해 상단 스위치가 열린 상태를 유지하는 것을 특징으로 하는 Class-D 출력단 회로 |
| 2 |
2 삭제 |
| 3 |
3 제 1 항에 있어서,상기 상단 스위치는 P구조의 트랜지스터를 이용하여 구성되는 것을 특징으로 하는 Class-D 출력단 회로 |
| 4 |
4 삭제 |
| 5 |
5 삭제 |
| 6 |
6 제 1 항에 있어서,상기 상단 스위치의 풀-다운 (pull-down) 구동회로는,입력신호를 받으면, 풀 다운 전류를 흘려 상단 스위치를 닫아 출력전압을 높이는 것을 특징으로 하는 Class-D 출력단 회로 |
| 7 |
7 제 6 항에 있어서,상기 상단 스위치의 풀-다운 구동회로는,제 3 트랜지스터를 이용하여 큰 전류를 흘려보내 빠른 풀-다운 동작을 완료한 후, 제 4 트랜지스터를 이용하여 소정의 전류를 이용해 상단 스위치가 닫힌 상태를 유지하고, 제너 다이오드를 이용하여 상단 스위치의 게이트 전압을 일정하게 유지하는 것을 특징으로 하는 Class-D 출력단 회로 |
| 8 |
8 제 1 항에 있어서,상기 Class-D 출력단 회로는 낮은 전압 스윙 펄스 폭 변조 신호를 입력받아 높은 전압 스윙 펄스 폭 변조 신호로 증폭하여 출력하는 것을 특징으로 하는 Class-D 출력단 회로 |
| 9 |
9 제 8 항에 있어서,상기 출력된 펄스 폭 변조 신호는 저역통과필터를 통해 아날로그 신호로 출력되는 것을 특징으로 하는 Class-D 출력단 회로 |
| 10 |
10 제 9 항에 있어서,상기 저역통과필터는 하나의 인덕터와 하나의 커패시터로 구성되는 LC 필터를 특징으로 하는 Class-D 출력단 회로 |
| 11 |
11 제 1 항에 있어서,상기 Class-D 출력단 회로는 시스템-온-칩으로 집적되는 것을 특징으로 하는 Class-D 출력단 회로 |
| 12 |
12 제 1 항, 제 3 항, 및 제 6 항 내지 제 11 항 중 어느 한 항의 Class-D 출력단 회로를 포함하는 오디오 시스템 |
| 지정국 정보가 없습니다 |
|---|
| 패밀리정보가 없습니다 |
|---|
| 순번 | 연구부처 | 주관기관 | 연구사업 | 연구과제 |
|---|---|---|---|---|
| 1 | 교육과학기술부 | 서강대학교 산학협력단 | 한국연구재단 일반연구자지원사업 | 선택적 SHA 기반의 저전력 12비트 100MS/s 급 0.13um CMOS ADC 연구 |
| 2 | 지식경제부 | 서강대학교 산학협력단 | 정보통신기술인력양성 | 아날로그IP설계기술 |
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- 데이터 이관에 따른 소요기간(1일)으로 인하여 등록원부와 일부 차이가 발생할 수 있으며, 일부 정보(부기, 상세 주소 등)를 제공하지 않고 있습니다.
- 법적증빙자료로 활용하시거나 더 자세한 정보를 보시려면 등록원부를 발급받아 사용하시기 바랍니다.
| 특허 등록번호 | 10-1431014-0000 |
|---|
권리란
| 표시번호 | 사항 |
|---|---|
| 1 |
출원 연월일 : 20121120 출원 번호 : 1020120131674 공고 연월일 : 20140820 공고 번호 : 특허결정(심결)연월일 : 20140718 청구범위의 항수 : 9 유별 : H03F 3/217 발명의 명칭 : 다상 스위칭 기반의 Ｃｌａｓｓ-Ｄ 출력단 회로 존속기간(예정)만료일 : 20190812 |
특허권자란
| 순위번호 | 사항 |
|---|---|
| 1 |
(권리자) 서강대학교산학협력단 서울특별시 마포구... |
등록료란
| 제 1 - 3 년분 | 금 액 | 198,000 원 | 2014년 08월 12일 | 납입 |
| 제 4 년분 | 금 액 | 166,600 원 | 2017년 08월 01일 | 납입 |
| 제 5 년분 | 금 액 | 119,000 원 | 2018년 07월 02일 | 납입 |
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| 번호 | 서류명 | 접수/발송일자 | 처리상태 | 접수/발송번호 |
|---|---|---|---|---|
| 1 | [특허출원]특허출원서 | 2012.11.20 | 수리 (Accepted) | 1-1-2012-0955483-78 |
| 2 | 선행기술조사의뢰서 | 2013.07.03 | 수리 (Accepted) | 9-1-9999-9999999-89 |
| 3 | 선행기술조사보고서 | 2013.08.08 | 수리 (Accepted) | 9-1-2013-0064073-06 |
| 4 | 의견제출통지서 | 2013.12.18 | 발송처리완료 (Completion of Transmission) | 9-5-2013-0877263-14 |
| 5 | [지정기간연장]기간연장(단축, 경과구제)신청서 | 2014.02.14 | 수리 (Accepted) | 1-1-2014-0144422-73 |
| 6 | [명세서등 보정]보정서 | 2014.03.04 | 보정승인간주 (Regarded as an acceptance of amendment) | 1-1-2014-0212420-11 |
| 7 | [거절이유 등 통지에 따른 의견]의견(답변, 소명)서 | 2014.03.04 | 수리 (Accepted) | 1-1-2014-0212404-80 |
| 8 | 등록결정서 | 2014.07.18 | 발송처리완료 (Completion of Transmission) | 9-5-2014-0491070-91 |
| 9 | 출원인정보변경(경정)신고서 | 2017.01.11 | 수리 (Accepted) | 4-1-2017-5005781-67 |
| 10 | 출원인정보변경(경정)신고서 | 2019.01.22 | 수리 (Accepted) | 4-1-2019-5014626-89 |
| 기술번호 | KST2015000991 |
|---|---|
| 자료제공기관 | NTB |
| 기술공급기관 | 서강대학교 |
| 기술명 | 다상 스위칭 기반의 Ｃｌａｓｓ-Ｄ 출력단 회로 |
| 기술개요 |
본 발명은Class-D 출력단 회로에 관한 것으로서 출력단 트랜지스터 쌍을 복수의 단으로 나누어 순차적으로 스위칭하는 것을 특징으로 함으로써, 고속의 스위칭 동작시 출력전압의 큰 오버슈트 및 언더슈트를 줄일 수 있다. |
| 개발상태 | 기술개발완료 |
| 기술의 우수성 | |
| 응용분야 | 오디오 시스템 |
| 시장규모 및 동향 | |
| 희망거래유형 | 기술매매,라이센스,기술협력,기술지도, |
| 사업화적용실적 | |
| 도입시고려사항 |
| 과제고유번호 | 1345174529 |
|---|---|
| 세부과제번호 | 2010-0007618 |
| 연구과제명 | 선택적 SHA 기반의 저전력 12비트 100MS/s급 0.13um CMOS ADC 연구 |
| 성과구분 | 출원 |
| 부처명 | 교육과학기술부 |
| 연구관리전문기관명 | 한국연구재단 |
| 연구주관기관명 | 서강대학교 산학협력단 |
| 성과제출연도 | 2012 |
| 연구기간 | 201005~201304 |
| 기여율 | 0.5 |
| 연구개발단계명 | 개발연구 |
| 6T분류명 | NT(나노기술) |
| 과제고유번호 | 1415123314 |
|---|---|
| 세부과제번호 | H0301-12-1007 |
| 연구과제명 | 차세대 융·복합 시스템용 아날로그IP 핵심설계기술개발 |
| 성과구분 | 출원 |
| 부처명 | 지식경제부 |
| 연구관리전문기관명 | 정보통신산업진흥원 (NIPA) |
| 연구주관기관명 | 서강대학교산학협력단 |
| 성과제출연도 | 2012 |
| 연구기간 | 201006~201312 |
| 기여율 | 0.5 |
| 연구개발단계명 | 기타 |
| 6T분류명 | IT(정보기술) |
특허성과
| [1020120138825] | ESD 보호회로 | 새창보기 |
|---|---|---|
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