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과잉운반자의 드레인 효율을 높인 이종접합 반도체소자구조 및 이의 제조 방법

  • 기술번호 : KST2015002664
  • 담당센터 : 광주기술혁신센터
  • 전화번호 : 062-360-4654
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 과잉운반자의 드레인 효율을 높인 이종접합 반도체 소자의 제조 방법에 관한 것으로 측면확산(LD)층을 사용하는 구조 및 이종접합 구조의 양자채널인 ECC(Excess Carrier Channel)층을 이용하는 구조를 적용하는 소자의 제조방법을 제공한다. 본 발명의 제조방법에 따라 제조된 반도체 소자는 통상의 Si MOS에 비해 전력 소모와 지연 시간의 곱인 값을 감소시킬 수 있고, 이종 접합의 전류 제한 기능으로 인하여 CMOS의 선형특성을 개선시킬 수 있다. Si 반도체의 Sub-70nm 극미세 소자화를 이루는 동시에 1V 이하의 저 전압구동, 정확한 임계 전압의 조절, 저 소비전력과 같은 장점을 제공한다. 따라서, 수 십 기가비트의 ULSI와 수 십 기가 Hz의 동작 특성으로 라디오파 집적 회로, 밀리미터파 집적 회로뿐만 아니고 기억 소자와 마이크로 프로세서, 광전집적회로, 시스템 온 칩(System-on-Chip) 등을 구현하는데 활용될 수 있다.측면확산드레인, 과잉운반자채널, 확산저지층, LD-MOS
Int. CL H01L 29/66 (2006.01.01) H01L 29/10 (2006.01.01) H01L 21/266 (2006.01.01) H01L 29/165 (2006.01.01) H01L 29/737 (2006.01.01)
CPC H01L 29/66242(2013.01) H01L 29/66242(2013.01) H01L 29/66242(2013.01) H01L 29/66242(2013.01) H01L 29/66242(2013.01)
출원번호/일자 1020050076237 (2005.08.19)
출원인 전북대학교산학협력단
등록번호/일자 10-0709069-0000 (2007.04.12)
공개번호/일자 10-2007-0021688 (2007.02.23) 문서열기
공고번호/일자 (20070418) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2005.08.19)
심사청구항수 13

출원인

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번호 이름 국적 주소
1 전북대학교산학협력단 대한민국 전라북도 전주시 덕진구

발명자

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번호 이름 국적 주소
1 심규환 대한민국 대전 유성구
2 양현덕 대한민국 전북 전주시 완산구
3 최상식 대한민국 전북 전주시 완산구
4 김재연 대한민국 전북 전주시 덕진구
5 양전욱 대한민국 전북 전주시 완산구

대리인

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번호 이름 국적 주소
1 박창희 대한민국 대전광역시 서구 한밭대로 ***번지 (둔산동, 사학연금회관) **층(특허법인 플러스)
2 권오식 대한민국 대전광역시 서구 한밭대로 ***번지 (둔산동, 사학연금회관) **층(특허법인 플러스)

최종권리자

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번호 이름 국적 주소
1 전북대학교산학협력단 전라북도 전주시 덕진구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2005.08.19 수리 (Accepted) 1-1-2005-0457221-44
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2006.04.14 수리 (Accepted) 4-1-2006-5051159-10
3 선행기술조사의뢰서
Request for Prior Art Search
2006.06.14 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search
2006.07.12 수리 (Accepted) 9-1-2006-0047943-27
5 의견제출통지서
Notification of reason for refusal
2006.07.24 발송처리완료 (Completion of Transmission) 9-5-2006-0421575-95
6 명세서등보정서
Amendment to Description, etc.
2006.09.18 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2006-0671635-31
7 의견서
Written Opinion
2006.09.18 수리 (Accepted) 1-1-2006-0671622-48
8 등록결정서
Decision to grant
2007.01.10 발송처리완료 (Completion of Transmission) 9-5-2007-0014198-84
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2010.12.28 수리 (Accepted) 4-1-2010-5245806-20
10 출원인정보변경(경정)신고서
Notification of change of applicant's information
2012.10.04 수리 (Accepted) 4-1-2012-5206243-46
11 출원인정보변경(경정)신고서
Notification of change of applicant's information
2016.01.29 수리 (Accepted) 4-1-2016-5013206-34
12 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.02.27 수리 (Accepted) 4-1-2019-5038917-11
13 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.07.23 수리 (Accepted) 4-1-2019-5146986-17
14 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.07.23 수리 (Accepted) 4-1-2019-5146985-61
15 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.10.22 수리 (Accepted) 4-1-2019-5219602-91
16 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.07.06 수리 (Accepted) 4-1-2020-5149086-79
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
반도체 기판상에 과잉운반자의 이동도가 높은 과잉운반자 채널(ECC)층을 형성하는 단계;상기 ECC층 상부에 반도체 층을 형성하는 단계; 및상기 반도체 층 내에서 불순물의 측면확산과 수직확산의 속도를 제어하는 측면확산(LD)층을 형성하는 단계;를 포함하는 과잉운반자의 드레인 효율을 높인 이종접합 반도체소자의 제조방법
2 2
제 1항에 있어서,과잉운반자 채널(ECC)층과 반도체 기판과의 격자상수 차이를 이용하여 과잉운반자의 이동도를 높이며 에너지 밴드구조를 조절하여 과잉운반자의 구속효율이 높도록 하는 것을 특징으로 하는 과잉운반자의 드레인 효율을 높인 이종접합 반도체소자의 제조방법
3 3
제 2항에 있어서,과잉운반자 채널(ECC)층은 도핑되지 않거나 1017cm-3이하의 채널농도를 가지며 Si, SiC, SiGe, SiGeC, GaAs, GaN, InP 및 InGaN으로부터 선택된 에피층인 것을 특징으로 하는 과잉운반자의 드레인 효율을 높인 이종접합 반도체소자의 제조방법
4 4
제 1항에 있어서, 측면확산(LD)층은 상기 반도체 층 상부에 절연막을 형성하는 단계; 마스크를 사용하여 이온 주입하는 단계; 및 열처리 단계;를 통하여 형성되는 것을 특징으로 하는 과잉운반자의 드레인 효율을 높인 이종접합 반도체소자의 제조방법
5 5
제 4항에 있어서, 상기 측면확산(LD)층 형성 단계 이후에, 게이트 산화막 형성 단계; 게이트 패턴 형성 단계; 및 소스, 드레인 형성 단계;를 포함하는 과잉운반자의 드레인 효율을 높인 이종접합 반도체소자의 제조방법
6 6
제 5항에 있어서, 측면확산(LD)층은 소스접합의 하단부에서 과잉운반자 채널층과 접합이 이루어지도록 하는 것을 특징으로 하는 과잉운반자의 드레인 효율을 높인 이종접합 반도체소자의 제조방법
7 7
제 1항 내지 제 6항에서 선택되는 어느 한 항에 있어서,상기 반도체 층은 ECC층 상부에 반도체 박막 하층, 확산저지층 및 반도체 박막 상층을 순차적으로 형성한 것임을 특징으로 하는 과잉운반자의 드레인 효율을 높인 이종접합 반도체소자의 제조방법
8 8
제 7항에 있어서, 상기 확산저지층은 반도체 박막 상층에 비해 불순물 확산계수가 2배 이상 감소되며 Si, SiC, SiGe, SiGeC, GaAs, GaN, InP 및 InGaN으로부터 선택된 에피층인 것을 특징으로 하는 과잉운반자의 드레인 효율을 높인 이종접합 반도체소자의 제조방법
9 9
제 8항에 있어서, 측면확산(LD)층은 수평 방향으로는 드레인 접합 상부에 접하며, 수직방향으로는 확산저지층에 의해 2단계의 확산계면을 형성하는 것을 특징으로 하는 과잉운반자의 드레인 효율을 높인 이종접합 반도체소자의 제조방법
10 10
제 1항 내지 제 6항에서 선택되는 어느 한 항에 있어서,상기 반도체 기판은 PD-SOI 기판이고, 상기 반도체 층은 반도체 PD층인 것을 특징으로 하는 과잉운반자의 드레인 효율을 높인 이종접합 반도체 소자의 제조방법
11 11
제 10항에 있어서,측면확산(LD)층 형성 단계 이후에 소스, 드레인 및 소스커플 접합을 순차적으로 이온주입하여 형성하는 단계를 포함하는 과잉운반자의 드레인 효율을 높인 이종접합 반도체 소자의 제조방법
12 12
제 1항 내지 제 9항에 따른 제조방법에 의하여 제조된 과잉운반자의 드레인 효율을 높인 이종접합 반도체 소자
13 13
제 10항 내지 제 11항에 따른 제조방법에 의하여 제조된 1/f 잡음이 작고 과잉운반자의 드레인 효율을 높인 이종접합 반도체 소자
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.