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아날로그 집적회로 설계 장치 및 방법

  • 기술번호 : KST2015012272
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 아날로그 집적회로 설계 장치 및 방법에 관한 것으로서, 입력된 설계 사양을 입력처리하는 단계와, 전체 회로를 블록별로 분리하고, 각 블록별로 셀프 캐스코드 구조의 회로를 구성하는 단계와, 설계 사양에 대응하여 셀프 캐스코드의 채널길이 비율을 조절하는 단계와, 블록별 회로를 결합하는 단계와, 전체 회로의 특성을 설계 사양과 비교하는 단계를 포함한다. 본 발명에 따르면, 단일 모스펫을 이용하여 성능을 향상시키는 것보다 면적 증가비율이 작기 때문에 제조비용의 절감의 효과가 있다. 그리고, 성능 향상을 위해서 고안되는 회로를 추가하는 방법보다 간단하고, 적은 노력으로 회로의 성능을 높일 수 있다. 또한 추가되는 회로가 적기때문에 회로의 신뢰성도 향상시킬 수 있다. 특히 최신 공정인 저전압 나노미터급 공정을 이용한 아날로그 회로설계에 제안된 설계 기법을 적용하면 큰 효과를 얻을 수 있다.
Int. CL H03K 17/687 (2006.01)
CPC G06F 17/5063(2013.01) G06F 17/5063(2013.01)
출원번호/일자 1020130069217 (2013.06.17)
출원인 충북대학교 산학협력단
등록번호/일자 10-1516327-0000 (2015.04.23)
공개번호/일자 10-2014-0146459 (2014.12.26) 문서열기
공고번호/일자 (20150504) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2013.06.17)
심사청구항수 5

출원인

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번호 이름 국적 주소
1 충북대학교 산학협력단 대한민국 충청북도 청주시 서원구

발명자

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번호 이름 국적 주소
1 김영석 대한민국 충북 청주시 흥덕구
2 백기주 대한민국 경상남도 창원시 성산구

대리인

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번호 이름 국적 주소
1 원성수 대한민국 서울특별시 송파구 법원로**, ***호, ***호(문정동,문정법조프라자) (특허법인명)
2 추혁 대한민국 경기도 화성시 동탄대로 ***-** 효성아이씨티타워 ****호(지엠국제특허)
3 박종경 대한민국 서울특별시 송파구 법원로**, ***호, ***호(문정동,문정법조프라자) (특허법인명)

최종권리자

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번호 이름 국적 주소
1 충북대학교 산학협력단 대한민국 충청북도 청주시 서원구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2013.06.17 수리 (Accepted) 1-1-2013-0537453-50
2 선행기술조사의뢰서
Request for Prior Art Search
2014.03.06 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2014.04.09 수리 (Accepted) 9-1-2014-0030426-13
4 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)
2014.06.09 수리 (Accepted) 1-1-2014-0537609-10
5 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.08.28 수리 (Accepted) 4-1-2014-5103343-45
6 의견제출통지서
Notification of reason for refusal
2014.10.28 발송처리완료 (Completion of Transmission) 9-5-2014-0733483-43
7 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2014.12.26 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2014-1264337-05
8 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2014.12.26 수리 (Accepted) 1-1-2014-1264310-73
9 등록결정서
Decision to grant
2015.04.14 발송처리완료 (Completion of Transmission) 9-5-2015-0247429-11
10 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.06.17 수리 (Accepted) 4-1-2015-5081402-70
11 출원인정보변경(경정)신고서
Notification of change of applicant's information
2018.05.15 수리 (Accepted) 4-1-2018-5086612-26
12 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.07.06 수리 (Accepted) 4-1-2020-5149268-82
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
삭제
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서로 다른 문턱 전압을 갖는 셀프 캐스코드 구조의 채널길이 비율을 이용하여 아날로그 집적회로를 설계하는 아날로그 집적회로 설계 방법
3 3
(a) 입력된 설계 사양을 입력처리하는 단계;(b) 전체 회로를 블록별로 분리하고, 각 블록별로 셀프 캐스코드 구조의 회로를 구성하는 단계;(c) 상기 설계 사양에 대응하여 셀프 캐스코드의 채널길이 비율을 조절하는 단계;(d) 각 블록별 회로를 결합하는 단계; 및(e) 상기 전체 회로의 특성을 상기 설계 사양과 비교하는 단계를 포함하는 아날로그 집적회로 설계 방법
4 4
제3항에 있어서,상기 단계 (b)는 상기 셀프 캐스코드 구조의 채널길이 비율을 50 : 50로 하여 임시로 회로를 설계하는 아날로그 집적회로 설계 방법
5 5
제3항에 있어서,상기 단계 (c)는 상기 설계 사양에 대응하여 시뮬레이션하는 단계를 더 포함하는 아날로그 집적회로 설계 방법
6 6
제3항에 있어서,상기 셀프 캐스코드 구조에 포함되는 MOSFET(Metal Oxide Semiconductor Field Effect Transistor)는,채널 도핑, 게이트 일함수, 게이트 산화막 두께를 포함하는 공정;쇼트 채널 효과(short channel effect), 리버스 쇼트 채널 효과(reverse short channel effect)를 포함하는 소자 특성; 및정방향 바디 바이어스, 게이트 바이어스를 포함하는 바이어스;중에서 적어도 어느 하나에 의해 서로 다른 문턱 전압을 갖는 아날로그 집적회로 설계 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 교육과학기술부 충북대학교 컴퓨터정보통신연구소 일반연구자지원사업 0.5V 아날로그 IP 및 바이오 센서 IC 개발