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입력 신호의 포락선을 검출하고, 상기 포락선이 검출된 시간에 관한 정보를 디지털 코드로 변환하는 제 1 처리부;상기 입력 신호를 샘플링하고, 샘플링된 신호들 간의 시간간격을 변경하여 양자화하는 제 2 처리부; 그리고상기 제 1 처리부가 출력한 디지털 코드를 기반으로 클럭 신호를 생성하여 상기 제 2 처리부에 제공하는 클럭 신호 생성부;를 포함하는 신호 처리 장치
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제 1 항에 있어서,상기 제 1 처리부는:상기 입력 신호의 포락선을 검출하는 포락선 검출기;상기 포락선을 임계전압과 비교하여 구형파를 출력하는 비교기; 그리고기준 신호와 상기 구형파 간의 시간차를 디지털 코드로 변환하는 시간-디지털 변환기;를 포함하는 신호 처리 장치
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제 2 항에 있어서,상기 시간-디지털 변환기는:상기 기준 신호를 지연시키는 다수의 지연소자; 그리고지연된 기준 신호와 구형파 중에서 상기 구형파가 먼저 입력되는 경우 신호를 출력하는 다수의 아비터;를 포함하는 신호 처리 장치
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제 3 항에 있어서,상기 클럭 신호 생성부는:상기 다수의 아비터 중 두 개의 아비터의 출력 신호를 XOR 연산하는 다수의 XOR 게이트;상기 다수의 XOR 게이트의 출력 신호에 따라 상기 다수의 지연소자의 출력 신호 중 하나를 선택하여 출력하는 멀티플렉서; 그리고상기 멀티플렉서의 출력 신호를 이용하여 상기 클럭 신호를 생성하는 클럭 셀;을 포함하는 신호 처리 장치
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5
제 4 항에 있어서,상기 제 2 처리부는:상기 입력 신호를 제 1 주기로 샘플링하여 유지하는 샘플 홀드부;샘플링된 신호들 간의 시간간격을 제 2 주기로 연장하는 연장부; 그리고상기 연장부의 출력 신호를 양자화하는 양자화부;를 포함하는 신호 처리 장치
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6
제 5 항에 있어서,상기 클럭 셀은:상기 멀티플렉서의 출력 신호를 이용하여 상기 제 1 주기의 샘플링 클럭 신호를 생성하는 샘플링 클럭 셀; 그리고상기 멀티플렉서의 출력 신호를 이용하여 상기 제 2 주기의 연장 클럭 신호를 생성하는 연장 클럭 셀;을 포함하는 신호 처리 장치
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7
제 6 항에 있어서,상기 샘플링 클럭 셀은:상기 멀티플렉서의 출력 신호를 상기 제 1 주기만큼 지연시키는 버퍼; 그리고상기 멀티플렉서의 출력 신호의 상승 에지와 상기 버퍼의 출력 신호의 상승 에지 간의 시간간격을 폭으로 갖는 펄스 신호를 생성하는 로직 게이트;를 포함하는 지연 셀을 다수 개 포함하는 신호 처리 장치
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8
제 6 항에 있어서,상기 연장 클럭 셀은:상기 멀티플렉서의 출력 신호를 상기 제 2 주기만큼 지연시키는 버퍼; 그리고상기 멀티플렉서의 출력 신호의 상승 에지와 상기 버퍼의 출력 신호의 상승 에지 간의 시간간격을 폭으로 갖는 펄스 신호를 생성하는 로직 게이트;를 포함하는 지연 셀을 다수 개 포함하는 신호 처리 장치
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9
제 6 항에 있어서,상기 샘플 홀드부는:상기 샘플링 클럭 신호에 따라 개폐되어 상기 입력 신호를 샘플링하는 다수의 샘플링 스위치; 그리고샘플링된 신호의 전압으로 충전되는 다수의 커패시터;를 포함하는 신호 처리 장치
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10
제 6 항에 있어서,상기 연장부는:상기 연장 클럭 신호에 따라 개폐되어 상기 샘플링된 신호들 간의 시간간격을 연장하는 다수의 연장 스위치를 포함하는 신호 처리 장치
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11
제 5 항에 있어서,상기 양자화부는:상기 연장부의 출력 신호를 기준 전압과 비교하여 써모미터 코드를 출력하는 다수의 비교기; 그리고상기 써모미터 코드를 2진 코드로 인코딩하는 써모미터-바이너리 인코더;를 포함하는 신호 처리 장치
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제 2 항에 있어서,상기 제 1 처리부는:상기 시간-디지털 변환기의 출력 신호를 2진 코드로 인코딩하는 써모미터-바이너리 인코더를 더 포함하는 신호 처리 장치
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13
입력 신호의 포락선을 검출하여 상기 포락선이 검출된 시간에 관한 정보를 출력하고, 상기 출력된 정보를 기반으로 생성된 클럭 신호에 따라 상기 입력 신호를 샘플링하여 양자화하는 신호 처리 방법
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14
제 13 항에 있어서,상기 포락선이 검출된 시간에 관한 정보를 출력하는 것은:상기 입력 신호의 포락선을 검출하는 단계;상기 포락선을 임계전압과 비교하여 구형파를 출력하는 단계; 그리고기준 신호와 상기 구형파 간의 시간차를 디지털 코드로 변환하는 단계;를 포함하는 신호 처리 방법
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15
제 13 항에 있어서,상기 입력 신호를 샘플링하여 양자화하는 것은:상기 입력 신호를 제 1 주기로 샘플링하여 유지하는 단계;샘플 신호들 간의 시간간격을 제 2 주기로 변경하는 단계; 그리고상기 시간간격이 변경된 샘플 신호들을 양자화하는 단계;를 포함하는 신호 처리 방법
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제 15 항에 있어서,상기 제 2 주기는 상기 제 1 주기보다 더 긴 신호 처리 방법
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수신 신호를 증폭하는 저잡음 증폭기;상기 증폭된 수신 신호의 포락선을 검출하고, 상기 포락선이 검출된 시간에 관한 정보를 디지털 코드로 변환하는 제 1 처리부;상기 증폭된 수신 신호를 샘플링하고, 샘플링된 신호들 간의 시간간격을 변경하여 양자화하는 제 2 처리부; 그리고상기 제 1 처리부가 출력한 디지털 코드를 기반으로 클럭 신호를 생성하여 상기 제 2 처리부에 제공하는 클럭 신호 생성부;를 포함하는 수신기
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18
제 17 항에 있어서,상기 수신 신호는 UWB 임펄스 신호인 수신기
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19
제 17 항에 있어서,상기 제 1 처리부는:상기 증폭된 수신 신호의 포락선을 검출하는 포락선 검출기;상기 포락선을 임계전압과 비교하여 구형파를 출력하는 비교기; 그리고기준 신호와 상기 구형파 간의 시간차를 디지털 코드로 변환하는 시간-디지털 변환기;를 포함하는 수신기
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제 19 항에 있어서,상기 기준 신호는, 상기 수신기와 송신기를 동기화시키는 동기 신호인 수신기
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제 19 항에 있어서,상기 시간-디지털 변환기는:상기 기준 신호를 지연시키는 다수의 지연소자; 그리고지연된 기준 신호와 구형파 중에서 상기 구형파가 먼저 입력되는 경우 신호를 출력하는 다수의 아비터;를 포함하는 수신기
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22
제 21 항에 있어서,상기 클럭 신호 생성부는:상기 다수의 아비터 중 두 개의 아비터의 출력 신호를 XOR 연산하는 다수의 XOR 게이트;상기 다수의 XOR 게이트의 출력 신호에 따라 상기 다수의 지연소자의 출력 신호 중 하나를 선택하여 출력하는 멀티플렉서; 그리고상기 멀티플렉서의 출력 신호를 이용하여 상기 클럭 신호를 생성하는 클럭 셀;을 포함하는 수신기
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23
제 22 항에 있어서,상기 제 2 처리부는:상기 증폭된 수신 신호를 제 1 주기로 샘플링하여 유지하는 샘플 홀드부;샘플링된 신호들 간의 시간간격을 제 2 주기로 연장하는 연장부; 그리고상기 연장부의 출력 신호를 양자화하는 양자화부;를 포함하는 수신기
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제 23 항에 있어서,상기 클럭 셀은:상기 멀티플렉서의 출력 신호를 이용하여 상기 제 1 주기의 샘플링 클럭 신호를 생성하는 샘플링 클럭 셀; 그리고상기 멀티플렉서의 출력 신호를 이용하여 상기 제 2 주기의 연장 클럭 신호를 생성하는 연장 클럭 셀;을 포함하는 수신기
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제 24 항에 있어서,상기 샘플링 클럭 셀은:상기 멀티플렉서의 출력 신호를 상기 제 1 주기만큼 지연시키는 버퍼; 그리고상기 멀티플렉서의 출력 신호의 상승 에지와 상기 버퍼의 출력 신호의 상승 에지 간의 시간간격을 폭으로 갖는 펄스 신호를 생성하는 로직 게이트;를 포함하는 지연 셀을 다수 개 포함하는 수신기
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제 24 항에 있어서,상기 연장 클럭 셀은:상기 멀티플렉서의 출력 신호를 상기 제 2 주기만큼 지연시키는 버퍼; 그리고상기 멀티플렉서의 출력 신호의 상승 에지와 상기 버퍼의 출력 신호의 상승 에지 간의 시간간격을 폭으로 갖는 펄스 신호를 생성하는 로직 게이트;를 포함하는 지연 셀을 다수 개 포함하는 수신기
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신호를 송신하는 송신기;타겟으로부터 반사된 신호를 수신하는 수신기; 그리고상기 수신기의 출력 신호를 기반으로 상기 타겟까지의 거리를 계산하는 DSP;를 포함하며, 상기 수신기는: 수신 신호를 증폭하는 저잡음 증폭기; 상기 증폭된 수신 신호의 포락선을 검출하고, 상기 포락선이 검출된 시간에 관한 정보를 디지털 코드로 변환하는 제 1 처리부; 상기 증폭된 수신 신호를 샘플링하고, 샘플링된 신호들 간의 시간간격을 변경하여 양자화하는 제 2 처리부; 그리고 상기 제 1 처리부가 출력한 디지털 코드를 기반으로 클럭 신호를 생성하여 상기 제 2 처리부에 제공하는 클럭 신호 생성부;를 포함하는 거리 측정 장치
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