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중앙 처리 장치의 고성능 처리를 위한 메모리 주소 맵핑회로

  • 기술번호 : KST2015023933
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 메인 메모리의 구성을 DRAM(SDRAM)+SRAM으로 구성하고, 이러한 구성을 이용하여 중앙 처리 장치의 고성능 처리를 할 수 있는 중앙 처리 장치의 고성능 처리를 위한 메모리 주소 맵핑 회로에 관한 것이다. 이와 같은 본 발명에 따른 중앙처리장치의 고성능 처리를 위한 메모리 주소 맵핑 회로는 디코딩을 위한 어드레스 신호 및 제어신호를 출력하는 중앙 처리 장치(CPU)와; 상기 중앙 처리 장치(CPU)에서 출력된 어드레스 신호 및 제어신호를 디코딩 및 제어 신호로 변환하는 주소 디코더와, 제1 메모리의 위치를 변화시켜주는 모듈로 구성된 프로그래머블 로직 장치와; 유동적으로 위치를 바꿀 수 있는 상기 제1 메모리 및 하나 이상의 다른 메모리를 구비하며, 상기 프로그래머블 로직 장치에서 출력되는 메모리 제어 신호를 수신하는 메모리부로 구성된다. CPU, 메모리 어드레스, 맵핑
Int. CL G06F 12/06 (2006.01)
CPC G11C 8/10(2013.01) G11C 8/10(2013.01) G11C 8/10(2013.01)
출원번호/일자 1020000074716 (2000.12.08)
출원인 엘지전자 주식회사
등록번호/일자 10-0488103-0000 (2005.04.28)
공개번호/일자 10-2002-0045305 (2002.06.19) 문서열기
공고번호/일자 (20050509) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2002.07.16)
심사청구항수 1

출원인

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번호 이름 국적 주소
1 엘지전자 주식회사 대한민국 서울특별시 영등포구

발명자

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번호 이름 국적 주소
1 유득형 대한민국 경기도수원시팔달구

대리인

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번호 이름 국적 주소
1 허용록 대한민국 서울특별시 강남구 역삼로 ***, *층 (역삼동, 현죽빌딩)(선영특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 엘지전자 주식회사 대한민국 서울특별시 영등포구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2000.12.08 수리 (Accepted) 1-1-2000-0261916-98
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2001.03.29 수리 (Accepted) 4-1-2001-0036111-11
3 출원인변경신고서
Applicant change Notification
2002.06.14 수리 (Accepted) 1-1-2002-5146007-09
4 출원심사청구서
Request for Examination
2002.07.16 수리 (Accepted) 1-1-2002-0227174-09
5 대리인 선임 신고서
Notification of assignment of agent
2002.07.18 수리 (Accepted) 1-1-2002-0227608-12
6 출원인정보변경(경정)신고서
Notification of change of applicant's information
2003.10.16 수리 (Accepted) 4-1-2003-0055522-32
7 선행기술조사의뢰서
Request for Prior Art Search
2004.07.09 수리 (Accepted) 9-1-9999-9999999-89
8 선행기술조사보고서
Report of Prior Art Search
2004.08.18 수리 (Accepted) 9-1-2004-0048770-24
9 의견제출통지서
Notification of reason for refusal
2004.09.20 발송처리완료 (Completion of Transmission) 9-5-2004-0390164-47
10 의견서
Written Opinion
2004.11.19 수리 (Accepted) 1-1-2004-0541033-26
11 명세서 등 보정서
Amendment to Description, etc.
2004.11.19 보정승인 (Acceptance of amendment) 1-1-2004-0541032-81
12 등록결정서
Decision to grant
2005.03.21 발송처리완료 (Completion of Transmission) 9-5-2005-0121548-79
13 출원인정보변경(경정)신고서
Notification of change of applicant's information
2008.08.08 수리 (Accepted) 4-1-2008-5128387-76
14 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.04.27 수리 (Accepted) 4-1-2009-5080835-50
15 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.11.03 수리 (Accepted) 4-1-2009-0023850-26
16 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.05.22 수리 (Accepted) 4-1-2015-5068349-97
17 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.05.28 수리 (Accepted) 4-1-2020-5118228-40
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
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디코딩을 위한 어드레스 신호 및 제어신호를 출력하는 중앙 처리 장치(CPU)와; 상기 중앙 처리 장치(CPU)에서 출력된 어드레스 신호 및 제어신호를 디코딩 및 제어 신호로 변환하는 주소 디코더와, 제1 메모리(SRAM)의 위치를 변화시켜주는 모듈로 구성된 프로그래머블 로직 장치와; 유동적으로 위치를 바꿀 수 있는 상기 제1 메모리(SRAM) 및 하나 이상의 다른 메모리(DRAM/SRAM)를 구비하며, 상기 프로그래머블 로직 장치에서 출력되는 메모리 제어 신호를 수신하는 메모리부 및 상기 중앙 처리 장치와 메모리부 사이에 위치하며, 어드레스 및 데이터를 전송하는 버퍼로 구성된 것을 특징으로 하는 중앙처리장치의 고성능 처리를 위한 메모리 주소 맵핑 회로
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디코딩을 위한 어드레스 신호 및 제어신호를 출력하는 중앙 처리 장치(CPU)와; 상기 중앙 처리 장치(CPU)에서 출력된 어드레스 신호 및 제어신호를 디코딩 및 제어 신호로 변환하는 주소 디코더와, 제1 메모리(SRAM)의 위치를 변화시켜주는 모듈로 구성된 프로그래머블 로직 장치와; 유동적으로 위치를 바꿀 수 있는 상기 제1 메모리(SRAM) 및 하나 이상의 다른 메모리(DRAM/SRAM)를 구비하며, 상기 프로그래머블 로직 장치에서 출력되는 메모리 제어 신호를 수신하는 메모리부 및 상기 중앙 처리 장치와 메모리부 사이에 위치하며, 어드레스 및 데이터를 전송하는 버퍼로 구성된 것을 특징으로 하는 중앙처리장치의 고성능 처리를 위한 메모리 주소 맵핑 회로
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.