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박막 트랜지스터 및 그 제조방법

  • 기술번호 : KST2015025397
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요약 본 발명에 따른 박막 트랜지스터의 제조방법은, 기판 위에 결정성 반도체막을 형성하는 단계와; 결정성 반도체막을 패터닝하고, 그 패터닝된 결정성 반도체막 위에 게이트 절연막을 형성하는 단계와; 게이트 절연막 상의 소정의 두 영역에 포토 레지스트막을 형성하는 단계와; 게이트 절연막에 대한 건식 식각을 수행하는 단계와; 포토 레지스트막을 제거하고, 상부로 돌출된 게이트 절연막 사이 및 인접한 돌출 영역의 게이트 절연막 일부에 게이트 전극을 형성하는 단계와; 돌출된 게이트 절연막 중에서 게이트 전극이 형성되지 않은 영역의 게이트 절연막은, 게이트 전극이 형성된 영역에서부터 바깥쪽으로 완만한 경사로 형성시키는 단계와; 게이트 전극이 형성된 영역 하부에 대응되는 결정성 반도체막은 고농도 불순물 이온이 도핑되지 않은 채널 영역으로, 게이트 전극이 형성되지 않은 영역의 돌출된 게이트 절연막 하부에 대응되는 결정성 반도체막은 고농도 불순물 이온이 연속적 농도변화를 갖는 LDD 영역으로, 돌출된 게이트 절연막의 바깥 영역 하부에 대응되는 결정성 반도체막은 고농도 불순물 이온이 도핑된 소오스/드레인 영역으로 형성하는 단계와; 게이트 절연막 및 게이트 전극 위에 층간 절연막을 형성하는 단계; 및 소오스/드레인 영역 위의 층간 절연막 및 게이트 절연막에 비아 홀을 형성하고, 그 비아 홀이 형성된 영역 위에 소오스 전극 및 드레인 전극을 형성하는 단계; 를 포함한다.
Int. CL H01L 29/786 (2006.01)
CPC H01L 29/78621(2013.01) H01L 29/78621(2013.01) H01L 29/78621(2013.01) H01L 29/78621(2013.01) H01L 29/78621(2013.01)
출원번호/일자 1020020020342 (2002.04.15)
출원인 엘지디스플레이 주식회사
등록번호/일자 10-0488063-0000 (2005.04.28)
공개번호/일자 10-2003-0081894 (2003.10.22) 문서열기
공고번호/일자 (20050506) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항 심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2002.04.15)
심사청구항수 9

출원인

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번호 이름 국적 주소
1 엘지디스플레이 주식회사 대한민국 서울특별시 영등포구

발명자

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번호 이름 국적 주소
1 이석우 대한민국 경기도안양시동안구

대리인

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번호 이름 국적 주소
1 허용록 대한민국 서울특별시 강남구 역삼로 ***, *층 (역삼동, 현죽빌딩)(선영특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 엘지디스플레이 주식회사 대한민국 서울특별시 영등포구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2002.04.15 수리 (Accepted) 1-1-2002-0111308-99
2 선행기술조사의뢰서
Request for Prior Art Search
2004.03.10 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2004.04.13 수리 (Accepted) 9-1-2004-0021398-76
4 의견제출통지서
Notification of reason for refusal
2004.04.22 발송처리완료 (Completion of Transmission) 9-5-2004-0152846-51
5 명세서 등 보정서
Amendment to Description, etc.
2004.06.15 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2004-0256699-05
6 의견서
Written Opinion
2004.06.15 수리 (Accepted) 1-1-2004-0256700-64
7 거절결정서
Decision to Refuse a Patent
2004.12.23 발송처리완료 (Completion of Transmission) 9-5-2004-0545855-79
8 명세서 등 보정서 (심사전치)
Amendment to Description, etc(Reexamination)
2005.02.16 보정승인 (Acceptance of amendment) 7-1-2005-0002968-77
9 등록결정서
Decision to grant
2005.04.16 발송처리완료 (Completion of Transmission) 9-5-2005-0172138-47
10 출원인정보변경(경정)신고서
Notification of change of applicant's information
2008.04.18 수리 (Accepted) 4-1-2008-5061241-15
11 출원인정보변경(경정)신고서
Notification of change of applicant's information
2010.12.21 수리 (Accepted) 4-1-2010-5241074-12
12 출원인정보변경(경정)신고서
Notification of change of applicant's information
2011.10.04 수리 (Accepted) 4-1-2011-5199065-15
13 출원인정보변경(경정)신고서
Notification of change of applicant's information
2011.12.29 수리 (Accepted) 4-1-2011-5262372-95
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번호 청구항
1 1
기판과;상기 기판 상에 마련되며, 고농도 불순물 이온이 도핑된 소오스/드레인 영역과, 고농도 불순물 이온이 연속적 농도 변화를 갖도록 도핑된 LDD 영역 및 고농도 불순물 이온이 도핑되지 않은 채널 영역이 구비된 결정성 반도체막과;상기 결정성 반도체막 위에 형성되며, 상기 LDD 영역의 상부 및 상기 LDD 영역에 인접한 채널 영역의 상부에는 돌출되어 타 영역에 비하여 상대적으로 두껍게 형성되고, 상기 LDD 영역의 상부는 바깥쪽(소오스/드레인 영역) 방향으로 그 두께가 감소되도록 경사지게 형성된 게이트 절연막과;상기 LDD 영역에 인접한 채널 영역의 상부에 돌출되어 형성된 게이트 절연막의 상부 및 그 돌출된 게이트 절연막 사이의 상부에 형성된 게이트 전극과;상기 게이트 절연막 및 게이트 전극 위에 형성된 층간 절연막; 및상기 층간 절연막 및 게이트 절연막에 형성된 비아 홀을 통하여 상기 소오스/드레인 영역과 연결되며, 상기 층간 절연막 상부에 형성된 소오스/드레인 전극; 을 포함하는 것을 특징으로 하는 박막 트랜지스터
2 2
제 1항에 있어서, 상기 기판과 결정성 반도체막 사이에, 상기 기판을 통한 불순물의 영향을 줄이기 위하여 버퍼층이 더 구비되는 것을 특징으로 하는 박막 트랜지스터
3 3
제 1항에 있어서, 상기 결정성 반도체막에 형성되는 LDD 영역의 길이는, 상기 게이트 전극의 길이에 비하여 상대적으로 짧게 형성되는 것을 특징으로 하는 박막 트랜지스터
4 4
제 1항 내지 제 3항 중의 어느 한 항에 의하여 형성된 박막 트랜지스터와; 상기 박막 트랜지스터의 소오스/드레인 전극과 층간 절연막 위에 형성된 보호막; 및 상기 드레인 전극 위에 형성된 콘텍트 홀을 통하여 상기 드레인 전극과 전기적으로 연결되고, 상기 보호막의 일부 영역 위에 겹쳐서 형성되며, 영상 표시를 위하여 마련되는 화소 전극; 을 포함하는 것을 특징으로 하는 디스플레이 소자
5 5
기판 위에 결정성 반도체막을 형성하는 단계와;상기 결정성 반도체막을 소정의 형태로 패터닝하고, 그 패터닝된 결정성 반도체막 위에 게이트 절연막을 형성하는 단계와;상기 게이트 절연막 상의 소정의 두 영역(추후 LDD가 형성될 영역 부근)에 포토 레지스트막이 돌출되도록 패터닝하여 형성하는 단계와;상기 게이트 절연막에 대한 건식 식각을 수행하여, 상기 포토 레지스트막이 형성된 영역 하부의 게이트 절연막은 식각되지 않도록 유지시키고, 상기 포토 레지스트막이 형성되지 않은 영역의 게이트 절연막은 식각하여 얇게 형성하는 단계와;상기 포토 레지스트막을 제거하고, (상기 포토 레지스트막이 형성되어 있던 영역으로서)상부로 돌출된 게이트 절연막 사이 및 인접한 상기 돌출 영역의 게이트 절연막 일부 상에 게이트 전극을 패터닝하여 형성하는 단계와;상기 게이트 절연막에 대한 습식 식각을 수행하고, 상기 돌출된 게이트 절연막 중에서 상기 게이트 전극이 형성되지 않은 영역의 게이트 절연막은, 상기 게이트 전극이 형성된 영역에서부터 바깥쪽으로 그 두께를 감소시켜 완만한 경사를 갖도록 형성시키는 단계와;상기 게이트 절연막의 상부에서 고농도 불순물 이온을 도핑시켜, 상기 게이트 전극이 형성된 영역 하부에 대응되는 상기 결정성 반도체막은 고농도 불순물 이온이 도핑되지 않은 채널 영역으로, 상기 게이트 전극이 형성되지 않은 영역의 돌출된 게이트 절연막 하부에 대응되는 상기 결정성 반도체막은 고농도 불순물 이온이 연속적 농도변화를 갖는 LDD 영역으로, 상기 돌출된 게이트 절연막의 바깥 영역 하부에 대응되는 상기 결정성 반도체막은 고농도 불순물 이온이 도핑된 소오스/드레인 영역으로 형성하는 단계와;상기 게이트 절연막 및 게이트 전극 위에 층간 절연막을 형성하는 단계; 및상기 소오스/드레인 영역 위의 층간 절연막 및 게이트 절연막에 비아 홀을 형성하고, 그 비아 홀이 형성된 영역 위에 소오스 전극 및 드레인 전극을 형성하는 단계; 를 포함하는 것을 특징으로 하는 박막 트랜지스터의 제조방법
6 6
제 5항에 있어서, 상기 LDD 영역에 도핑되는 고농도 불순물 이온의 농도는, 상기 결정성 반도체막의 소오스/드레인 영역에서 채널 영역으로 갈수록 그 농도가 엷어지는 것을 특징으로 하는 박막 트랜지스터의 제조방법
7 7
제 5항에 있어서, 상기 게이트 전극의 하부에 형성된 게이트 절연막의 두께는 일정하지 않으며, 상기 게이트 전극의 양단부(LDD 형성 영역 부근)에 형성된 게이트 절연막은 상부로 돌출되어 상대적으로 그 두께가 두꺼운 것을 특징으로 하는 박막 트랜지스터의 제조방법
8 8
제 5항에 있어서, 상기 상부로 돌출된 게이트 절연막 중에서 상기 게이트 전극이 형성되지 않은 영역의 게이트 절연막은, 게이트 전극이 형성된 영역에서부터 바깥쪽으로 완만한 경사로 형성되며, 그 돌출된 게이트 절연막의 경사 기울기(두께 변화)에 의하여 LDD 영역에 도핑되는 고농도 불순물 이온의 농도가 점진적으로 변화되는 것을 특징으로 하는 박막 트랜지스터의 제조방법
9 9
제 5항에 있어서, 상기 결정성 반도체막에 형성되는 LDD 영역의 길이는, 상기 게이트 전극의 길이에 비하여 상대적으로 짧게 형성되는 것을 특징으로 하는 박막 트랜지스터의 제조방법
10 9
제 5항에 있어서, 상기 결정성 반도체막에 형성되는 LDD 영역의 길이는, 상기 게이트 전극의 길이에 비하여 상대적으로 짧게 형성되는 것을 특징으로 하는 박막 트랜지스터의 제조방법
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.