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비디오 디코더의 인트라 예측 장치

  • 기술번호 : KST2015036051
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요약 본 발명은 이동형 방송 수신기의 비디오 디코딩을 위한 인트라 예측 장치에 관한 것이다. 특히 본 발명은 Intra_Luma_plane 모드와 Intra_chroma_plane 모드의 일부 구성 요소와 데이터 패스 자원(Data-path Resource)을 공유(Sharing)함으로써, 하드웨어 면적을 줄이는 효과가 있다. 특히 상기 Intra_Luma_plane 모드와 Intra_chroma_plane 모드일 때 수식을 간소화함으로써, 데이터 패스를 더 단순하게 구성하여 하드웨어 면적을 더 작게 하고 소모되는 전력을 더욱 줄일 수 있다. 그리고 상기 Intra_Luma_plane 모드와 Intra_chroma_plane 모드를 제외한 나머지 필터링 모드(Filtering Mode)의 데이터 패스 자원을 공유함으로써, 하드웨어 면적을 더욱 줄일 수 있고 더불어 전력 소모도 더욱 줄일 수 있다. 이와 같이 본 발명은 다양한 인트라 예측 모드에서 데이터 패스의 일부 자원을 공유하고, 모든 연산을 파이프라인시킴으로써, 하드웨어 면적을 줄이고, 고 성능, 저 전력화가 가능한 이동형 방송 수신기를 구현할 수 있다. H.264, 인트라 예측
Int. CL H04N 19/156 (2014.01) H04N 19/593 (2014.01) H04N 19/43 (2014.01)
CPC H04N 19/11(2013.01) H04N 19/11(2013.01) H04N 19/11(2013.01) H04N 19/11(2013.01)
출원번호/일자 1020050014552 (2005.02.22)
출원인 엘지전자 주식회사
등록번호/일자 10-0617086-0000 (2006.08.22)
공개번호/일자 10-2006-0093806 (2006.08.28) 문서열기
공고번호/일자 (20060831) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2005.02.22)
심사청구항수 10

출원인

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번호 이름 국적 주소
1 엘지전자 주식회사 대한민국 서울특별시 영등포구

발명자

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번호 이름 국적 주소
1 김상철 대한민국 서울 관악구

대리인

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번호 이름 국적 주소
1 심창섭 대한민국 서울특별시 송파구 올림픽로 **, 현대빌딩 *층 (잠실동)(KBK특허법률사무소)
2 김용인 대한민국 서울특별시 송파구 올림픽로 ** (잠실현대빌딩 *층)(특허법인(유한)케이비케이)

최종권리자

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번호 이름 국적 주소
1 엘지전자 주식회사 대한민국 서울특별시 영등포구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2005.02.22 수리 (Accepted) 1-1-2005-0093212-06
2 등록결정서
Decision to grant
2006.07.27 발송처리완료 (Completion of Transmission) 9-5-2006-0431392-15
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2008.08.08 수리 (Accepted) 4-1-2008-5128387-76
4 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.04.27 수리 (Accepted) 4-1-2009-5080835-50
5 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.11.03 수리 (Accepted) 4-1-2009-0023850-26
6 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.05.22 수리 (Accepted) 4-1-2015-5068349-97
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.05.28 수리 (Accepted) 4-1-2020-5118228-40
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번호 청구항
1 1
다수개의 인트라 예측 모드 중 어느 하나의 모드로 인트라 예측을 수행하기 위해 주변 매크로 블록의 인접 데이터를 입력받는 데이터 입력부;설정된 인트라 예측 모드가 데이터 복사(data copy)를 의미하는 모드이면 상기 데이터 입력부에서 출력되는 데이터를 그대로 바이패스하는 제1 데이터 처리부;설정된 인트라 예측 모드가 상기 제1 데이터 처리부에서 사용되는 모드와 플레인 모드를 제외한 어느 하나의 모드이면 일부 구성 요소 및 데이터 패스를 공유하여 상기 데이터 입력부에서 출력되는 데이터에 대해 설정된 인트라 예측 모드로 인트라 예측을 수행하는 제2 데이터 처리부;설정된 인트라 예측 모드가 플레인 모드이면 일부 구성 요소 및 데이터 패스를 공유하여 상기 데이터 입력부에서 출력되는 데이터에 대해 설정된 인트라 예측 모드로 인트라 예측을 수행하는 제3 데이터 처리부; 및 상기 제1 내지 제3 데이터 처리부 중 어느 하나로부터 인트라 예측된 데이터를 입력받아 Resudial 데이터와 더하여 출력하는 데이터 합성부를 포함하여 구성되는 것을 특징으로 하는 인트라 예측 장치
2 2
제 1 항에 있어서, 상기 제1 데이터 처리부는Intra_16x16_Ver 모드, Intra_16x16_Hor 모드, Intra_Chroma_Ver 모드, Intra_Chroma_Hor 모드, Intra_4x4_Ver 모드, Intra_4x4_Hor 모드 중 어느 하나의 모드로 설정되면 상기 데이터 입력부에서 출력되는 데이터를 그대로 데이터 합성부로 바이패스하는 것을 특징으로 하는 인트라 예측 장치
3 3
제 1 항에 있어서, 상기 제2 데이터 처리부는Intra_16x16_DC 모드, Intra_Chroma_DC 모드, Intra_4x4_DC 모드, Intra_4x4_Diagonal_Down_Left 모드, Intra_4x4_Diagonal_Down_Right 모드, Intra_4x4_Vertical_Right 모드, Intra_4x4_Horizontal_Down 모드, Intra_4x4_Vertical_Left 모드, Intra_4x4_Horizontal_Up 모드 중 어느 하나의 모드로 설정되면, 일부 구성 요소 및 데이터 패스를 공유하여 설정된 모드로 인트라 예측을 수행하는 것을 특징으로 하는 인트라 예측 장치
4 4
제 1 항에 있어서, 상기 제2 데이터 처리부는상기 데이터 입력부를 통해 제공되는 데이터를 일시 저장하는 제1 내지 제4 레지스터가 병렬 구성되는 제1 레지스터부;상기 데이터 입력부를 통해 제공되는 데이터를 일시 저장하는 제1 내지 제4 레지스터가 병렬 구성되는 제2 레지스터부;설정된 인트라 예측 모드에 따라 상기 제1 레지스터부의 출력에 대해 가산 연산을 수행하는 제1 가산 연산부;설정된 인트라 예측 모드에 따라 상기 제2 레지스터부의 출력에 대해 가산 연산을 수행하는 제2 가산 연산부;설정된 인트라 예측 모드에 따라 상기 제1 가산 연산부의 출력을 누산하는 제1 누산부; 및 설정된 인트라 예측 모드에 따라 상기 제2 가산 연산부의 출력을 누산하는 제2 누산부를 포함하여 구성되는 것을 특징으로 하는 인트라 예측 장치
5 5
제 4 항에 있어서, 상기 제2 데이터 처리부는상기 제1 레지스터부의 제1 내지 제4 레지스터에는 첫번째 예측 데이터를 계산하기 위한 데이터들이 입력되고, 동시에 제2 레지스터부의 제1 내지 제4 레지스터에는 두번째 예측 데이터를 계산하기 위한 데이터들이 입력되며, 이 값들이 한 클럭 사이클 뒤에 제1,제2 가산 연산부의 마지막 출력단으로 입력됨과 동시에 다음 예측을 위한 데이터들이 제1 레지스터부의 제1 내지 제4 레지스터와 제2 레지스터부의 제1 내지 제4 레지스터에 각각 입력되는 파이프라인 구조인 것을 특징으로 하는 인트라 예측 장치
6 6
제 4 항에 있어서, 상기 제1 가산 연산부는상기 제1 레지스터부의 제1,제2 레지스터의 각 출력과 상수 1을 더하여 출력하는 제1 가산기;상기 제1 레지스터부의 제3 레지스터의 출력을 1비트 왼쪽으로 쉬프트시켜 출력하는 쉬프터;상기 제1 레지스터부의 제3 레지스터의 출력과 쉬프터의 출력 중 하나를 선택 신호에 따라 선택하여 출력하는 제1 먹스;상기 제1 먹스의 출력과 상기 제1 레지스터부의 제4 레지스터의 출력 그리고, 상수 1을 더하여 출력하는 제2 가산기;상기 제1, 제2 가산기의 덧셈 결과를 다시 더하여 출력하는 제3 가산기;상기 제3 가산기의 출력과 상기 제2 가산 연산부의 중간 출력을 더하여 출력하는 제4 가산기;제1, 제3, 제4 가산기의 출력 중 하나를 선택 신호에 따라 선택하여 출력하는 제2 먹스; 및 상기 제2 먹스의 출력을 일시 저장한 후 인에이블 신호에 따라 출력하는 버퍼로 구성되는 것을 특징으로 하는 인트라 예측 장치
7 7
제 1 항에 있어서, 상기 제3 데이터 처리부는 Intra_Luma_Plane 모드이면서 입력 데이터의 x 좌표가 이븐이거나 Intra_Chroma_Plane 모드이면서 입력 데이터가 Cb 신호이면, 초기 값을 설정하고 입력 데이터에 대해 인트라 예측을 수행하는 제1 플레인 연산부; 및Intra_Luma_Plane 모드이면서 입력 데이터의 x 좌표가 오드이거나 Intra_Chroma_Plane 모드이면서 입력 데이터가 Cr 신호이면, 초기 값을 설정하고 입력 데이터에 대해 인트라 예측을 수행하는 제2 플레인 연산부로 구성되는 것을 특징으로 하는 인트라 예측 장치
8 8
제 7 항에 있어서, 상기 제1 플레인 연산부는휘도 신호 초기값 또는 Cb 신호 초기값과 피드백되는 이전 값 중 하나를 선택하여 출력하는 제1 먹스;상기 제1 먹스의 출력을 지정된 비트만큼 왼쪽으로 쉬프트시켜 출력하는 제1 쉬프터;상기 제1 쉬프터의 출력과 피드백되는 이전 값 중 하나를 선택하여 출력하는 제2 먹스;다수개의 기 설정된 상수 2b, b, c, 0 중 하나를 선택하여 출력하는 제3 먹스;상기 제2,제3 먹스를 통해 출력되는 값을 더하여 출력하는 가산기; 및 상기 가산기의 출력을 왼쪽으로 쉬프트시켜 출력하는 제2 쉬프터로 구성되는 것을 특징으로 하는 인트라 예측 장치
9 9
제 8 항에 있어서, 상기 제2 플레인 연산부는Cr 신호 초기값과 피드백되는 이전 값 중 하나를 선택하여 출력하는 제1 먹스;상기 제1 먹스의 출력을 지정된 비트만큼 오른쪽으로 쉬프트시켜 출력하는 제1 쉬프터;상기 제1 쉬프터의 출력, 상기 제1 플레인 연산부의 가산기 출력, 그리고 피드백되는 이전 값 중 하나를 선택하여 출력하는 제2 먹스;다수개의 기 설정된 상수 2b, b, bCr, cCr, 0 중 하나를 선택하여 출력하는 제3 먹스;상기 제2,제3 먹스를 통해 출력되는 값을 더하여 출력하는 가산기; 및 상기 가산기의 출력을 오른쪽으로 쉬프트시켜 출력하는 제2 쉬프터로 구성되는 것을 특징으로 하는 인트라 예측 장치
10 10
제 1 항에 있어서, 상기 데이터 합성부는상기 제1 내지 제3 데이터 처리부에서 한 클럭에 두 개씩 예측되어 출력되는 값들을 Residual 값과 두 개씩 더해서 한 클럭에 두 개의 합성된 값을 출력하는 것을 특징으로 하는 인트라 예측 장치
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.