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스트림 데이터 처리 장치 및 방법

  • 기술번호 : KST2015036944
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 스트림(Stream) 데이터(Data) 처리시스템에 관한 것으로, SDR 모드 뿐만 아니라 스트림 데이터의 전송대역폭 향상을 위해 DDR (Double Data Rate) Mode를 구비하므로써, 1 Clock당 복수개의 서로 다른 위상의 데이터가 제어부의 제어에 의해 각각의 레지스터에 동시에 저장(Latch) 가능한 스트림 처리 시스템을 제공하며, SDR (Single 데이터 Rate) 모드인 경우에는 1 Clock당 1개의 데이터가 각각의 레지스터에 교번적으로 저장된다. 따라서 같은 Clock frequency에서 두배의 전송 대역폭을 구현 할 수 있으며, 또한 종래의 SDR(single data rate) mode를 동시에 지원함으로 호환성을 유지 할 수 있다.스트림, SDR, DDR, 레지스터
Int. CL G06F 13/00 (2006.01) G06F 15/163 (2006.01)
CPC G06F 9/3851(2013.01) G06F 9/3851(2013.01)
출원번호/일자 1020050033353 (2005.04.21)
출원인 엘지전자 주식회사
등록번호/일자 10-1128253-0000 (2012.03.12)
공개번호/일자 10-2006-0111056 (2006.10.26) 문서열기
공고번호/일자 (20120323) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2010.04.14)
심사청구항수 4

출원인

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번호 이름 국적 주소
1 엘지전자 주식회사 대한민국 서울특별시 영등포구

발명자

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번호 이름 국적 주소
1 박대헌 대한민국 경기도 오산시 경기대로**번길

대리인

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번호 이름 국적 주소
1 허용록 대한민국 서울특별시 강남구 역삼로 ***, *층 (역삼동, 현죽빌딩)(선영특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 엘지전자 주식회사 서울특별시 영등포구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 2005.04.21 수리 (Accepted) 1-1-2005-0209124-18
2 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2008.08.08 수리 (Accepted) 4-1-2008-5128387-76
3 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.04.27 수리 (Accepted) 4-1-2009-5080835-50
4 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.11.03 수리 (Accepted) 4-1-2009-0023850-26
5 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)		 2010.04.14 수리 (Accepted) 1-1-2010-0236117-94
6 선행기술조사의뢰서
Request for Prior Art Search		 2011.03.11 수리 (Accepted) 9-1-9999-9999999-89
7 선행기술조사보고서
Report of Prior Art Search		 2011.04.19 수리 (Accepted) 9-1-2011-0036231-43
8 의견제출통지서
Notification of reason for refusal		 2011.04.29 발송처리완료 (Completion of Transmission) 9-5-2011-0233488-73
9 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2011.05.31 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2011-0410481-60
10 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2011.05.31 수리 (Accepted) 1-1-2011-0410482-16
11 등록결정서
Decision to grant		 2011.12.21 발송처리완료 (Completion of Transmission) 9-5-2011-0755766-60
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.05.22 수리 (Accepted) 4-1-2015-5068349-97
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2020.05.28 수리 (Accepted) 4-1-2020-5118228-40
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
스트림 데이터를 출력하는 스트림 데이터 출력장치와, 상기 출력장치에서 출력된 스트림 데이터를 처리하는 연산장치를 포함하는 시스템에 있어서,상기 연산장치는 서로 다른 위상 Clock이 입력되는 제 1 레지스터부;상기 레지스터부의 출력값이 다중화부를 통해 제 2 레지스터부의 각각의 레지스터로 동시 또는 교번적으로 인가 되도록 제어하는 제어부; 및 상기 제 2 레지스터부의 저장값이 기록되는 메모리부를 포함하고,1Clock당 하나의 데이터를 전송하는 SDR모드인 경우에는, 입력Clock신호와 동기된 Clock신호에 따른 데이터가 상기 제 1 레지스터부에 저장/출력되며, Clock 사이클별로 다중화부를 통해 교번적으로 상기 제 2 레지스터부의 각각의 레지스터에 저장되는 것을 특징으로 하는 스트림 데이터 처리 장치
2 2
스트림 데이터를 출력하는 스트림 데이터 출력장치와, 상기 출력장치에서 출력된 스트림 데이터를 처리하는 연산장치를 포함하는 시스템에 있어서,상기 연산장치는 서로 다른 위상 Clock이 입력되는 제 1 레지스터부;상기 레지스터부의 출력값이 다중화부를 통해 제 2 레지스터부의 각각의 레지스터로 동시 또는 교번적으로 인가 되도록 제어하는 제어부; 및 상기 제 2 레지스터부의 저장값이 기록되는 메모리부를 포함하고,1Clock당 복수개의 데이터를 전송하는 DDR모드인 경우에는, 입력 Clock 신호와 동기 및 바뀐 Clock' 신호에 따른 데이터가 제 1 레지스터부의 각각의 레지스터에 저장/출력되며, Clock 사이클별로 동시에 다중화부를 통해 제 2 레지스터부의 각각의 레지스터에 저장되는 것을 특징으로 하는 스트림 데이터 처리 장치
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데이터를 처리하는데 있어서,Clock당 전송가능한 데이터에 따라 전송모드를 각각 설정하는 단계;현재 설정된 전송모드에 따라, 1Clock당 하나의 데이터를 전송하는 SDR모드인 경우에는, 제어부의 제어에 의거 입력Clock신호와 동기된 Clock신호에 따른 데이터가 제 1 레지스터부에 저장/출력되며, Clock 사이클별로 다중화부를 통해 교번적으로 제 2 레지스터부의 각각의 레지스터에 저장되는 단계; 및상기 저장된 데이터를 메모리 저장하는 단계를 포함하는 것을 특징으로 하는 스트림 데이터 처리 방법
4 4
데이터를 처리하는데 있어서,Clock당 전송가능한 데이터에 따라 전송모드를 각각 설정하는 단계;현재 설정된 전송모드에 따라, 1Clock당 복수개의 데이터를 전송하는 DDR모드인 경우에는, 제어부의 제어에 의거 입력 Clock 신호와 동기 및 바뀐 Clock' 신호에 따른 데이터가 제 1 레지스터부의 각각의 레지스터에 저장/출력되며, Clock 사이클별로 동시에 다중화부를 통해 제 2 레지스터부의 각각의 레지스터에 저장되는 단계; 및상기 저장된 데이터를 메모리 저장하는 단계를 포함하는 것을 특징으로 하는 스트림 데이터 처리 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.