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원본 시퀀스에 임시 비트(temporary bits)를 삽입하여 구조화 시퀀스(systematic sequence)를 생성하는 단계;상기 구조화 시퀀스를 제 1 인코더에 의해 인코딩하여 제 1 패리티 시퀀스를 생성하는 단계;상기 구조화 시퀀스를 인터리빙하는 단계;상기 인터리빙된 시퀀스를 제 2 인코더에 의해 인코딩하여 제 2 패리티 시퀀스를 생성하는 단계; 및상기 구조화 시퀀스, 상기 제 1 패리티 시퀀스, 및 상기 제 2 패리티 시퀀스에서 상기 임시 비트 삽입으로 인하여 추가된 비트에 해당하는 인덱스를 펑처링 인덱스로 설정하고, 상기 펑처링 인덱스를 제외한 인덱스를 출력하는 단계를 포함하는, 터보 코드 인코딩 방법
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제 1 항에 있어서,상기 구조화 시퀀스 생성 단계에서 상기 임시 비트는 상기 원본 시퀀스의 길이와 미리 설정된 기본 인터리버 세트 중 선택된 기본 인터리버의 길이와의 차이에 해당하는 길이의 원본 시퀀스에 삽입하는, 터보 코드 인코딩 방법
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제 2 항에 있어서,상기 미리 설정된 기본 인터리버 세트는 ARP의 변동 벡터 주기의 배수 길이를 가지도록 설정되며,상기 선택된 기본 인터리버는 상기 변동 벡터 주기의 배수 중 상기 원본 시퀀스의 길이 이상의 최소 배수 길이를 가지는, 터보 코드 인코딩 방법
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제 1 항 내지 제 3 항 중 어느 한 항에 있어서,상기 임시 비트 및 상기 펑처링 인덱스는 인코딩단과 디코딩단이 모두 알고 있는, 터보 코드 인코딩 방법
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원본 시퀀스에 임시 비트(temporary bits)를 삽입하여 구조화 시퀀스(systematic bits)를 생성하는 단계;상기 구조화 시퀀스를 제 1 인코더에 의해 인코딩하여 제 1 패리티 시퀀스를 생성하는 단계;상기 구조화 시퀀스를 인터리빙하는 단계;상기 인터리빙된 시퀀스를 제 2 인코더에 의해 인코딩하여 제 2 패리티 시퀀스를 생성하는 단계; 및상기 구조화 시퀀스, 상기 제 1 패리티 시퀀스, 및 상기 제 2 패리티 시퀀스에서 상기 임시 비트 삽입으로 인하여 추가된 비트에 해당하는 인덱스를 펑처링 인덱스로 설정하고, 상기 펑처링 인덱스를 제외한 인덱스를 출력하는 단계에 의해 생성된 송신측 신호를 채널을 통해 수신측에서 수신하여 디코딩하는 방법에 있어서,수신된 상기 수신 신호의 상기 구조화 시퀀스 대응 신호, 상기 제 1 패리티 시퀀스 대응 신호 및 상기 제 2 패리티 비트 대응 신호 각각의 상기 펑처링 인덱스에 보충 신호를 삽입하는 단계; 및상기 보충 신호가 각각 삽입된 상기 구조화 시퀀스 대응 신호, 상기 제 1 패리티 시퀀스 대응 신호 및 상기 제 2 패리티 비트 대응 신호를 디코딩하는 단계를 포함하는 것을 특징으로 하는 터보 코드 디코딩 방법
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제 5 항에 있어서,상기 보충 신호 삽입 단계에서, 상기 구조화 시퀀스 대응 신호의 상기 펑처링 인덱스에 삽입하는 상기 보충 신호는, 상기 임시 비트 및 상기 임시 비트의 변조 방법에 따라 부호가 결정되며 절대값이 1보다 큰 신호인, 터보 코드 디코딩 방법
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7
제 5 항 또는 제 6 항에 있어서,상기 보충 신호 삽입 단계에서, 상기 제 1 패리티 시퀀스 대응 신호 및 상기 제 2 패리티 비트 대응 신호의 상기 펑처링 인덱스에 삽입하는 상기 보충 신호는 0인, 터보 코드 디코딩 방법
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8
제 5 항에 있어서,상기 송신측의 구조화 시퀀스 생성 단계에서 상기 임시 비트는 상기 원본 시퀀스의 길이와 미리 설정된 기본 인터리버 세트 중 선택된 기본 인터리버의 길이와의 차이에 해당하는 길이의 원본 시퀀스에 삽입하며,상기 수신측의 디코딩 단계는 상기 선택된 기본 인터리버와 동일한 길이의 인터리버에 의한 인터리빙 단계를 포함하는, 터보 코드 디코딩 방법
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9
제 8 항에 있어서,상기 미리 설정된 기본 인터리버 세트는 ARP의 변동 벡터 주기의 배수 길이를 가지도록 설정되며,상기 선택된 기본 인터리버는 상기 변동 벡터 주기의 배수 중 상기 원본 시퀀스의 길이 이상의 최소 배수 길이를 가지는, 터보 코드 디코딩 방법
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제 8 항에 있어서,상기 미리 설정된 기본 인터리버 세트는 병렬 디코딩에 이용되는 윈도우 개수의 배수 길이를 가지도록 설정되며,상기 선택된 기본 인터리버 길이는 상기 윈도우 개수의 배수 중 상기 원본 시퀀스의 길이 이상의 최소 배수 길이를 가지는, 터보 코드 디코딩 방법
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원본 시퀀스에 임시 비트(temporary bits)를 삽입하여 구조화 시퀀스(systematic sequence)를 생성하는 임시비트삽입부;상기 구조화 시퀀스를 인코딩하여 제 1 패리티 시퀀스를 생성하는 제 1 인코더;상기 구조화 시퀀스를 인터리빙하는 인터리버;상기 인터리빙된 시퀀스를 인코딩하여 제 2 패리티 시퀀스를 생성하는 제 2 인코더; 및상기 구조화 시퀀스, 상기 제 1 패리티 시퀀스, 및 상기 제 2 패리티 시퀀스에서 상기 임시 비트 삽입으로 인하여 추가된 비트에 해당하는 인덱스를 펑처링 인덱스로 설정하고, 상기 펑처링 인덱스를 제외한 인덱스를 출력하도록 하는 임시비트제거부를 포함하는, 터보 코드 인코더
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원본 시퀀스에 임시 비트(temporary bits)를 삽입하여 구조화 시퀀스(systematic sequence)를 생성하는 임시비트삽입부;상기 구조화 시퀀스를 인코딩하여 제 1 패리티 시퀀스를 생성하는 제 1 인코더;상기 구조화 시퀀스를 인터리빙하는 인터리버;상기 인터리빙된 시퀀스를 인코딩하여 제 2 패리티 시퀀스를 생성하는 제 2 인코더; 및상기 구조화 시퀀스, 상기 제 1 패리티 시퀀스, 및 상기 제 2 패리티 시퀀스에서 상기 임시 비트 삽입으로 인하여 추가된 비트에 해당하는 인덱스를 펑처링 인덱스로 설정하고, 상기 펑처링 인덱스를 제외한 인덱스를 출력하도록 하는 임시비트제거부를 포함하는 터보 코드 인코더에 의해 생성된 송신측 신호를 채널을 통해 수신측에서 수신하여 디코딩하는 터보 코드 디코더에 있어서,수신된 상기 수신 신호의 상기 구조화 시퀀스 대응 신호, 상기 제 1 패리티 시퀀스 대응 신호 및 상기 제 2 패리티 비트 대응 신호 각각의 상기 펑처링 인덱스에 보충 신호를 삽입하는 보충신호삽입부; 및상기 보충 신호가 각각 삽입된 상기 구조화 시퀀스 대응 신호, 상기 제 1 패리티 시퀀스 대응 신호 및 상기 제 2 패리티 비트 대응 신호를 디코딩하는 디코더를 포함하는 것을 특징으로 하는 터보 코드 디코더
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