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매립형 인쇄회로기판 및 그 제조방법

  • 기술번호 : KST2015061035
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요약 본 발명은 매립형 인쇄회로기판의 제조공정 및 그 결과물에 관한 것으로, 도금적합성 제1레진층을 포함하는 제1금속층상에 전자소자칩을 실장하는 1단계와 상기 전자소자칩상에 도금적합성 제2레진층을 포함하는 절연적층군으로 매립하는 2단계, 상기 전자소자칩의 연결단자를 외부로 노출시키는 3단계, 상기 단자와 직접연결되는 회로패턴을 형성하는 4단계를 포함하는 공정을 제공하여, 전자소자칩의 단자가 외부로 노출되며, 상기 단자와 직접연결되는 회로패턴을 구비하는 인쇄회로기판을 제공하는 것을 특징으로 한다.본 발명에 따르면, 내장 부품과 인쇄회로기판을 직접 연결하는 매립형 인쇄회로기판의 제조방법과 구조를 구현하여, 종래의 비아와 랜드(Land) 또는 메탈 범프와 랜드, 혹은 솔더와 솔더 패드, 도전페이스트와 패드 등의 부수적인 구조물을 사용하지 않으면서 전기적으로 연결가능하도록 하여, 극미세 피치의 입출력연결구조(I/O interconnection)를 구현하고, 사용되는 전자 부품의 범용성을 확보할 수 있도록 하며, 특히 인쇄회로기판의 설계의 자유도를 극대화할 수 있는 효과가 있다.
Int. CL H05K 3/30 (2006.01) H05K 1/18 (2006.01)
CPC H05K 3/4697(2013.01) H05K 3/4697(2013.01) H05K 3/4697(2013.01) H05K 3/4697(2013.01)
출원번호/일자 1020100044023 (2010.05.11)
출원인 엘지이노텍 주식회사
등록번호/일자 10-1115476-0000 (2012.02.06)
공개번호/일자 10-2011-0124565 (2011.11.17) 문서열기
공고번호/일자 (20120227) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2010.05.11)
심사청구항수 15

출원인

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번호 이름 국적 주소
1 엘지이노텍 주식회사 대한민국 서울특별시 강서구

발명자

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번호 이름 국적 주소
1 이민석 대한민국 서울특별시 중구

대리인

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번호 이름 국적 주소
1 김희곤 대한민국 대전시 유성구 문지로 ***-*(문지동) *동(웰쳐국제특허법률사무소)
2 김인한 대한민국 서울특별시 서초구 사임당로 **, **층 (서초동, 신영빌딩)(특허법인세원)
3 박용순 대한민국 서울특별시 송파구 법원로*길 **, **층 D-****호(문정동)(주심국제특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 엘지이노텍 주식회사 서울특별시 중구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2010.05.11 수리 (Accepted) 1-1-2010-0302626-04
2 의견제출통지서
Notification of reason for refusal
2011.06.13 발송처리완료 (Completion of Transmission) 9-5-2011-0321238-63
3 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2011.08.12 수리 (Accepted) 1-1-2011-0625575-39
4 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2011.08.12 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2011-0625573-48
5 등록결정서
Decision to grant
2012.01.30 발송처리완료 (Completion of Transmission) 9-5-2012-0056356-37
6 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.10.27 수리 (Accepted) 4-1-2014-0093826-77
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2017.03.08 수리 (Accepted) 4-1-2017-5035901-08
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2018.07.18 수리 (Accepted) 4-1-2018-5136723-03
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.01.15 수리 (Accepted) 4-1-2020-5011221-01
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
제1금속층 상에 도금적합성 제1레진층을 패터닝하여 전자소자칩의 실장영역을 형성하는 1단계;상기 전자소자칩의 실장영역에 비전도성 접착물질을 이용하여 능동소자 또는 수동소자를 실장하는 2단계;상기 전자소자칩상에 절연적층군으로 매립하는 3단계;상기 제1금속층을 제거하여 노출된 상기 접착물질 및 상기 도전적합성 제1레진층에 대해 에칭을 수행하여 상기 전자소자칩의 연결단자를 상기 절연적층군으로부터 노출시키는 4단계;상기 단자와 직접연결되는 회로패턴을 형성하는 5단계;를 포함하는 매립형 인쇄회로기판의 제조방법
2 2
삭제
3 3
청구항 1에 있어서,상기 1단계는,절연층의 양면에 동박을 구비한 캐리어 보드상에 상기 제1금속층을 적층한 상태로 공정이 수행되는 매립형 인쇄회로기판의 제조방법
4 4
청구항 1에 있어서,상기 도금적합성 제1레진층 및 제2레진층은,에폭시, 페놀수지, 프리프레그, 폴리이미드 필름, ABF(Ajinomoto Build up Film) 중 어느 하나로 형성되는 매립형 인쇄회로기판의 제조방법
5 5
청구항 1 에 있어서,상기 3단계는,상기 전자소자칩의 주위 및 상부를 매립하는 절연층과 상기 절연층의 상부에 적층되는 도금적합성 제2레진층 및 제2금속층을 적층하는 단계;인 매립형 전자소자칩의 제조방법
6 6
청구항 5에 있어서,상기 3단계는,상기 전자소자칩의 주변부를 둘러싸는 구조의 적어도 1 이상의 제1절연적층군과,상기 절연적층군의 상부를 덮는 제2절연적층군 및 도금적합성 제2레진층을 어라인하고,상부에 제2금속층을 적층 하여 가열 가압하여 형성하는 단계로 이루어지는 매립형 인쇄회로기판의 제조방법
7 7
청구항 5에 있어서,상기 3단계는,상기 전자소자칩의 주변부를 둘러싸는 구조의 적어도 1 이상의 제1절연적층군과,상기 제1절연적층군의 상부를 덮는 제2절연적층군 및 도금적합성 제2레진층 및 제2금속층을 어라인하되,상기 제1절연적층군과 제2절연적층군 사이에 회로패턴을 포함하는 제3절연층군을 배열하여 적층 하는 단계로 형성되는 매립형 인쇄회로기판의 제조방법
8 8
청구항 1에 있어서,상기 에칭은 습식(wet) 또는 건식(dry)에칭인 매립형 인쇄회로기판의 제조방법
9 9
청구항 5에 있어서,상기 5단계는,c 1) 상기 제1 레진층 상에 제3금속층을 형성하는 단계;c 2) 상기 제3금속층을 패터닝하여 상기 전자소자칩의 단자와 직접 연결되는 외부회로패턴을 형성하는 단계;를 포함하는 매립형 인쇄회로기판의 제조방법
10 10
청구항 9에 있어서,상기 c 1)단계는,상기 외부회로패턴 간에 또는 상기 매립형 인쇄회로기판의 내부에 포함되는 내부회로패턴과 상기 외부회로패턴간을 전기적으로 연결하는 도통홀을 형성하는 단계를 더 포함하는 매립형 인쇄회로기판의 제조방법
11 11
청구항 8에 있어서,상기 5단계는,d 1) 매립형 인쇄회로기판의 양면에 드라이필름레지스트를 패터닝하는 단계;d 2) 도금을 통해 상기 전자소자칩과 연결되는 회로패턴을 적어도 1 이상 형성되는 외부회로패턴을 형성하는 단계;d 3) 상기 드라이필름 레지스트를 제거하는 단계;를 포함하는 매립형 인쇄회로기판의 제조방법
12 12
절연층에 매립되며, 상기 절연층으로부터 노출되는 단자를 갖는 전자소자칩;상기 절연층 상에 형성되며, 상기 단자와 직접 연결되는 적어도 1 이상의 외부회로패턴;상기 외부회로패턴과 상기 전자소자칩의 실장영역을 제외한 절연층의 사이에 형성되는 도금적합성 제1레진층; 상기 전자소자칩의 실장영역의 절연층과 상기 외부회로패턴의 사이에 형성되는 비전도성 접착물질; 및상기 단자가 형성되는 이면의 절연층과 외부회로패턴 사이에 형성되는 도금적합성 제2레진층을 포함하는 매립형 인쇄회로기판
13 13
삭제
14 14
청구항 12에 있어서,상기 도금적합성 제1레진층 및 제2레진층은 에폭시, 페놀수지, 프리프레그, 폴리이미드 필름, ABF(Ajinomoto Build up Film) 중 어느 하나를 이용하여 형성되는 매립형 인쇄회로기판
15 15
청구항 14에 있어서,상기 도금적합성 제2레진층과 상기 절연층은 동일한 재료로 형성되는 매립형 인쇄회로기판
16 16
청구항 14 또는 청구항 15에 있어서,상기 절연층의 내부에는,상기 외부회로패턴과 전기적으로 연결되는 내부회로패턴을 포함하는 제2절연적층군을 적어도 1 이상 구비하는 매립형 인쇄회로기판
17 17
삭제
18 18
청구항 15에 있어서,상기 전자소자칩은 수동소자 또는 능동소자인 매립형 인쇄회로기판
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.