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외부에 칩 연결 단자를 구비한 전자 소자;상기 전자 소자를 매립하며, 제 1면을 통해 상기 전자 소자의 칩 연결 단자를 노출하는 제 1 절연층;상기 제 1 절연층 내에 매립되며, 상기 제 1 절연층의 제 1면을 통해 노출되는 제 1 회로 패턴;상기 제 1 절연층의 제 1면과 접촉하며, 상기 노출된 칩 연결 단자 및 제 1 회로 패턴을 덮는 제 2 절연층;상기 제 2 절연층 중 상기 제 1 절연층의 제 1면과 접촉하는 면의 반대 면에 형성되는 제 2 회로 패턴; 및상기 제 2 절연층 내에 형성되며, 상기 제 2 회로 패턴과 상기 제 1 절연층 내에 매립된 제 1 회로 패턴을 전기적으로 연결하는 연결부를 포함하고,상기 제 1 회로 패턴의 노출면은 상기 칩 연결 단자의 노출면 및 상기 제 1 절연층의 제 1면과 동일한 평면상에 놓이는 인쇄회로기판
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제 1항에 있어서,상기 연결부는, 구리, 알루미늄 및 은 중 적어도 하나의 금속성 물질을 포함하는 금속 페이스트로 형성되는 인쇄회로기판
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제 1항에 있어서,상기 전자 소자는 접착 페이스트에 의해 상기 제 1 절연층 내에 부착되며,상기 연결부는 상기 칩 연결 단자의 상부 면을 덮는 구조로 상기 칩 연결단자와 직접 접촉하는 인쇄회로기판
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제 1항에 있어서,상기 전자 소자는 수동 소자 및 능동 소자 중 적어도 하나를 포함하는 인쇄회로기판
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캐리어 보드 위에 내층 회로 패턴을 형성하는 단계;상기 형성된 내층 회로 패턴을 마스크로 하여 도포된 접착 페이스트 위에 칩 연결 단자가 구비된 전자 소자를 부착하는 단계;상기 캐리어 보드 위에 상기 내층 회로 패턴 및 전자 소자를 매립하는 제 1 절연층을 형성하는 단계;상기 캐리어 보드를 분리하여, 상기 제 1 절연층의 제 1면을 통해 상기 내층 회로 패턴 및 전자 소자의 칩 연결 단자를 외부로 노출시키는 단계;상기 노출된 내층 회로 패턴을 식각하여, 상기 제 1 절연층 내에 매립된 제 1 회로 패턴을 형성하는 단계;상기 제 1 절연층 위에 상기 노출된 내층 회로 패턴 및 칩 연결 단자를 덮는 제 2 절연층을 형성하는 단계;상기 제 2 절연층 내에 상기 칩 연결 단자를 노출하는 비아홀을 형성하고, 상기 형성된 비아홀 내부에 금속 페이스트를 인쇄하는 단계; 및상기 제 2 절연층 내에 형성된 금속 페이스트 위에 상기 칩 연결 단자와 전기적으로 연결되는 제 2 회로패턴을 형성하는 단계를 포함하며,상기 제 1 회로 패턴 및 칩 연결 단자의 노출 면은 상기 제 1 절연층의 제 1면과 동일한 평면상에 놓이는 인쇄회로기판의 제조 방법
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제 7항에 있어서,상기 인쇄된 금속 페이스트에 의해 형성되는 연결부는 상기 노출된 칩 연결 단자와 직접적으로 연결되는 인쇄회로기판의 제조 방법
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제 7항에 있어서,상기 금속 페이스트를 인쇄하는 단계는구리, 알루미늄 및 은 중 적어도 하나의 금속성 물질을 도포하는 단계를 포함하는 인쇄회로기판의 제조 방법
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제 7항에 있어서,상기 캐리어 보드가 제거되면, 상기 제 1 절연층을 뒤집어 상기 노출된 제 1 회로 패턴 및 칩 연결 단자가 상부를 향하도록 하는 단계를 더 포함하는 인쇄회로기판의 제조 방법
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제 7항에 있어서,상기 제 2 절연층을 형성하는 단계는상기 전자 소자의 주변부를 둘러싸는 구조의 적어도 1 이상의 제 1 절연 적층군과, 상기 제 1 절연 적층군의 상부를 덮는 제 2 절연 적층군을 어라인하는 단계와,상기 어라인된 제 1 및 2 절연 적층군 위에 외각 절연층을 적층하는 단계와,상기 제 1 및 2 절연 적층군과 외각 절연층을 가열 가압하는 단계를 포함하는 인쇄회로기판의 제조 방법
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제 7항에 있어서,상기 제 2 절연층의 상면에 상기 제 2 회로 패턴의 상면을 노출하는 보호층을 형성하는 단계가 더 포함되는 인쇄회로기판의 제조 방법
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제 7항에 있어서,상기 전자 소자는 능동 소자 및 수동 소자 중 적어도 하나를 포함하는 인쇄회로기판의 제조 방법
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