맞춤기술찾기

이전대상기술

적층형 반도체 패키지 및 이를 이용한 이동 단말기

  • 기술번호 : KST2015067181
  • 담당센터 :
  • 전화번호 :
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 방열성능을 개선한 적층형 반도체 패키지 및 이를 이용한 이동 단말기에 관한 것으로서, 복수의 반도체 칩 사이에 적층되고, 복수의 반도체 칩으로부터 흡수한 열을 외부로 방열하는 방열수단을 포함하며, 복수의 반도체 칩으로부터 흡수한 열이 방열수단의 표면을 통해 외부로 방열되어 적층형 반도체 패키지 및 이를 이용한 이동 단말기의 내구성을 향상시킬 수 있다.
Int. CL H01L 23/367 (2006.01) H01L 23/12 (2006.01)
CPC H01L 23/3735(2013.01) H01L 23/3735(2013.01) H01L 23/3735(2013.01) H01L 23/3735(2013.01)
출원번호/일자 1020120007397 (2012.01.25)
출원인 엘지전자 주식회사
등록번호/일자
공개번호/일자 10-2013-0086499 (2013.08.02) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 12

출원인

번호, 이름, 국적, 주소의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 인명정보 - 출원인 표입니다.
번호 이름 국적 주소
1 엘지전자 주식회사 대한민국 서울특별시 영등포구

발명자

번호, 이름, 국적, 주소의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 인명정보 - 발명자 표입니다.
번호 이름 국적 주소
1 정병권 대한민국 서울 금천구

대리인

번호, 이름, 국적, 주소의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 인명정보 - 대리인 표입니다.
번호 이름 국적 주소
1 김용인 대한민국 서울특별시 송파구 올림픽로 ** (잠실현대빌딩 *층)(특허법인(유한)케이비케이)
2 방해철 대한민국 서울특별시 송파구 올림픽로 ** (잠실현대빌딩 *층)(특허법인(유한)케이비케이)

최종권리자

번호, 이름, 국적, 주소의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 인명정보 - 최종권리자 표입니다.
번호 이름 국적 주소
최종권리자 정보가 없습니다
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원] 특허출원서
[Patent Application] Patent Application
2012.01.25 수리 (Accepted) 1-1-2012-0061651-73
2 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)
2014.12.01 수리 (Accepted) 1-1-2014-1163420-06
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.05.22 수리 (Accepted) 4-1-2015-5068349-97
4 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.05.28 수리 (Accepted) 4-1-2020-5118228-40
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
회로기판;상기 회로기판의 상측에 적층되는 제 1반도체 칩;상기 제 1반도체칩의 상측에 적층되는 제 2반도체 칩; 및상기 제 1반도체 칩와 상기 제 2반도체 칩의 사이에 적층되고, 상기 제 1반도체 칩 및 상기 2반도체 칩에서 발생되는 열을 외부로 방열하는 방열수단;을 포함하는 적층형 반도체 패키지
2 2
제 1항에 있어서,상기 방열수단은,연성 회로기판인 것을 특징으로 하는 적층형 반도체 패키지
3 3
제 1항에 있어서,상기 방열수단은 그 양단부가 제 1반도체 칩 및 제 2반도체 칩의 측면방향으로 연장되어 노출되는 것을 특징으로 하는 적층형 반도체 패키지
4 4
제 3항에 있어서,상기 방열수단은 복수가 서로 상하로 적층되고, 상기 복수의 방열수단은 그 양단부가 노출되는 방향이 서로 엇갈리게 적층되는 것을 특징으로 하는 적층형 반도체 패키지
5 5
제 1항에 있어서,상기 방열수단은,상기 제 1반도체 칩 및 상기 제 2반도체 칩으로부터 흡수된 열을 외부로 방열하고, 전기적으로 전열된 방열부, 상기 방열부의 하면에 마련되는 제 1접속패드, 상기 방열부의 상면에 마련되는 제 2접속패드, 그리고 상기 방열부를 관통하여 상기 제 1접속패드 및 상기 제 2접속패드를 전기적으로 연결하는 도전부를 포함하는 것을 특징으로 하는 적층형 반도체 패키지
6 6
제 5항에 있어서,상기 제 1반도체 칩과 상기 제 1접속패드, 그리고 상기 제 2접속패드와 상기 제 2반도체는 솔더볼을 통해 각각 접속되는 것을 특징으로 하는 적층형 반도체 패키지
7 7
제 1항에 있어서,상기 방열수단에 흡수된 열을 상기 회로기판으로 유도하는 보조 방열수단을 더 포함하는 것을 특징으로 하는 적층형 반도체 패키지
8 8
제 7항에 있어서,상기 보조 방열수단은,상기 방열수단과 연결되고, 상기 회로기판에 고정되는 쉴드캔을 포함하는 것을 특징으로 하는 적층형 반도체 패키지
9 9
제 8항에 있어서,상기 보조 방열수단은,상기 쉴드캔을 가압하여 고정시키고, 하단부가 상기 회로기판에 고정되는 쉴드캔 고정용 클립을 더 포함하는 것을 특징으로 하는 적층형 반도체 패키지
10 10
케이스;상기 케이스의 내부에 장착되는 회로기판;상기 회로기판의 상측에 적층되는 어플리케이션 프로세서상기 어플리케이션 프로세서의 상측에 적층되는 메모리; 및상기 어플리케이션 프로세서와 상기 메모리 사이에 적층되고, 상기 어플리케이션 프로세서 및 상기 메모리로부터 발생된 열을 외부로 방열하는 하나 이상의 연성회로기판;을 포함하는 이동 단말기
11 11
제 10항에 있어서,상기 연성회로기판과 연결되고, 상기 연성회로기판에 흡수된 열을 상기 회로기판으로 유도하는 쉴드캔을 더 포함하는 것을 특징으로 하는 이동 단말기
12 12
제 11항에 있어서,상기 쉴드캔을 가압하여 고정시키고, 하단부가 상기 회로기판에 고정되는 쉴드캔 고정용 클립을 더 포함하는 것을 특징으로 하는 이동 단말기
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.