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노멀리 오프 특성을 갖는 반도체 소자 및 그 제조 방법

  • 기술번호 : KST2015068281
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 명세서는,기판상에 차례로 적층된 제 1 버퍼층, 제 2 버퍼층, 장벽층, 게이트 전극, 소스 전극 및 드레인 전극을 구비하는 반도체 소자에 있어서, 상기 제 1 버퍼층 상에 전자 친화도가 100이상인 물질을 주입하여 노멀리-오프(Normally-Off) 유도층을 형성함으로써 내전압특성의 향상, 표면의 누설전류의 감소, 용이한 구동전압의 제어등 개선된 반도체 소자 및 그 제조방법을 제공한다.이를 위하여, 일 실시예에 따른 반도체 소자는, 기판; 상기 기판 상에 형성되고, 노멀리-오프(Normally-Off) 유도층을 포함하는 제 1 버퍼층; 상기 제 1 버퍼층 상에 형성되고, 2DEG를 포함하는 제 2 버퍼층; 상기 제 2 버퍼층 상에 형성되는 장벽층; 및 상기 장벽층 상에 형성되는 게이트 전극을 포함하되, 상기 노멀리-오프(Normally-Off) 유도층은 상기 제 2 버퍼층과 접촉하는 것일 수 있다.
Int. CL H01L 29/778 (2006.01) H01L 21/335 (2006.01)
CPC H01L 29/778(2013.01) H01L 29/778(2013.01) H01L 29/778(2013.01)
출원번호/일자 1020120061735 (2012.06.08)
출원인 엘지전자 주식회사
등록번호/일자
공개번호/일자 10-2013-0137986 (2013.12.18) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 20

출원인

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번호 이름 국적 주소
1 엘지전자 주식회사 대한민국 서울특별시 영등포구

발명자

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번호 이름 국적 주소
1 음영신 대한민국 서울특별시 서초구
2 장태훈 대한민국 서울특별시 서초구

대리인

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번호 이름 국적 주소
1 박장원 대한민국 서울특별시 강남구 강남대로 ***, *층~*층 (논현동, 비너스빌딩)(박장원특허법률사무소)

최종권리자

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번호 이름 국적 주소
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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2012.06.08 수리 (Accepted) 1-1-2012-0458992-26
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.05.22 수리 (Accepted) 4-1-2015-5068349-97
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.05.28 수리 (Accepted) 4-1-2020-5118228-40
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번호 청구항
1 1
기판;상기 기판 상에 형성되고, 노멀리-오프(Normally-Off) 유도층을 포함하는 제 1 버퍼층;상기 제 1 버퍼층 상에 형성되고, 2DEG를 포함하는 제 2 버퍼층;상기 제 2 버퍼층 상에 형성되는 장벽층; 및상기 장벽층 상에 형성되는 게이트 전극을 포함하되,상기 노멀리-오프(Normally-Off) 유도층은 상기 제 2 버퍼층과 접촉하는 것인 반도체 소자
2 2
제1항에 있어서, 상기 기판은,절연성 기판, GaN 기판, SiC 기판 및 Si 기판 중 적어도 하나인 것인 반도체 소자
3 3
제1항에 있어서, 상기 노멀리-오프(Normally-Off) 유도층은,전자 친화도가 100이상인 물질을 포함하는 것인 반도체 소자
4 4
제3항에 있어서, 상기 전자 친화도가 100이상인 물질은,F, Cl 및 Br 중 적어도 하나인 것인 반도체 소자
5 5
제1항에 있어서, 상기 제 1 버퍼층 및 상기 제 2 버퍼층은,GaN으로 이루어지고,상기 장벽층은,AlxGa1-xN으로 이루어진 것인 반도체 소자
6 6
제5항에 있어서, 상기 장벽층은,Al의 조성이 5 ~ 100%인 AlxGa1-xN으로 이루어진 것인 반도체 소자
7 7
제1항에 있어서, 상기 노멀리-오프(Normally-Off) 유도층은,상기 제 1 버퍼층의 일부 영역에 전자 친화도가 100이상인 물질을 주입하여 형성되는 것인 반도체 소자
8 8
제7항에 있어서, 상기 노멀리-오프(Normally-Off) 유도층은,트렌치(trench) 형태, 브이-그루브(V-groove) 형태 및 반원 형태 중 적어도 하나의 형태를 구비하는 것인 반도체 소자
9 9
제1항에 있어서, 상기 노멀리-오프(Normally-Off) 유도층은,상기 제 2 버퍼층의 하부 전면과 접촉하는 것인 반도체 소자
10 10
제1항에 있어서, 상기 노멀리-오프(Normally-Off) 유도층의 너비는,0
11 11
제1항에 있어서, 상기 제 1 버퍼층의 두께는,1um ~ 10um이고,상기 제 2 버퍼층의 두께는,1nm ~ 1000nm이고,상기 장벽층의 두께는,1nm ~ 100nm인 것인 반도체 소자
12 12
제1항에 있어서,상기 장벽층 상의 일부 영역에 형성되는 캡 층(cap layer)을 더 포함하는 것을 특징으로 하는 반도체 소자
13 13
제12항에 있어서, 상기 캡 층(cap layer)은,GaN 및 AIN 중 적어도 하나로 이루어지는 것인 반도체 소자
14 14
제13항에 있어서, 상기 캡 층(cap layer) 또는 상기 장벽층의 일부 영역 상에 형성되는 오믹 접합 메탈층을 더 포함하는 것을 특징으로 하는 반도체 소자
15 15
기판 상에 제 1 버퍼층을 형성시키는 단계;상기 제 1 버퍼층에 전자 친화도가 100이상인 물질을 주입시켜 노멀리-오프(Normally-Off) 유도층을 형성시키는 단계;상기 제 1 버퍼층 상에 제 2 버퍼층을 형성시키는 단계;상기 제 2 버퍼층 상에 장벽층을 형성시키는 단계; 및상기 장벽층 상에 게이트 전극을 형성시키는 단계를 포함하되,상기 노멀리-오프(Normally-Off) 유도층은 상기 제 2 버퍼층과 접촉하는 것인 반도체 소자의 제조방법
16 16
제15항에 있어서, 상기 전자 친화도가 100이상인 물질은,상기 제 1 버퍼층에 임플란테이션(Implantation) 및 플라즈마(Plasma) 중 적어도 하나를 근거로 주입되는 것인 반도체 소자의 제조방법
17 17
제15항에 있어서, 상기 전자 친화도가 100이상인 물질은,F, Cl 및 Br 중 적어도 하나인 것인 반도체 소자의 제조방법
18 18
제15항에 있어서, 상기 기판은,절연성 기판, GaN 기판, SiC 기판 및 Si 기판 중 적어도 하나로 이루어지고,상기 제 1 버퍼층 및 상기 제 2 버퍼층은,GaN으로 이루어지고,상기 장벽층은,AlxGa1-xN으로 이루어진 것인 반도체 소자의 제조방법
19 19
제15항에 있어서, 상기 노멀리-오프(Normally-Off) 유도층은,상기 제 1 버퍼층의 일부 영역에 전자 친화도가 100이상인 물질을 주입하여 형성되는 것인 반도체 소자의 제조방법
20 20
제19항에 있어서, 상기 노멀리-오프(Normally-Off) 유도층은,트렌치(trench) 형태, 브이-그루브(V-groove) 형태 및 반원 형태 중 적어도 하나의 형태를 구비하는 것인 반도체 소자의 제조방법
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.