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질화물 반도체 소자 및 이의 제조 방법

  • 기술번호 : KST2015068583
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요약 질화물 반도체 소자 및 이의 제조 방법이 개시된다. 본 발명의 실시 예들은 이종접합 구조의 질화물 반도체 소자를 제조함에 있어서, undoped, carbon doped, Fe doped GaN을 선택적으로 성장하거나, GaN 위에 패턴을 만든 후 AlGaN 장벽층을 재성장함으로써, 수직형 소자를 구현할 수 있고, 칩(Chip)의 면적을 효율적으로 사용할 수 있다. 본 발명의 실시 예들은, 전력 소자에서 중요한 특성인 On 저항을 낮출 수 있다. 또, 본 발명의 실시 예들은, 드레인 전극을 n형 AlGaN의 바닥에 형성시켜 수직형 구조를 구현함으로써, 열 방출이 쉬어 패키지가 수평형 소자에 비해서 간단한 장점이 있다.
Int. CL H01L 29/778 (2006.01) H01L 21/335 (2006.01)
CPC H01L 29/778(2013.01) H01L 29/778(2013.01) H01L 29/778(2013.01) H01L 29/778(2013.01)
출원번호/일자 1020120081423 (2012.07.25)
출원인 엘지전자 주식회사
등록번호/일자
공개번호/일자 10-2014-0013618 (2014.02.05) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 21

출원인

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번호 이름 국적 주소
1 엘지전자 주식회사 대한민국 서울특별시 영등포구

발명자

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번호 이름 국적 주소
1 황의진 대한민국 서울특별시 서초구
2 장태훈 대한민국 서울특별시 서초구

대리인

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번호 이름 국적 주소
1 박장원 대한민국 서울특별시 강남구 강남대로 ***, *층~*층 (논현동, 비너스빌딩)(박장원특허법률사무소)

최종권리자

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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2012.07.25 수리 (Accepted) 1-1-2012-0596346-55
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.05.22 수리 (Accepted) 4-1-2015-5068349-97
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.05.28 수리 (Accepted) 4-1-2020-5118228-40
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번호 청구항
1 1
기판 위에 형성되는 제1 AlGaN층;2차원 전자 가스 채널을 구비하고, 상기 제1 AlGaN층 위에 형성되는 GaN층;상기 GaN층 위에 형성되는 제2 AlGaN층;상기 제1 AlGaN층 하부에 형성되고, 메탈로 이루어진 드레인 전극; 및상기 제2 AlGaN층 위에 각각 형성되는 게이트 전극 및 소스 전극;을 포함하고,상기 2차원 전자 가스 채널은,상기 GaN층과 상기 제2 AlGaN층의 접촉면을 따라 수평 방향 및 수직 방향으로 형성되는 것을 특징으로 하는 질화물 반도체 소자
2 2
제1 항에 있어서,상기 제1 AlGaN층의 일부와 상기 제2 AlGaN층의 일부가 서로 접촉하도록 상기 GaN층에는 리세스 영역이 형성되는 것을 특징으로 하는 질화물 반도체 소자
3 3
기판 위에 형성되는 제1 AlGaN층;상기 제1 AlGaN층 위에 형성되는 GaN층;상기 GaN층의 식각된 리세스 영역 및 상기 GaN층 위에 형성되는 제2 AlGaN층;상기 제1 AlGaN층 하부에 형성되고, 메탈로 이루어진 드레인 전극; 및상기 제2 AlGaN층 위에 각각 형성되는 게이트 전극 및 소스 전극;을 포함하는 질화물 반도체 소자
4 4
제1 항 내지 제3 항 중 어느 한 항에 있어서,상기 제1 AlGaN층은,n형 AlxGa1-xN층이고, 0≤x≤1,인 것을 특징으로 하는 질화물 반도체 소자
5 5
제1 항 내지 제3 항 중 어느 한 항에 있어서,상기 GaN층은,도핑되지 아니한 GaN층이거나, 또는 카본, 아이언, 마그네슘, 및 이들의 조합 중 하나로 도핑된 고저항 GaN층인 것을 특징으로 하는 질화물 반도체 소자
6 6
제5 항에 있어서,상기 GaN층의 두께는, 0
7 7
제5 항에 있어서,상기 GaN층에 도핑된 불순물 농도는, 1e17/cm3 내지 1e20/cm3인 것을 특징으로 하는 질화물 반도체 소자
8 8
제2 항 또는 제3 항에 있어서,상기 GaN층에는 일정 폭을 가진 줄무늬 패턴이 형성되고,상기 줄무늬 패턴 부분이 식각되어 상기 리세스 영역이 형성되는 것을 특징으로 하는 질화물 반도체 소자
9 9
제8 항에 있어서,상기 줄무늬 패턴의 폭은, 0
10 10
제3 항에 있어서,상기 제2 AlGaN층은,상기 제1 AlGaN층의 일부와 맞닿도록 형성된 것을 특징으로 하는 질화물 반도체 소자
11 11
제1 항 내지 제3 항 중 어느 한 항에 있어서,상기 GaN층은,상기 제1 AlGaN층 위에 선택적 성장에 의해 형성되는 것을 특징으로 하는 질화물 반도체 소자
12 12
제1 항 내지 제3 항 중 어느 한 항에 있어서,상기 제2 AlGaN층의 두께는, 상기 GaN층보다 두껍게 형성되고, 0
13 13
제1 항 내지 제3 항 중 어느 한 항에 있어서,상기 게이트 전극은,상기 제2 AlGaN층 위에 형성되는 게이트 절연막층;을 포함하는 것을 특징으로 하는 질화물 반도체 소자
14 14
제1 항 내지 제3 항 중 어느 한 항에 있어서,상기 제2 AlGaN층 위에 형성되는 p형 GaN층;을 더 포함하고,상기 게이트 전극은,상기 p형 GaN층 위에 형성되는 것을 특징으로 하는 질화물 반도체 소자
15 15
기판 위에 제1 AlGaN층을 형성하는 단계;상기 제1 AlGaN층 위에 GaN층을 형성하는 단계;상기 GaN층을 식각하여 리세스 영역을 형성하는 단계;상기 리세스 영역 및 상기 GaN층 위에 제2 AlGaN층을 형성하는 단계;상기 제2 AlGaN층 위에 소스 전극을 형성하는 단계;상기 제2 AlGaN층 위에 게이트 전극을 형성하는 단계; 및상기 제1 AlGaN층 하부에 드레인 전극을 형성하는 단계;를 포함하는 질화물 반도체 소자의 제조 방법
16 16
제15 항에 있어서,상기 리세스 영역을 형성하는 단계는,상기 GaN층 위에 일정 폭을 가진 줄무늬 패턴을 형성하고, 상기 줄무늬 패턴을 식각하여 상기 리세스 영역을 형성하는 것을 특징으로 하는 질화물 반도체 소자의 제조 방법
17 17
제16 항에 있어서,상기 줄무늬 패턴의 폭은, 0
18 18
기판 위에 제1 AlGaN층을 형성하는 단계;상기 제1 AlGaN층 위에 선택적으로 GaN층을 성장하여 형성하는 단계;상기 제1 AlGaN층의 일부와 상기 GaN층 위에 제2 AlGaN층을 형성하는 단계;상기 제2 AlGaN층 위에 소스 전극을 형성하는 단계;상기 제2 AlGaN층 위에 게이트 전극을 형성하는 단계; 및상기 제1 AlGaN층 하부에 드레인 전극을 형성하는 단계;를 포함하는 질화물 반도체 소자의 제조 방법
19 19
제18 항에 있어서,상기 선택적으로 성장된 상기 GaN층 사이의 간격은, 0
20 20
제15 항 내지 제19 항 중 어느 한 항에 있어서,상기 제2 AlGaN층 위에 게이트 절연막층을 형성하는 단계;를 더 포함하는 질화물 반도체 소자의 제조 방법
21 21
제15 항 내지 제19 항 중 어느 한 항에 있어서,상기 제2 AlGaN층 위에 p형 GaN층을 형성하는 단계;를 더 포함하는 질화물 반도체 소자의 제조 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.