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클럭 버퍼 회로 및 클럭 버퍼링 방법

  • 기술번호 : KST2015068655
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요약 본 발명은 버퍼링 기능을 켜고 끄는 과정에서 발생되는 불완전한 클럭의 발생을 방지할 수 있는 클럭 버퍼 회로에 관한 것이다. 본 발명의 실시예들 중 적어도 하나에 의하면, 버퍼링 기능을 켜는 과정에서 발생되는 불완전한 클럭을 소정 시간 동안 차단시키고, 안정된 클럭이 발생될 때 그 클럭을 출력시켜서 완전한 클럭만을 생성할 수 있다는 장점이 있다.
Int. CL H03K 5/13 (2006.01) H03K 19/0175 (2006.01)
CPC H03K 19/0008(2013.01) H03K 19/0008(2013.01) H03K 19/0008(2013.01)
출원번호/일자 1020120082960 (2012.07.30)
출원인 엘지전자 주식회사
등록번호/일자
공개번호/일자 10-2013-0129052 (2013.11.27) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보 미국  |   61/648,596   |   2012.05.18
법적상태 공개
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 17

출원인

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번호 이름 국적 주소
1 엘지전자 주식회사 대한민국 서울특별시 영등포구

발명자

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번호 이름 국적 주소
1 이세현 대한민국 경기 안양시 동안구

대리인

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번호 이름 국적 주소
1 김용인 대한민국 서울특별시 송파구 올림픽로 ** (잠실현대빌딩 *층)(특허법인(유한)케이비케이)
2 방해철 대한민국 서울특별시 송파구 올림픽로 ** (잠실현대빌딩 *층)(특허법인(유한)케이비케이)

최종권리자

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번호 이름 국적 주소
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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2012.07.30 수리 (Accepted) 1-1-2012-0606468-07
2 우선권주장증명서류제출서(USPTO)
Submission of Priority Certificate(USPTO)
2012.08.01 수리 (Accepted) 9-1-2012-9009145-42
3 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)
2014.12.01 수리 (Accepted) 1-1-2014-1163593-85
4 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.05.22 수리 (Accepted) 4-1-2015-5068349-97
5 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.05.28 수리 (Accepted) 4-1-2020-5118228-40
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
인에이블(Enable) 신호에 따라 입력 클럭을 버퍼링 하는 클럭 버퍼 회로에 있어서,상기 인에이블 신호에 기초해 상기 입력 클럭을 버퍼링하는 버퍼링부;상기 인에이블 신호를 소정 시간 지연시키는 지연 소자; 및상기 지연된 인에이블 신호에 기초해 상기 버퍼링된 입력 클럭을 출력하는 출력부를 포함하는 클럭 버퍼 회로
2 2
제 1 항에 있어서,상기 버퍼링부는 상기 인에이블 신호가 인에이블 상태일 경우 상기 입력 클럭을 버퍼링하는 클럭 버퍼 회로
3 3
제 1 항에 있어서,상기 출력부는 상기 지연된 인에이블 신호가 인에이블 상태일 경우 상기 입력 클럭을 출력하고,상기 지연된 인에이블 신호가 디스에이블(Disable) 상태일 경우 상기 입력 클럭을 출력하지 않는 클럭 버퍼 회로
4 4
제 1 항에 있어서,상기 지연 소자는 상기 인에이블 신호가디스에이블 상태에서 인에이블 상태로 전환될 때에는 상기 인에이블 신호를 상기 소정 시간만큼 지연시키고,인에이블 상태에서 디스에이블 상태로 전환될 때에는 상기 인에이블 신호를 지연시키지 않는 것을 특징으로 하는 클럭 버퍼 회로
5 5
제 2 항 내지 제 4 항 중 어느 한 항에 있어서,상기 인에이블 상태는 상기 인에이블 신호의 전압값이 소정 값 이상인 상태이고,상기 디스에이블 상태는 상기 인에이블 신호의 전압값이 상기 소정 값 미만인 클럭 버퍼 회로
6 6
제 1 항에 있어서,상기 버퍼링부는 상기 인에이블 신호와 상기 입력 클럭을 입력으로 하는 제 1 NAND 게이트로 구성되고, 상기 제 1 NAND 게이트의 출력은 피드백 저항을 통해 상기 입력 클럭이 인가되는 입력으로 연결되도록 구성된 클럭 버퍼 회로
7 7
제 6 항에 있어서,상기 제 1 NAND 게이트의 입력으로 들어가는 상기 입력 클럭은 직류 입력을 차단하기 위한 콘덴서를 통해 상기 제 1 NAND 게이트의 입력으로 연결되는 클럭 버퍼 회로
8 8
제 1 항에 있어서,상기 지연 소자는 시퀀싱/슈퍼바이저리(sequencing/supervisory) 소자인 것을 특징으로 하는 클럭 버퍼 회로
9 9
제 6 항에 있어서,상기 출력부는 상기 제 1 NAND 게이트의 출력과 상기 지연 소자의 출력을 입력으로 하는 제 2 NAND 게이트로 구성되는 것을 특징으로 하는 클럭 버퍼 회로
10 10
제 1 항에 있어서,상기 버퍼링부는 상기 인에이블 신호와 상기 입력 클럭을 입력으로 하는 제 1 NOR 게이트로 구성되고, 상기 제 1 NOR 게이트의 출력은 피드백 저항을 통해 상기 상기 입력 클럭이 인가되는 입력으로 연결되도록 구성된 클럭 버퍼 회로
11 11
제 10 항에 있어서,상기 제 1 NOR 게이트의 입력으로 들어가는 상기 입력 클럭은 직류 입력을 차단하기 위한 콘덴서를 통해 상기 제 1 NOR 게이트의 입력으로 연결되는 클럭 버퍼 회로
12 12
제 11 항에 있어서,상기 출력부는 상기 제 1 NOR 게이트의 출력과 상기 지연 소자의 출력을 입력으로 하는 제 2 NOR 게이트로 구성되는 것을 특징으로 하는 클럭 버퍼 회로
13 13
인에이블(Enable) 신호에 따라 입력 클럭 버퍼링 방법에 있어서,상기 인에이블 신호에 기초해 상기 입력 클럭을 버퍼링하는 단계;상기 인에이블 신호를 소정 시간 지연시키는 단계; 및상기 지연된 인에이블 신호에 기초해 상기 버퍼링된 입력 클럭을 출력하는 단계를 포함하는 클럭 버퍼링 방법
14 14
제 13 항에 있어서,상기 버퍼링하는 단계는 상기 인에이블 신호가 인에이블 상태일 경우 상기 입력 클럭을 버퍼링하는 클럭 버퍼링 방법
15 15
제 13 항에 있어서,상기 출력하는 단계는 상기 지연된 인에이블 신호가 인에이블 상태일 경우 상기 입력 클럭을 출력하고,상기 지연된 인에이블 신호가 디스에이블(Disable) 상태일 경우 상기 입력 클럭을 출력하지 않는 클럭 버퍼링 방법
16 16
제 13 항에 있어서,상기 지연하는 단계는 상기 인에이블 신호가디스에이블 상태에서 인에이블 상태로 전환될 때에는 상기 인에이블 신호를 상기 소정 시간만큼 지연시키고,인에이블 상태에서 디스에이블 상태로 전환될 때에는 상기 인에이블 신호를 지연시키지 않는 것을 특징으로 하는 클럭 버퍼링 방법
17 17
제 14 항 내지 제 16 항 중 어느 한 항에 있어서,상기 인에이블 상태는 상기 인에이블 신호의 전압값이 소정 값 이상인 상태이고,상기 디스에이블 상태는 상기 인에이블 신호의 전압값이 상기 소정 값 미만인 클럭 버퍼링 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.