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다중 안테나 무선 통신 시스템에서 단말이 채널 인터리빙을 수행하는 방법으로서,채널 품질 지시자 (Channel Quality Indicator; CQI) 정보와 부호화된 데이터 정보 각각을 기 설정된 비트 단위의 벡터로 구성하여, 제 1 인터리버 입력 벡터 시퀀스를 생성하는 단계;부호화된 랭크 지시자 (Rank Indicator; RI) 정보 및 ACK/NACK (Acknowledgement/Negative ACK) 정보 각각을 전송 레이어 개수(NL)만큼 반복하여 상기 기 설정된 비트 단위의 제 2 인터리버 입력 벡터 시퀀스 및 제 3 인터리버 입력 벡터 시퀀스를 생성하는 단계;상기 제 1 인터리버 입력 벡터 시퀀스, 상기 제 2 인터리버 입력 벡터 시퀀스 및 상기 제 3 인터리버 입력 벡터 시퀀스 각각을 인터리버 행렬에 맵핑하는 단계; 및상기 인터리버 행렬을 열 단위로 독출하여, 출력 벡터 시퀀스를 생성하는 단계를 포함하며,상기 기 설정된 비트 단위는,변조 차수(Qpm)와 상기 전송 레이어 개수(NL)의 곱에 의하여 정의되는 것을 특징으로 하는,채널 인터리빙 수행 방법
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제 1 항에 있어서,상기 제 1 인터리버 입력 벡터 시퀀스를 생성하는 단계는,QCQI 비트 사이즈의 상기 CQI 정보 와 G 비트 사이즈의 상기 데이터 정보 f0,f1,f2,f3,
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제 1 항에 있어서,상기 제 2 인터리버 입력 벡터 시퀀스 () 및 상기 제 3 인터리버 입력 벡터 ()는 Qpm 비트 사이즈의 상기 RI 정보 () 및 상기 ACK/NACK 정보 ()각각이 NL 회 반복하여 연접된 것을 특징으로 하는,채널 인터리빙을 수행하는 방법
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제 1 항에 있어서,상기 제 2 인터리버 입력 벡터 시퀀스 () 및 상기 제 3 인터리버 입력 벡터 시퀀스 ()를 생성하는 단계는, Qpm 비트 사이즈의 상기 RI 정보 () 및 상기 ACK/NACK 정보 () 각각에 대하여 NL 개의 레이어 특정 스크램블링 시퀀스를 적용하는 단계; 및상기 스크램블링된 RI 정보 및 ACK/NACK 정보 각각을 연접하는 단계를 포함하는 것을 특징으로 하는,채널 인터리빙을 수행하는 방법
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제 1 항에 있어서,상기 인터리버 행렬에 맵핑하는 단계는,상기 제 2 인터리버 입력 벡터 시퀀스를 상기 인터리버 행렬의 최대 인덱스 행부터 RI 정보 용 열 인덱스 순으로 맵핑하는 단계;상기 제 1 인터리버 입력 벡터 시퀀스를, 상기 제 2 인터리버 입력 벡터 시퀀스가 맵핑된 엔트리를 제외하고, 상기 인터리버 행렬의 최소 인덱스 행부터 시간 우선 방식으로 맵핑하는 단계; 및상기 제 3 인터리버 입력 벡터 시퀀스를, 상기 제 1 인터리버 입력 벡터 시퀀스가 맵핑된 엔트리를 천공하여, 상기 인터리버 행렬의 최대 인덱스 행부터 ACK/NACK 정보 용 열 인덱스 순으로 맵핑하는 단계를 포함하는 것을 특징으로 하는,채널 인터리빙을 수행하는 방법
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제 5 항에 있어서,상기 인터리버 행렬의 엔트리 각각은,NL·Qpm 비트 사이즈의 벡터 인 것을 특징으로 하는,채널 인터리빙을 수행하는 방법
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다중 안테나 무선 통신 시스템에서 단말 장치로서,기지국과 신호를 송수신하기 위한 다중 안테나; 및상기 신호를 처리하기 위한 프로세서를 포함하고,상기 프로세서는,채널 품질 지시자 (Channel Quality Indicator; CQI) 정보와 부호화된 데이터 정보 각각을 기 설정된 비트 단위의 벡터로 구성하여 제 1 인터리버 입력 벡터 시퀀스를 생성하고, 부호화된 랭크 지시자 (Rank Indicator; RI) 정보 및 ACK/NACK (Acknowledgement/Negative ACK) 정보 각각을 전송 레이어 개수(NL)만큼 반복하여 상기 기 설정된 비트 단위의 제 2 인터리버 입력 벡터 시퀀스 및 제 3 인터리버 입력 벡터 시퀀스를 생성하며, 상기 제 1 인터리버 입력 벡터 시퀀스, 상기 제 2 인터리버 입력 벡터 시퀀스 및 상기 제 3 인터리버 입력 벡터 시퀀스 각각을 인터리버 행렬에 맵핑하고,상기 인터리버 행렬의 출력 벡터 시퀀스는 상기 인터리버 행렬을 열 단위로 독출하여 생성되며,상기 기 설정된 비트 단위는 변조 차수(Qpm)와 상기 전송 레이어 개수(NL)의 곱에 의하여 정의되는 것을 특징으로 하는,단말 장치
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제 7 항에 있어서,상기 프로세서는,QCQI 비트 사이즈의 상기 CQI 정보 와 G 비트 사이즈의 상기 데이터 정보 f0,f1,f2,f3,
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제 7 항에 있어서,상기 제 2 인터리버 입력 벡터 시퀀스 () 및 상기 제 3 인터리버 입력 벡터 ()는 Qpm 비트 사이즈의 상기 RI 정보 () 및 상기 ACK/NACK 정보 ()각각이 NL 회 반복하여 연접된 것을 특징으로 하는,단말 장치
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제 7 항에 있어서,상기 프로세서는,Qpm 비트 사이즈의 상기 RI 정보 () 및 상기 ACK/NACK 정보 () 각각에 대하여 NL 개의 레이어 특정 스크램블링 시퀀스를 적용하고, 상기 스크램블링된 RI 정보 및 ACK/NACK 정보 각각을 연접하여, 상기 제 2 인터리버 입력 벡터 시퀀스 () 및 상기 제 3 인터리버 입력 벡터 시퀀스 ()를 생성하는 것을 특징으로 하는,단말 장치
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제 7 항에 있어서,상기 제 2 인터리버 입력 벡터 시퀀스는,상기 인터리버 행렬의 최대 인덱스 행부터 RI 정보 용 열 인덱스 순으로 맵핑되고,상기 제 1 인터리버 입력 벡터 시퀀스는,상기 제 2 인터리버 입력 벡터 시퀀스가 맵핑된 엔트리를 제외하고, 상기 인터리버 행렬의 최소 인덱스 행부터 시간 우선 방식으로 맵핑되며,상기 제 3 인터리버 입력 벡터 시퀀스는,상기 제 1 인터리버 입력 벡터 시퀀스가 맵핑된 엔트리를 천공하여, 상기 인터리버 행렬의 최대 인덱스 행부터 ACK/NACK 정보 용 열 인덱스 순으로 맵핑되는 것을 특징으로 하는,단말 장치
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제 11 항에 있어서,상기 인터리버 행렬의 엔트리 각각은,NL·Qpm 비트 사이즈의 벡터 인 것을 특징으로 하는,단말 장치
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