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단말에서 페이징 메시지를 수신하는 방법으로서,페이징 사이클의 주기 및 상기 페이징 사이클의 배수 파라미터를 지시하는 페이징 구성 정보를 수신하고 상기 페이징 구성 정보에 따라 제1 페이징 프레임(Paging Frame)의 제1 페이징 위치(Paging Occasion)를 결정하는 단계;연결 상태 DRX(Discontinuous Reception) 사이클의 시작 위치 및 온 구간 길이를 지시하는 DRX 구성 정보를 수신하는 단계; 및상기 제1 페이징 프레임의 제1 페이징 위치를 상기 DRX 사이클의 온 구간 내에 포함되는 제2 페이징 프레임의 제2 페이징 위치로 업데이트하는 단계를 포함하되,상기 업데이트하는 단계는,상기 DRX 사이클의 온 구간 길이가 하나의 무선 프레임 길이보다 크거나 같은 경우, (상기 DRX 사이클의 시작 위치 ≤ (T/N)×n×10 ＜ 상기 DRX 사이클의 시작 위치 + 상기 DRX 사이클의 온 구간 길이)를 만족하는 페이징 프레임 (T/N)×n을 상기 제2 페이징 프레임으로 결정하는 것과,상기 DRX 사이클의 온 구간 길이가 하나의 무선 프레임 길이보다 작은 경우, (상기 DRX 사이클의 시작 위치 ≤ (T/N)×n×10 + PO(k) ＜ 상기 DRX 사이클의 시작 위치 + 상기 DRX 사이클의 온 구간 길이)를 만족하는 페이징 프레임 (T/N)×n을 상기 제2 페이징 프레임으로 결정하는 것을 포함하며,PO(k)는 상기 페이징 프레임 (T/N)×n 내의 페이징 위치를 나타내고, T는 상기 페이징 사이클의 주기이고, N은 min(T, nB)이고, nB는 상기 페이징 사이클의 배수 파라미터인, 방법
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제1항에 있어서,상기 단말이 FDD(Frequency Division Duplex)로 동작하도록 설정되고, 상기 DRX 사이클의 온 구간 길이가 하나의 무선 프레임 길이보다 크거나 같은 경우, 상기 제2 페이징 프레임 내에서 9번 서브프레임이 상기 제2 페이징 위치로 결정되고,상기 단말이 TDD(Time Division Duplex)로 동작하도록 설정되고, 상기 DRX 사이클의 온 구간 길이가 하나의 무선 프레임 길이보다 크거나 같은 경우, 상기 제2 페이징 프레임 내에서 0번 서브프레임이 상기 제2 페이징 위치로 결정되는, 방법
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제1항에 있어서,상기 DRX 사이클의 온 구간 길이가 하나의 무선 프레임 길이보다 작은 경우, 상기 제2 페이징 프레임 내에서 상기 PO(k) 값 중 최소값에 해당하는 서브프레임이 상기 제2 페이징 위치로 결정되는, 방법
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제1항에 있어서,상기 nB는 4T, 2T, T, T/2, T/4, T/8, T/16, T/32 중 하나인, 방법
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제1항에 있어서,상기 제2 페이징 프레임의 제2 페이징 위치에서 상기 페이징 메시지를 수신하는 단계를 더 포함하는, 방법
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페이징 메시지를 수신하는 단말에 있어서,RF(Radio Frequency) 모듈; 및 프로세서를 포함하되, 상기 프로세서는상기 RF 모듈을 통해 페이징 사이클의 주기 및 상기 페이징 사이클의 배수 파라미터를 지시하는 페이징 구성 정보를 수신하고 상기 페이징 구성 정보에 따라 제1 페이징 프레임(Paging Frame)의 제1 페이징 위치(Paging Occasion)를 결정하고,상기 RF 모듈을 통해 연결 상태 DRX(Discontinuous Reception) 사이클의 시작 위치 및 온 구간 길이를 지시하는 DRX 구성 정보를 수신하고,상기 제1 페이징 프레임의 제1 페이징 위치를 상기 DRX 사이클의 온 구간 내에 포함되는 제2 페이징 프레임의 제2 페이징 위치로 업데이트하도록 구성되며,상기 업데이트하는 것은,상기 DRX 사이클의 온 구간 길이가 하나의 무선 프레임 길이보다 크거나 같은 경우, (상기 DRX 사이클의 시작 위치 ≤ (T/N)×n×10 ＜ 상기 DRX 사이클의 시작 위치 + 상기 DRX 사이클의 온 구간 길이)를 만족하는 페이징 프레임 (T/N)×n을 상기 제2 페이징 프레임으로 결정하는 것과,상기 DRX 사이클의 온 구간 길이가 하나의 무선 프레임 길이보다 작은 경우, (상기 DRX 사이클의 시작 위치 ≤ (T/N)×n×10 + PO(k) ＜ 상기 DRX 사이클의 시작 위치 + 상기 DRX 사이클의 온 구간 길이)를 만족하는 페이징 프레임 (T/N)×n을 상기 제2 페이징 프레임으로 결정하는 것을 포함하며,PO(k)는 상기 페이징 프레임 (T/N)×n 내의 페이징 위치를 나타내고, T는 상기 페이징 사이클의 주기이고, N은 min(T, nB)이고, nB는 상기 페이징 사이클의 배수 파라미터인, 단말
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제10항에 있어서,상기 단말이 FDD(Frequency Division Duplex)로 동작하도록 설정되고, 상기 DRX 사이클의 온 구간 길이가 하나의 무선 프레임 길이보다 크거나 같은 경우, 상기 제2 페이징 프레임 내에서 9번 서브프레임이 상기 제2 페이징 위치로 결정하고,상기 단말이 TDD(Time Division Duplex)로 동작하도록 설정되고, 상기 DRX 사이클의 온 구간 길이가 하나의 무선 프레임 길이보다 크거나 같은 경우, 상기 제2 페이징 프레임 내에서 0번 서브프레임이 상기 제2 페이징 위치로 결정되는, 단말
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제10항에 있어서,상기 DRX 사이클의 온 구간 길이가 하나의 무선 프레임 길이보다 작은 경우, 상기 제2 페이징 프레임 내에서 상기 PO(k) 값 중 최소값에 해당하는 서브프레임이 상기 제2 페이징 위치로 결정되는, 단말
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제10항에 있어서,상기 nB는 4T, 2T, T, T/2, T/4, T/8, T/16, T/32 중 하나인, 단말
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제10항에 있어서,상기 프로세서는 또한 상기 제2 페이징 프레임의 제2 페이징 위치에서 상기 페이징 메시지를 수신하도록 구성되는, 단말
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