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질화물 반도체 소자 및 그 제조 방법

  • 기술번호 : KST2015071404
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 명세서는, 초격자층 구조를 통해 높은 임계전압을 가지면서, 불순물 도핑된층의 삽입으로 노멀리 오프(Normally-off) 특성을 동시에 가지는 반도체 소자(또는 에피텍셜 기판) 및 그 제조방법을 제공한다.이를 위하여, 일 실시예에 따른 반도체 소자는, 버퍼층; 상기 버퍼층 상에 형성되는 초격자층; 상기 초격자층에 상에 형성되고 GaN으로 이루어지는 채널층; 상기 채널층 상에 형성되는 장벽층; 및 상기 장벽층 상에 형성되는 p-GaN층을 포함할 수 있다.
Int. CL H01L 29/778 (2006.01.01) H01L 29/66 (2006.01.01) H01L 29/20 (2006.01.01)
CPC H01L 29/778(2013.01) H01L 29/778(2013.01) H01L 29/778(2013.01)
출원번호/일자 1020130059892 (2013.05.27)
출원인 엘지전자 주식회사
등록번호/일자
공개번호/일자 10-2014-0139346 (2014.12.05) 문서열기
공고번호/일자 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2018.05.28)
심사청구항수 12

출원인

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번호 이름 국적 주소
1 엘지전자 주식회사 대한민국 서울특별시 영등포구

발명자

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번호 이름 국적 주소
1 김재무 대한민국 서울특별시 서초구
2 장태훈 대한민국 서울특별시 서초구
3 김준호 대한민국 서울특별시 서초구
4 조성무 대한민국 서울특별시 서초구
5 황의진 대한민국 서울특별시 서초구

대리인

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번호 이름 국적 주소
1 박장원 대한민국 서울특별시 강남구 강남대로 ***, *층~*층 (논현동, 비너스빌딩)(박장원특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 엘지전자 주식회사 서울특별시 영등포구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2013.05.27 수리 (Accepted) 1-1-2013-0468689-10
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.05.22 수리 (Accepted) 4-1-2015-5068349-97
3 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)
2018.05.28 수리 (Accepted) 1-1-2018-0522420-97
4 의견제출통지서
Notification of reason for refusal
2019.06.27 발송처리완료 (Completion of Transmission) 9-5-2019-0461008-16
5 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2019.08.27 수리 (Accepted) 1-1-2019-0882338-28
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2019.08.27 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2019-0882341-66
7 등록결정서
Decision to grant
2019.10.21 발송처리완료 (Completion of Transmission) 9-5-2019-0762381-47
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.05.28 수리 (Accepted) 4-1-2020-5118228-40
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
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버퍼층;상기 버퍼층 상에 형성되는 초격자층;상기 초격자층에 상에 형성되고 GaN으로 이루어지는 채널층;상기 채널층 상에 형성되는 장벽층; 및상기 장벽층 상에 형성되는 p-GaN층을 포함하고,상기 버퍼층은 저온으로 성장된 제 1 AlN층 및 상기 제 1 AlN층 상에 형성되고, 고온으로 성장된 제 2 AlN층을 포함하고,상기 초격자층은 서로 다른 2개의 제 1 박막층 및 제 2 박막층이 적층된 초격자 박막층이 복수개 적층되어 형성되고,상기 제 1 박막층은 AlxGa1-xN(0≤x≤1) 또는 AlxInyGa1-x-yN(0≤x,y≤1, x≠y)로 이루어지고,상기 제 2 박막층은 GaN으로 이루어지고,상기 제 1 박막층의 두께는 1nm ~ 15nm이고, 상기 제 2 박막층의 두께는 1nm ~ 100nm이고, 상기 초격자층은 2 ~ 500 개의 초격자 박막층을 포함하고, p형 도펀트인 Fe로 도핑되며, 상기 p형 도펀트의 농도는 1e16/cm3 ~ 5e20/cm3 이고, 상기 초격자층의 적층 방향으로 점층적으로 감소되는 것을 특징으로 하는 반도체 소자
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제1항에 있어서, 상기 채널층의 두께는,0
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제1항에 있어서, 상기 채널층은,Mg, C 및 Fe 중 적어도 하나의 도펀트로 도핑되고,상기 적어도 하나의 도펀트 농도는,1e16/cm3 ~ 5e20/cm3인 것인 반도체 소자
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제1항에 있어서, 상기 장벽층은,AlN 또는 AlxGa1-xN(0≤x≤0
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제1항에 있어서, 상기 장벽층의 두께는,1nm ~ 100nm인 것인 반도체 소자
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제1항에 있어서, 상기 p-GaN층의 두께는,10nm ~ 200nm인 것인 반도체 소자
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제1항에 있어서, 상기 p-GaN층의 p형 불순문 농도는,3e17/cm3 ~ 1e20/cm3인 것인 반도체 소자
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제1항에 있어서,상기 장벽층 상에 형성되는 GaN 캡층을 더 포함하는 것을 특징으로 하는 반도체 소자
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제20항에 있어서, 상기 GaN 캡층의 두께는,2nm ~ 10nm인 것인 반도체 소자
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제1항에 있어서, 상기 버퍼층은,기판 상에 형성되는 것인 반도체 소자
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제22항에 있어서, 상기 기판은,Si, SiC, Sapphire 및 GaN 중 적어도 하나로 이루어지는 것인 반도체 소자
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제1항에 있어서, 상기 장벽층의 일부 영역 상에 형성되는 소스 전극, 드레인 전극 및 상기 p-GaN층 상에 형성되는 게이트 전극을 더 포함하는 것을 특징으로 하는 반도체 소자
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