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디지탈신호처리용실리콘컴파일러의비트직렬곱셈기

  • 기술번호 : KST2015073430
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 내용 없음.
Int. CL G06F 7/52 (2006.01)
CPC G06F 7/525(2013.01)
출원번호/일자 1019890019497 (1989.12.26)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-1991-0012903 (1991.08.08) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 거절
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (1989.12.26)
심사청구항수 3

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 이황수 대한민국 서울시강남구
2 김진율 대한민국 서울시강남구
3 조윤석 대한민국 서울시서초구

대리인

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번호 이름 국적 주소
1 김영길 대한민국 서울특별시 강남구 테헤란로 ***, 대흥빌딩 ***호 (역삼동)

최종권리자

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번호 이름 국적 주소
최종권리자 정보가 없습니다
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 출원심사청구서
Request for Examination		 1989.12.26 수리 (Accepted) 1-1-1989-0113902-94
2 특허출원서
Patent Application		 1989.12.26 수리 (Accepted) 1-1-1989-0113900-03
3 대리인선임신고서
Notification of assignment of agent		 1989.12.26 수리 (Accepted) 1-1-1989-0113901-48
4 명세서등보정서
Amendment to Description, etc.		 1991.10.07 수리 (Accepted) 1-1-1989-0113903-39
5 의견제출통지서
Notification of reason for refusal		 1992.05.29 발송처리완료 (Completion of Transmission) 1-5-1989-0060431-52
6 지정기간연장신청서
Request for Extension of Designated Period		 1992.06.29 수리 (Accepted) 1-1-1989-0113904-85
7 지정기간연장신청서
Request for Extension of Designated Period		 1992.07.25 수리 (Accepted) 1-1-1989-0113905-20
8 지정기간연장신청서
Request for Extension of Designated Period		 1992.08.29 수리 (Accepted) 1-1-1989-0113906-76
9 명세서등보정서
Amendment to Description, etc.		 1992.09.28 수리 (Accepted) 1-1-1989-0113908-67
10 의견서
Written Opinion		 1992.09.28 수리 (Accepted) 1-1-1989-0113907-11
11 거절사정서
Decision to Refuse a Patent		 1993.01.19 발송처리완료 (Completion of Transmission) 1-5-1989-0060432-08
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
14 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
15 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1

데이타가 N비트(N≥k)의 2의 보수 표현을 갖고, 계수가 k비트의 2의 보수표현을 갖는 경우에 K-1개의 덧셈기와 1개의 뺄셈기를 직렬로 연결하고, 데이타의 비트 흐름과 계수의 비트흐름과 이전까지의 합한 결과 및 콘트롤 신호는 출력단에서 다음에 연결되는 덧셈기 또는 뺄셈기로 계속 공급되도록 구성함을 특징으로 하는 디지탈 신호처리용 실리콘 컴파일러의 비트 직렬 곱셈기

2 2

제1항에 있어서, 덧셈기는 다수의 래치(D1), (D2), (D3), (D4), (D5), (D6), (D7), (D8)와, 계수래치(CD1)와, 가산기(1)와, 3접점 스위치(SW1), (SW2)와 AND게이트(A1),(A2)및 익스클루시브-OR게이트(EX-OR)들로 구성하고 입력단(Xi), (Yi), (PPi), (ri)으로 데이타의 비트 흐름, 계수의 비트흐름, 이전까지 합한 결과, 최하위 비트의 콘트롤 신호가 각각 입력 되도록 하며 콘트롤 신호에 의해 적절한 시간에 계수 비트를 계수 래치(CD1)에 저장하면서 부호를 확장하도록 한 디지탈 신호처리용 실리콘 컴파일러의 비트직렬 곱셀기

3 3

제1항에 있어서, 뺄셈기는 다수의 래치(D9), (D10), (D11), (D12), (D13), (D14), (D15)와, 계수래치(CD2)와, 가산기(2)와, 3접점 스위치(SW3)와, NAND게이트(NA1) 및 OR게이트(OR)들로 구성하고 입력단(Xi), (Yi), (PPi), (ri)으로 데이타의 비트흐름, 계수의 비트흐름, 이전까지 합한 결과, 최하위 비트의 콘트롤 신호가 각각 입력되도록 한 디지탈 신호 처리용 실리콘 컴파일러의 비트 직렬곱셈기

4
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.