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병렬처리시스템을위한노드메모리시스템

  • 기술번호 : KST2015073658
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 병렬처리시스템을 위한 노드메모리 시스템에 관한 것으로서, 종래의 병렬처리시스템을 구성하는 하나의 노드 구조를 대략 살펴보면, 일반 산술계산과 제어를 위한 범용 프로세서와, 특정 응용처리를 위한 예를 들면, 이미지 처리(image processing), 그래픽스(graphics), 신호처리(signal processing)을 위한 전용 프로세서들로 구분하는 노드 프로세서, 그리고 프로세서가 처리하는 데이타를 저장하기 위한 노드메모리와, 이웃 노드들과의 커뮤니케이션(communication)을 위한 컨트롤러를 가지고 있다.이때, 노드 메모리는 버스를 통해 노드내의 프로세서들과 인접한 이웃 노드들에 의해 액서스된다.본 발명은 병렬처리시스템을 프로세서, 메모리, 컨트롤러등을 포함하는 노드들의 집합으로 구성하므로써 하나의 프로세스를 여러개의 프로세스로 분할하여 실행하므로 전체적인 시스템의 성능을 향상시킬 수 있도록 병렬처리 시스템을 위한 노드메모리 시스템을 제공하는 것이다.
Int. CL G11C 7/00 (2006.01)
CPC G06F 13/1668(2013.01) G06F 13/1668(2013.01) G06F 13/1668(2013.01) G06F 13/1668(2013.01)
출원번호/일자 1019910024777 (1991.12.28)
출원인 한국전자통신연구원
등록번호/일자 10-0084365-0000 (1995.04.27)
공개번호/일자 10-1993-0014573 (1993.07.23) 문서열기
공고번호/일자 1019950000495 (19950124) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (1991.12.28)
심사청구항수 10

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 최장식 대한민국 대전직할시유성구
2 김기현 대한민국 대전직할시유성구
3 이훈복 대한민국 대전직할시중구
4 박치항 대한민국 대전직할시중구

대리인

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번호 이름 국적 주소
1 김영길 대한민국 서울특별시 강남구 테헤란로 ***, 대흥빌딩 ***호 (역삼동)
2 김명섭 대한민국 서울특별시 강남구 테헤란로**길 *, 테헤란오피스빌딩 ***호 시몬국제특허법률사무소 (역삼동)

최종권리자

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번호 이름 국적 주소
1 재단법인한국전자통신연구소 대한민국 대전광역시유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 출원심사청구서
Request for Examination		 1991.12.28 수리 (Accepted) 1-1-1991-0135117-22
2 특허출원서
Patent Application		 1991.12.28 수리 (Accepted) 1-1-1991-0135114-96
3 대리인선임신고서
Notification of assignment of agent		 1991.12.28 수리 (Accepted) 1-1-1991-0135116-87
4 대리인선임신고서
Notification of assignment of agent		 1991.12.28 수리 (Accepted) 1-1-1991-0135115-31
5 의견제출통지서
Notification of reason for refusal		 1994.06.27 발송처리완료 (Completion of Transmission) 1-5-1991-0065147-10
6 지정기간연장신청서
Request for Extension of Designated Period		 1994.07.27 수리 (Accepted) 1-1-1991-0135118-78
7 지정기간연장신청서
Request for Extension of Designated Period		 1994.08.26 수리 (Accepted) 1-1-1991-0135119-13
8 명세서등보정서
Amendment to Description, etc.		 1994.09.27 수리 (Accepted) 1-1-1991-0135121-16
9 의견서
Written Opinion		 1994.09.27 수리 (Accepted) 1-1-1991-0135120-60
10 출원공고결정서
Written decision on publication of examined application		 1994.12.29 발송처리완료 (Completion of Transmission) 1-5-1991-0065148-55
11 등록사정서
Decision to grant		 1995.04.24 발송처리완료 (Completion of Transmission) 1-5-1991-0065149-01
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
14 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
15 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1

다수의 전용 및 범용프로세서들과, 이 프로세서들이 처리하는 데이타를 저장하는 노드 메모리와 특정버스(MBUS)들로 구성된 병렬처리시스템에 있어서, 상기 노드 메모리와 특정버스간의 인터페이스(interface)가 상기 노드 메모리내의 다수의 DRAM을 제어하기 위한 특정 상용 컨트롤러 칩(상품명 ; DP8422A), 및 실제 데이타의 읽기 및 쓰기동작을 수행하는 다수의 제어모듈로 구성되고, 상기 다수의 제어모듈은 트랜잭션의 유형과 크기를 결정하는 유형(type) 및 크기(size)모듈 ; 데이타의 입출력시 데이타폭의 차이를 제어하기 위한 64비트 래치모듈과 래치의 제어를 위한 전송모듈 ; 데이타 입출력시 데이타의 유효여부를 체크하기 위한 패러티(parity)생성/체크모듈 ; 1바이트에서 128바이트까지 버스트전송을 위한 32비트 카운터를 포함한 버스트(burst)모듈 ; 및 새로운 주소 지정없이 자체 주소를 연속적으로 발생시키기 위한 모듈로 구성되어 특정버스(MBUS)클럭에 동기되면서 데이타의 입력 및 출력을 수행하는 노드 메모리 시스템

지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.