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어레이프로세서의2단계명령어파이프라인처리방법

  • 기술번호 : KST2015074065
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 VLSI기술을 이용한 MIMD(multiple instructien multlple data)방식으로 동작할 수 있는 2클럭 명령어(명령어의 수행에 두 사이클(명령어 패치사이클과 명령어 실행사이클)이 요구되는 명령어)의 구조를 갖는 간단한 어레이 프로세서의 설계에 있어서, 명령어의 2단계(stage)파이프라인 제어 회로의 병령어 처리방법에 관한 것으로, 클럭의 네그티브에지 및 포지티브 에지를 이용하고, 상기 IPFR신호가 제공될때, 상기 제1레지스터(2)에 명령어가 쓰여지게 하고. 상기 IPFR신호의 제공시점으로 부터 반 사이클이 지난후 상기 제1디코더(4)로 부터 상기 오퍼랜드 제어신호가 출력되게 하며, 상기 IPFR신호의 제공시점으로 부터 반 사이클이 지난후 상기 제2레지스터(3)로 상기 IFR신호가 제공되게 하고, 상기 IFR신호와 제공시점으로 부터 반 사이클이 지난후 상기 제2디코더(5)로부터 상기 목적지 제어신호가 출력되게 하는 것이 특징이다.
Int. CL G06F 9/38 (2006.01)
CPC G06F 9/3867(2013.01) G06F 9/3867(2013.01) G06F 9/3867(2013.01)
출원번호/일자 1019930028476 (1993.12.18)
출원인 한국전자통신연구원
등록번호/일자 10-0095253-0000 (1996.02.05)
공개번호/일자 10-1995-0020098 (1995.07.24) 문서열기
공고번호/일자 1019950014161 (19951122) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (1993.12.18)
심사청구항수 1

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 김종문 대한민국 대전직할시유성구
2 김명원 대한민국 대전직할시유성구
3 송윤선 대한민국 대전직할시대덕구
4 이영직 대한민국 대전직할시유성구

대리인

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번호 이름 국적 주소
1 김영길 대한민국 서울특별시 강남구 테헤란로 ***, 대흥빌딩 ***호 (역삼동)
2 김명섭 대한민국 서울특별시 강남구 테헤란로**길 *, 테헤란오피스빌딩 ***호 시몬국제특허법률사무소 (역삼동)

최종권리자

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번호 이름 국적 주소
1 재단법인한국전자통신연구소 대한민국 대전직할시유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 대리인선임신고서
Notification of assignment of agent
1993.12.18 수리 (Accepted) 1-1-1993-0142954-54
2 특허출원서
Patent Application
1993.12.18 수리 (Accepted) 1-1-1993-0142953-19
3 출원심사청구서
Request for Examination
1993.12.18 수리 (Accepted) 1-1-1993-0142955-00
4 대리인사임신고서
Notification of resignation of agent
1994.02.22 수리 (Accepted) 1-1-1993-0142956-45
5 출원공고결정서
Written decision on publication of examined application
1995.10.31 발송처리완료 (Completion of Transmission) 1-5-1993-0067589-92
6 등록사정서
Decision to grant
1996.01.31 발송처리완료 (Completion of Transmission) 1-5-1993-0067590-38
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
10 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
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번호 청구항
1 1

프로그램을 저장하는 메모리(1)와, IPFR신호에 따라서 상기 메모리(1)로부터 명령어를 프리페치하기 위한 제1의 레지스터(2)와, IFR신호에 따라서 명령어의 파이프라인 처리를 위한 제 2 의 레지스터(3)와, 상기 제1 및 상기 제 2 레지스터(2,3) 각각으로부터 제공되는 명령어를 각각 해독하여 오퍼랜드 및 목적지제어신호를 출력하는 제 1 및 제 2 디코더(4,5)를 포함하는 어레이 프로제서에서 명령어의 파이프라인 처리를수행하는 방법에 있어서, 클럭의 네그티브 에지 및 포지티브 에지를 이용하고, 상기 IPFR신호가 제공될때, 상기 제 1 레지스터(2)에 명령어가 쓰여지게 하고, 상기 IPFR신호의 제공시점으로부터 반 사이클이 지난후 상기 제 1 디코더(4)로부터 상기 오퍼랜드 제어신호가 출력되게 하며, 상기 IPFR신호의 제공시점으로부터 반 사이클이 지난후 상기 제 2레지스터(3)로 상기 IFR신호가 제공되게 하고, 상기 IFR신호의 제공시점으로부터 반 사이클이 지단후 상기 제 2 디코더(5)로부터 상기 목적지 제어신호가 출력되게 하는 것을 특징으로 하는 어레이 프로제서의 2단계(stage)명령어 파이프라인 처리방법

지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.