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버스사용권아비트레이션회로

  • 기술번호 : KST2015074275
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 버스(BUS) 사용권의 아비트레이션 회로에 관한 것으로서, 특히 2개의 DMA 제어기 (DMAC)를 구비하는 버스사용권의 아비트레이션 회로에 관한 것이다.본 발명은 DMAC를 내장한 CPU 칩과 LANCE 칩을 사용하는 장치에서의 버스 아비트레이션 기능을 수행하는 회로를 제공 한다.
Int. CL G06F 12/02 (2006.01)
CPC G06F 13/1605(2013.01)
출원번호/일자 1019920026089 (1992.12.29)
출원인 한국전자통신연구원
등록번호/일자 10-0095317-0000 (1996.02.06)
공개번호/일자 10-1994-0015836 (1994.07.21) 문서열기
공고번호/일자 1019950009568 (19950824) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (1992.12.29)
심사청구항수 1

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 이재호 대한민국 대전직할시유성구
2 이숙진 대한민국 대전직할시유성구
3 김영일 대한민국 대전직할시서구
4 김민택 대한민국 대전직할시서구
5 최각진 대한민국 대전직할시유성구
6 백승준 대한민국 대전직할시대덕구

대리인

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번호 이름 국적 주소
1 신성특허법인(유한) 대한민국 서울특별시 송파구 중대로 ***, ID타워 ***호 (가락동)

최종권리자

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번호 이름 국적 주소
1 재단법인한국전자통신연구소 대한민국 대전직할시유성구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 1992.12.29 수리 (Accepted) 1-1-1992-0141291-89
2 대리인선임신고서
Notification of assignment of agent		 1992.12.29 수리 (Accepted) 1-1-1992-0141292-24
3 출원심사청구서
Request for Examination		 1992.12.29 수리 (Accepted) 1-1-1992-0141293-70
4 의견제출통지서
Notification of reason for refusal		 1995.04.29 발송처리완료 (Completion of Transmission) 1-5-1992-0047371-43
5 지정기간연장신청서
Request for Extension of Designated Period		 1995.05.29 수리 (Accepted) 1-1-1992-0141294-15
6 명세서등보정서
Amendment to Description, etc.		 1995.06.26 수리 (Accepted) 1-1-1992-0141295-61
7 의견서
Written Opinion		 1995.06.26 수리 (Accepted) 1-1-1992-0141296-17
8 출원공고결정서
Written decision on publication of examined application		 1995.07.28 발송처리완료 (Completion of Transmission) 1-5-1992-0047373-34
9 등록사정서
Decision to grant		 1995.11.07 발송처리완료 (Completion of Transmission) 1-5-1992-0047375-25
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1

CPU(1)와, DMA 제어기(이하, DMAC라 함)(2)와, LAN 제어기 칩(이하, LANCE라 함)(3)을 구비한 장치에 적용되는 버스 사용권 아비트레이션 회로에 있어서, 상기 LANCE(3)의 버스 사용 요구 단자(HOLD*)에 입력단이 연결된 제1인버터(U7A)와, 상기 LANCE(3)의 어드레스 선택단자(AS*)에 일입력이 연결된 낸드(NAND) 게이트(U4A)와, 상기 제1인버터(U7A)의 출력단에 프리셋(PR)단이 연결되고 상기 낸드 게이트(U4A)의 출력단에 클리어(CL)단이 연결되며 출력단이 상기 LANCE(3)의 버스 사용인식신호(HLDA*)단에 연결된 제1플립플롭(U11B)과, 상기 LANCE(3)의 버스 사용 인식 신호(HLDA*)단에 일입력이 연결되고 타입력단은 DMAC(2)의 버스 사용 인식(BGACK*) 신호단에 연결되고 출력단은 CPU(1)의 버스 사용 인식(BGACK*) 신호단에 연결된 제1앤드(AND) 게이트(U2A)와, 상기 제1인터터(U7A)의 출력단에 클럭단이 연결되고 프리셋(PR)단은 상기 LANCE(3)의 버스 사용 인식신호(HLDA*)단에 연결된 제2플립플롭(U11A)과, 상기 CPU(1)의 버스 허용 신호(BG*)단에 일입력단이 연결되고 타입력단은 상기 제2플립플롭(U11A)의 정출력단(Q)에 연결된 제1오아(OR)게이트(U3B)와, 상기 오아게이트(U3B)의 출력단에 입력단이 연결되고 출력단은 상기 낸드 게이트(U4A)의 타입력단에 연결된 제2인버터(U5A)와, 상기 제2플립플롭(U1A)의 정출력단(Q)에 일입력단이 연결되고 타입력단은 상기 DMAC(2) 버스요구 신호(BR*)단에 연결되며 출력단은 상기 CPU(1)의 버스 요구 신호(BR*)단에 연결된 제2앤드(AND)게이트(U2B)와, 상기 제2플립플롭(U*A)의 정출력단(Q)의 반전된 출력에 일입력단이 연결되고 상기 DMAC(2)의 버스 요구 신호(BR*)단에 타입력단이 연결되고 또다른 입력단은 상기 CPU(1)의 버스 허용 신호(BG*)단에 연결되는 제2오아게이트(U3A)와, 상기 제2오아게이트(U3A)의 출력단에 입력단이 연결되고 출력단은 상기 DMAC(2)의 버스 허용 신호(BG*)단에 연결된 드라이버(U6A)와, 상기 LANCE(3)의 버스 사용 인식 신호(HLDA*)에 입력단이 연결되고 상기 드라이버(U6A)의 제어단에 출력단이 연결된 제3인버터(U5B)를 구비한 것을 특징으로 하는 버스 사용권 아비트레이션 회로

지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.