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클럭의위상차정렬을위한비트동기회로

  • 기술번호 : KST2015074292
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 신호지연에 따른 입력클럭과 시스템의 기준클럭 사이에서 발생하는 클럭의 위상차 정렬을 위한 비트 동기 회로에 있어서, 입력클럭과 직렬 데이타 입력받아 직렬데이타인 입력 데이타를 병렬변환하고 입력클럭으로 래치하는 직/병렬 변환부(101), 입력클럭과 기준클럭을 받아들여 제어신호를 출력하는 기준클럭 타이밍 발생부(104), 상기 직/병렬 변환부(101)의 래치된 병렬데이타와 기준클럭 타이밍 발생부(104)의 제어신호를 입력받아 래치된 병렬데이타를 제어신호로 래치시켜 기준클럭에 동기 시키는 래치부(102), 상기 래치부(102)로부터 래치된 병렬데이타와 기준클럭을 입력받아 래치된 병렬데이타를 기준클럭에 의하여 다시 직렬로 변환하는 병/직렬변환부(103)를 포함하여 구성되는 것을 특징으로 하는 클럭의 위상차 정렬을 위한 비트동기 회로에 관한 것으로, 입력클럭과 기준클럭 사이에 발생하는 클럭들간의 위상차를 정렬하기 위하여 입력되는 데이타를 4개의 병렬 신호로 변환하여 데이타의 전송속도를 낮추어줌으로써 고속의 전송데이타를 비트동기 시킬수 있으며, 병렬변환한 만큼의 지터진폭을 흡수할 수 있다. 또한, 본 발명은 적용할 경우 하드웨어의 구성이 간단하고 경제적인면에서 커다란 효과를 볼 수 있다.
Int. CL H04L 7/04 (2006.01)
CPC G11C 7/222(2013.01) G11C 7/222(2013.01)
출원번호/일자 1019930026133 (1993.12.01)
출원인 한국전자통신연구원, 주식회사 케이티
등록번호/일자 10-0096247-0000 (1996.02.27)
공개번호/일자 10-1995-0022352 (1995.07.28) 문서열기
공고번호/일자 1019950010918 (19950925) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (1993.12.01)
심사청구항수 5

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
2 주식회사 케이티 대한민국 경기도 성남시 분당구

발명자

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번호 이름 국적 주소
1 이형섭 대한민국 대전직할시중구
2 박승현 대한민국 대전직할시유성구
3 유강희 대한민국 대전직할시유성구

대리인

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번호 이름 국적 주소
1 신성특허법인(유한) 대한민국 서울특별시 송파구 중대로 ***, ID타워 ***호 (가락동)

최종권리자

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번호 이름 국적 주소
1 한국전기통신공사 대한민국 서울특별시종로구
2 재단법인한국전자통신연구소 대한민국 대전직할시유성구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 대리인선임신고서
Notification of assignment of agent		 1993.12.01 수리 (Accepted) 1-1-1993-0132465-50
2 특허출원서
Patent Application		 1993.12.01 수리 (Accepted) 1-1-1993-0132464-15
3 출원심사청구서
Request for Examination		 1993.12.01 수리 (Accepted) 1-1-1993-0132466-06
4 출원인명의변경신고서
Applicant change Notification		 1994.10.13 수리 (Accepted) 1-1-1993-0132467-41
5 출원공고결정서
Written decision on publication of examined application		 1995.08.30 발송처리완료 (Completion of Transmission) 1-5-1993-0061046-83
6 등록사정서
Decision to grant		 1995.11.30 발송처리완료 (Completion of Transmission) 1-5-1993-0061047-28
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 1999.01.20 수리 (Accepted) 4-1-1999-0010652-29
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2000.01.14 수리 (Accepted) 4-1-2000-0005008-66
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.04.09 수리 (Accepted) 4-1-2002-0032774-13
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.03.13 수리 (Accepted) 4-1-2009-5047686-24
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
14 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2010.04.19 수리 (Accepted) 4-1-2010-5068437-23
15 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.01.10 수리 (Accepted) 4-1-2012-5005621-98
16 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.03.21 수리 (Accepted) 4-1-2012-5058926-38
17 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2012.06.08 수리 (Accepted) 4-1-2012-5122434-12
18 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2013.07.31 수리 (Accepted) 4-1-2013-5106568-91
19 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.02.11 수리 (Accepted) 4-1-2014-5018159-78
20 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1

신호지연에 다른 입력클럭과 시스템의 기준클럭 사이에서 발생하는 클럭의 위상차 정렬을 위한 비트동기 회로에 있어서, 입력클럭과 직렬 데이타 입력받아 직렬 데이타인 입력 데이타를 병렬 변환하고 입력클럭으로 래치하는 직/병렬 변환부(101), 입력클럭과 기준클럭을 받아들여 제어신호를 출력하는 기준클럭 타이밍 발생부(104), 상기 직/병렬 변환부(101)의 래치된 병렬 데이타와 기준클럭 타이밍 발생부(104)의 제어신호를 입력받아 래치된 병렬 데이타를 제어신호로 래치시켜 기준클럭에 동기시키는 래치부(102), 상기 래치부(102)로부터 래치된 병렬 데이타와 기준클럭을 입력받아 래치된 병렬 데이타를 기준클럭에 의하여 다시 직렬로 변환하는 병/직렬 변환부(103)를 포함하여 구성되는 것을 특징으로 하는 클럭의 위상차 정렬을 위한 비트동기 회로

2 2

제1항에 있어서, 상기 래치부(102)는 입력클럭의 제어신호를 받는 제1래치부(203)와 기준클럭의 제어신호를 받는 제2래치부(207)로 구성되는 것을 특징으로 하는 클럭의 위상차 정렬을 위한 비트동기 회로

3 3

제1항 또는 제2항에 있어서, 상기 기준클럭 타이밍 발생부(104)는 입력클럭을 받아 병렬화된 데이타를 소정주기 마다 래치하기 위한 제어클럭을 상기 제1래치부(203)로 출력하는 제1카운터(202)와, 기준클럭을 받아 입력되는 클럭과 같은 타이밍을 갖게 해주는 제어클럭을 상기 제2래치부(207)로 출력하는 제2카운터(206)로 구성되는 것을 특징으로 하는 클럭의 위상차 정렬을 위한 비트동기 회로

4 4

제3항에 있어서, 상기 입력클럭 및 기준클럭 각각의 제1 및 제2카운터(202,206)는 동일 리셋신호를 받는 것을 특징으로 하는 클럭의 위상차 정렬을 위한 비트동기 회로

5 5

제3항에 있어서, 상기 제1 및 제2카운터(202,206)는 각각 4진 카운터인 것을 특징으로 하는 클럭의 위상차 정렬을 위한 비트동기 회로

지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.