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자기정렬된홈구조의채널을가진MOS소자및제조방법

  • 기술번호 : KST2015074451
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 집적회로의 집적도가 증가함에 따라 채널의 길이가 짧아지는 금속 산화물 반도체 소자에서 발생하는 문제점인 짧은 채널효과, 소스와 드레인의 저항증가, 금속배선에 의한 접합파괴 및 일렉트로 마이그레이션 등에 의한 소자의 신뢰성 저하를 방지하기 위한 것으로서, 게이트 전극과 소스 및 드레인 사이에 홈형태의 또다른 게이트 전극을 형성하여 이 홈의 깊이만큼의 소스 및 드레인의 접합깊이를 확보함으로써 이와 같은 문제점들을 극복한다.이러한 홈구조의 게이트 전극 아래에 소정 농도의 불순물을 주입하면, 이 불순물의 농도를 조절함으로써 문턱전압이나 누설전류와 같은 전기적 특성을 조절하는 것이 가능해 진다.
Int. CL H01L 27/08 (2006.01)
CPC H01L 29/1033(2013.01) H01L 29/1033(2013.01) H01L 29/1033(2013.01)
출원번호/일자 1019940027479 (1994.10.26)
출원인 한국전자통신연구원
등록번호/일자 10-0135029-0000 (1998.01.09)
공개번호/일자 10-1996-0015899 (1996.05.22) 문서열기
공고번호/일자 (19980420) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (1994.10.26)
심사청구항수 8

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 강원구 대한민국 대전직할시유성구
2 유종선 대한민국 대전직할시유성구
3 김여환 대한민국 대전직할시유성구
4 강성원 대한민국 대전직할시유성구

대리인

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번호 이름 국적 주소
1 김영길 대한민국 서울특별시 강남구 테헤란로 ***, 대흥빌딩 ***호 (역삼동)
2 원혜중 대한민국 서울특별시 강남구 테헤란로**길 **, 서울빌딩 *층 (역삼동)
3 이화익 대한민국 서울시 강남구 테헤란로*길** (역삼동,청원빌딩) *층,***,***호(영인국제특허법률사무소)
4 김명섭 대한민국 서울특별시 강남구 테헤란로**길 *, 테헤란오피스빌딩 ***호 시몬국제특허법률사무소 (역삼동)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 대리인선임신고서
Notification of assignment of agent
1994.10.26 수리 (Accepted) 1-1-1994-0124583-31
2 출원심사청구서
Request for Examination
1994.10.26 수리 (Accepted) 1-1-1994-0124584-87
3 특허출원서
Patent Application
1994.10.26 수리 (Accepted) 1-1-1994-0124582-96
4 출원인정보변경 (경정)신고서
Notification of change of applicant's information
1997.04.04 수리 (Accepted) 1-1-1994-0124585-22
5 대리인선임신고서
Notification of assignment of agent
1997.08.19 수리 (Accepted) 1-1-1994-0124586-78
6 등록사정서
Decision to grant
1997.12.24 발송처리완료 (Completion of Transmission) 1-5-1994-0069717-21
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
10 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1

제 1 소정 농도의 제 1 도전형 채널영역(A)을 갖춘 기판(1)과, 이 채널영역을 사이에 두고 상기 기판(1)상에 형성된 상기 제 1 도전형과 반대 도전형인 제 2 도전형의 소스 및 드레인 영역(7)과, 상기 채널영역 위에 형성된 게이트 절연막과, 이 게이트 절연막 위에 형성된 제 1 게이트 전극(4)을 구비하는 금속 산화물 반도체 소자에 있어서, 상기 제 1 게이트 전극(4)이 상기 소스 및 드레인 영역(7)과 근접하는 부분에는 제 2 게이트 전극(8)이 자기정렬법(Self-Align method)을 이용하여 홈형태로 형성되고, 상기 제 2 게이트 전극(8)이 상기 기판과 접하는 부분에는 게이트 산화막(9)이 형성되어 있으며, 이 게이트 산화막(9) 아래에는 상기 제 1 소정 농도와는 다른 제 2 소정 농도의 제 1 전도형 채널(B)이 형성되어 있는 것을 특징으로 하는 금속 산화물 반도체 소자

2 2

제1항에 있어서, 상기 자기정렬법을 이용한 홈형태에는 각진 형태나, 각이 없는 둥근형태 또는 임의의 다각형 등의 모양이 포함되는 것을 특징으로 하는 금속 산화물 반도체 소자

3 3

제1항에 있어서, 상기 제 1 소정 농도는 상기 제 2 소정 농도보다 더 낮고, 상기 제 1 도전형은 n형인 것을 특징으로 하는 금속 산화물 반도체 소자

4 4

제1항에 있어서, 상기 제 1 소정 농도와 상기 제 2 소정 농도는 상기 기판의 농도보다 높으며, 상기 제 1 도전형은 n형인 것을 특징으로 하는 금속 산화물 반도체 소자

5 5

제1항에 있어서, 상기 제 1 소정 농도는 상기 제 2 소정 농도보다 더 낮고, 상기 제 1 도전형은 p형인 것을 특징으로 하는 금속 산화물 반도체 소자

6 6

제1항에 있어서, 상기 제 1 소정 농도와 상기 제 2 소정 농도는 상기 기판의 농도보다 높으며, 상기 제 1 도전형은 p형인 것을 특징으로 하는 금속 산화물 반도체 소자

7 7

제3항 내지 제6항 중 어느 한 항에 있어서, 상기 채널영역(A) 아래에는 상기 제 2 소정 농도의 상기 제 1 도전형의 불순물이 도핑되어 있는 것을 특징으로 하는 금속 산화물 반도체 소자

8 8

홈구조의 금속 산화물 반도체 소자를 제조하는 방법으로서, 가) 제 1 도전형의 실리콘 기판(1) 상에 활성영역을 정의한 다음, 게이트 산화막(2)을 성장시키고 제 1 게이트 전극(4)을 패턴형성하는 단계

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2 JP02594772 JP 일본 FAMILY
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1 JP2594772 JP 일본 DOCDBFAMILY
2 JP8130310 JP 일본 DOCDBFAMILY
3 JPH08130310 JP 일본 DOCDBFAMILY
4 US5665990 US 미국 DOCDBFAMILY
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