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두 입력(A, B)에 대한 가감산 연산을 하는 연산기와, 그 연산기의 오버플로우 발생에 따라 연산결과를 최대치나 최소치로 보정을 하기 위한 보정값을 계산하는 보정회로 및 오버플로우 발생에 따라 상기 보정회로의 출력 또는 상기 연산기의 출력을 선택하여 출력하는 선택기로 이루어진 연산회로의 오버플로우를 검출하는 회로에 있어서, 상기 두 입력(A, B)을 상기 연산기와 함께 병렬로 입력받아 비교하여 오버플로우 발생 여부를 검출하는 오버플로우 검출기와, 그 오버플로우 검출기의 오버플로우 검출 여부에 의해 상기 선택기의 선택 제어신호를 출력하는 보정 제어회로로 구성되되, 상기 오버플로우 검출기는, 상기 하나의 입력(B)을 반전시키는 인버터와, 그 인버터를 통한 반전입력과 다른 입력(A)을 입력받아 대소를 비교하는 비교기와, 그 비교기의 출력(C)과 상기 두 입력 A
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제1항에 있어서, 상기 오버플로우 검출기는, 가/감산을 선택하기 위한 제어신호와 상기 가/감산기에 입력되는 두 입력(A, B)중 어느 한 입력(B)을 각각 논리 조합하는 XOR(40) 및 XNOR(41)와, 상기 다른 하나의 입력(A = VA)과 상기 XNOR(41)의 출력(VB')의 대소를 비교하는 비교기(42)와, 상기 비교기의 두 입력(VA와 VB')이 같은 때의 신호(VA = VB)와 상기 다른 하나의 입력이 큰 경우(VA ＞ VB)의 신호를 오아 조합하는 오아 게이트(43)와, 그 오아 게이트(43)의 출력(VA ≥ VB)과 상기 다른 하나의 입력이 큰 경우(VA ＞ VB)의 신호를 입력받아 상기 가/감산 선택 제어신호에 의거하여 선택하는 선택기(44)와, 그 선택기(44)의 출력신호와 상기 다른 하나의 입력신호의 부호 및 상기 XOR의 출력신호의 부호에 의거하여 A+B, A+B+1의 오버플로우를 검출하는 디코더로 구성된 것을 특징으로 하는 연산기의 오버플로우 검출회로
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