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AT-BUS에 장착하기 위한 병렬 신경망 보드의 제어회로

  • 기술번호 : KST2015075200
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 IBM-PC의 AT버스를 이용하여 대규모의 병렬 프로세서 시스템을 제어하기 위한 병렬 신경망 보드의 제어회로에 관한 것으로, 격자구조를 갖는 16개의 디지탈 신경칩으로 이루어지며 각각 특정의 주소를 갖는 소정갯수의 프로세서 보드(11)와, 상기 프로세서 보드(11) 각각에 부여된 특정 주소를 사용하여 상기 프로세서 보드(11)내의 신경칩간의 로칼 버스통신과 프로세서보드간의 글로벌 버스 통신을 제어하는 IBM-PC(10)를 포함하여 단일 프로세서 시스템인 IBM-PC에서 대규모 프로세서를 효율적으로 제어하기 위한 계충적 제어구조를 제공하는 것을 특징으로 하는 AT-Bus에 장착하기 위한 병렬 신경망 보드의 제어회로를 제공하고, 그에따른 선택되어진 해당 프로세서 보드의 주소를 AT-버스에 있는 주소 버스의 하위 네비트와 데이타 버스의 하위 네비트에서 이 실어 전송하는 전송수단과, 상기 전송수단에서 출력되는 주소 버스의 데이타와 데이타 버스를 비교하여 결과를 출력하는 제1비교기와; 상기 제1비교기에서 출력되는 비교데이타가 참인 경우 해당 보드의 주소값을 저장하는 레지스터; 및 상기 레지스터에 저장된 데이타와 미리 지정된 보드의 주소 값을 비교하여 보드가 선택됨을 출력하는 제2비교기를 포함하는 것을 특징으로 하는 IBM-PC가 제어할 수 있는 8개의 프로세서 보드중에서 임의의 프로세서 보드 선택회로를 제공한다.
Int. CL G06F 13/40 (2006.01)
CPC G06F 13/4208(2013.01)G06F 13/4208(2013.01)
출원번호/일자 1019950053657 (1995.12.21)
출원인 한국전자통신연구원
등록번호/일자 10-0152710-0000 (1998.06.30)
공개번호/일자 10-1997-0049687 (1997.07.29) 문서열기
공고번호/일자 (19981015) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (1995.12.21)
심사청구항수 4

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 김종문 대한민국 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 김영길 대한민국 서울특별시 강남구 테헤란로 ***, 대흥빌딩 ***호 (역삼동)
2 원혜중 대한민국 서울특별시 강남구 테헤란로**길 **, 서울빌딩 *층 (역삼동)
3 이화익 대한민국 서울시 강남구 테헤란로*길** (역삼동,청원빌딩) *층,***,***호(영인국제특허법률사무소)
4 김명섭 대한민국 서울특별시 강남구 테헤란로**길 *, 테헤란오피스빌딩 ***호 시몬국제특허법률사무소 (역삼동)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 출원심사청구서
Request for Examination		 1995.12.21 수리 (Accepted) 1-1-1995-0207371-73
2 대리인선임신고서
Notification of assignment of agent		 1995.12.21 수리 (Accepted) 1-1-1995-0207370-27
3 특허출원서
Patent Application		 1995.12.21 수리 (Accepted) 1-1-1995-0207369-81
4 출원인정보변경 (경정)신고서
Notification of change of applicant's information		 1997.05.07 수리 (Accepted) 1-1-1995-0207372-18
5 대리인선임신고서
Notification of assignment of agent		 1997.08.25 수리 (Accepted) 1-1-1995-0207373-64
6 등록사정서
Decision to grant		 1998.06.17 발송처리완료 (Completion of Transmission) 1-5-1995-0109511-96
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
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번호 청구항
1 1

신경망 시스템에 있어서, 격자구조를 16개의 디지탈 신경칩으로 이루어지며 각각 특정의 주소를 갖는 소정갯수의 프로세서 보드(11)와, 상기 프로세서 보드(11) 각각에 부여된 특정 주소를 사용하여 상기 프로세서 보드(11)내의 신경칩간의 로칼 버스통신과 프로세서보드간의 글로벌 버스통신을 제어하는 IBM-PC(10)를 포함하여 단일 프로세서 시스템인 IBM-PC에서 대규모 프로세서를 효율적으로 제어하기 위한 계층적 제어구조를 제공하는 것을 특징으로 하는 AT-Bus에 장착하기 위한 병렬 신경망 보드의 제어회로

2 2

제1항에 있어서, 상기 신경칩은 로칼버스를 사용하여서 온-라인 상태에서 뉴랄 프로세서간(또는 디지탈 신경칩간)에 데이타 통신을 하며, 글로벌 버스를 이용하여서 오프-라인 상태에서 상기 IBM-PC와 데이타를 업/다운 로딩하는 것을 특징으로 하는 AT-Bus에 장착하기 위한 병렬 신경망 보드의 제어회로

3 3

제1항에 있어서, 상기 디지탈 신경칩은 네 개의 뉴랄 프로세서로 구성된 단일칩 다중 프로세서인 것을 특징으로 하는 AT-Bus에 장착하기 위한 병렬 신경망 보드의 제어회로

4 4

격자구조를 갖는 16개의 디지탈 신경칩으로 이루어지며 각각 특정의 주소를 갖는 소정갯수의 프로세서 보드(11)와 프로세서 보드(11) 각각에 부여된 특정 주소를 사용하여 상기 프로세서 보드(11)내의 신경칩간의 로칼 버스통신과 프로세서보드간의 글로벌 버스통신을 제어하는 IBM-PC(10)를 구비하는 신경망 시스템에 있어서, 선택되어진 해당 프로세서 보드의 주소를 AT-버스에 있는 주소 버스의 하위 네비트와 데이타 버스의 하위 네비트에서 이 실어 전송하는 전송수단과; 상기 전송수단에서 출력되는 주소 버스의 데이타와 데이타 버스를 비교하여 결과를 출력하는 제1비교기와; 상기 제1비교기에서 출력되는 비교데이타가 참인 경우 해당 보드의 주소값을 저장하는 레지스터; 및 상기 레지스터에 저장된 데이타와 미리 지정된 보드의 주소값을 비교하여 보드가 선택됨을 출력하는 제2비교기를 포함하는 것을 특징으로 하는 IBM-PC가 제어할 수 있는 8개의 프로세서 보드중에서 임의의 프로세서 보드 선택회로

지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.