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직접 메모리 액세스 제어기

  • 기술번호 : KST2015076574
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 직접 메모리 액세스(DMA;Direct Memory Access) 제어기에 관한 것으로, 특히, 디지털 컴퓨터 분야에서 고속의 디지털 신호처리기의 SDRAM(Synchrono -us Dynamic RAM)과 같은 버스트 전송기능을 갖는 고속 외부 메모리와 내부 모듈간의 직접 메모리 액세스 제어기에 관한 것이다.영상 압축/복원을 위해 SDRAM과 같은 고속의 외부 메모리와 여러 개의 프로세싱 모듈을 사용하여 병렬 처리하는 구조를 갖는 멀티미디어 프로세서에서, 다양한 직접 메모리 액세스(Direct Memory Access) 제어기와 다수의 프로세싱 모듈사이에 다양한 형태의 직접 메모리 액세스 채널을 제공할 필요성이 있다. 본 발명은 직접 메모리 액세스 버스 브릿지를 사용하는 직접 메모리 액세스 전송 방법 및 구조에 관한 것으로, 확장성이 용이하며 임시 저장 장치가 필요 없으면서 일반 CPU와 같은 인터페이스로 입/출력 디바이스을 연결할 수 있도록 하며, 고속의 데이터를 연속적으로 전송할 수 있도록 하는 직접 메모리 액세스 제어기를 제공한다.
Int. CL G06F 13/00 (2006.01)
CPC G06F 13/28(2013.01) G06F 13/28(2013.01) G06F 13/28(2013.01)
출원번호/일자 1019970064815 (1997.11.29)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-1999-0043773 (1999.06.15) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 거절
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (1997.11.29)
심사청구항수 3

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 김상범 대한민국 대전광역시 서구
2 최장식 대한민국 대전광역시 대덕구
3 박치항 대한민국 대전광역시 유성구
4 천대녕 대한민국 대전광역시 유성구
5 김기현 대한민국 대전광역시 유성구
6 황승구 대한민국 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 신영무 대한민국 서울특별시 강남구 영동대로 ***(대치동) KT&G타워 *층(에스앤엘파트너스)
2 최승민 대한민국 서울특별시 중구 통일로 **, 에이스타워 *층 (순화동)(법무법인 세종)

최종권리자

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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 대리인선임신고서
Notification of assignment of agent		 1997.11.29 수리 (Accepted) 1-1-1997-0203632-71
2 출원심사청구서
Request for Examination		 1997.11.29 수리 (Accepted) 1-1-1997-0203633-16
3 특허출원서
Patent Application		 1997.11.29 수리 (Accepted) 1-1-1997-0203631-25
4 의견제출통지서
Notification of reason for refusal		 2000.01.27 발송처리완료 (Completion of Transmission) 9-5-2000-0010750-32
5 거절사정서
Decision to Refuse a Patent		 2000.04.28 발송처리완료 (Completion of Transmission) 9-5-2000-0092355-11
6 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1

다수의 직접 메모리 액세스 제어 회로와,

직접 메모리 액세스 버스 중재기와,

직접 메모리 액세스 마스터 버스와 직접 메모리 액세스 슬래이브 버스를 연결하며, 상기 마스터 버스에 연결된 상기 직접 메모리 액세스 제어기의 신호에 따라 고속의 외부메모리와 입/출력 디바이스 사이의 데이터 전송 통로를 제공하는 직접 메모리 액세스 버스 브릿지를 포함하여 이루어지는 것을 특징으로 하는 직접 메모리 액세스 제어기

2 2

제 1 항에 있어서,

상기 직접 메모리 액세스 버스 브릿지는 상기 직접 메모리 액세스 마스터 버스에서 인가된 신호를 받아 직접 메모리 액세스 버스 브릿지의 제어신호를 생성하는 버스 브릿지 제어기와,

상기 직접 메모리 액세스 버스 브릿지 제어기의 제어 신호에 의해서 방향을 전환하는 양방향 데이터 래치와,

상기 직접 메모리 액세스 버스 브릿지 제어기의 제어 신호에 의하여 시작 어드레스를 저장하는 어드래스 래치와,

상기 어드래스 래치에서 인가된 어드레스를 디코딩하는 공간 디코더와,

시작 어드레스와 상기 버스 브릿지 제어기에서 인가된 전송 카운터 값을 더하여 입/출력 디바이스의 유효 어드레스를 만드는 덧셈기를 포함하여 이루어진 것을 특징으로 하는 직접 메모리 액세스 제어기

3 3

제 2 항에 있어서,

상기 직접 메모리 액세스 버스 브릿지 제어기는 대기상태에서 현재 전송 카운터와 마지막 전송 신호를 초기화 한 후 선택 신호가 들어오면 어드레스, 방향 및 버스트 길이를 저장하고 동작 상태로 들어가고, 선택 신호가 들어오지 않으면 다시 대기상태를 반복하는 단계와,

상기 동작 상태에서 전송 카운터를 1 증가 시킨 후 현재의 전송 카운터와 버스트 전송크기가 같은지를 검사하는 단계와,

현재의 전송 카운터와 버스트 전송크기가 같으면 마지막 전송 신호를 1 로 한 후 상기 대기 상태로 들어가고, 현재의 전송 카운터와 버스트 전송크기가 같지 않으면 상기 전송 제어신호를 엑티브 시키고 동작모드를 계속하는 단계를 포함하여 이루어지는 것을 특징으로 하는 직접 메모리 액세스 제어기

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1 US6219724 US 미국 DOCDBFAMILY
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