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고속 비터비 복호기에서 라딕스-4 가지 메트릭 연산을위한 디펑처 구조 및 방법

  • 기술번호 : KST2015077792
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 펑처드 부호를 고속으로 복호하는 비터비(Viterbi) 복호기 설계 방법 중 라딕스-4(Radix-4) 방식의 가지 메트릭(Branch Metric) 연산기를 사용하여 설계를 할 때 비터비 복호기로 입력되는 비트 스트림을 디펑처하는 구조와 방법에 관한 것이다. 기존의 고속 비터비 복호기 설계는 라딕스-2(Radix-2) 가지 메트릭 연산기를 사용한 방식이었고, 따라서 이때 사용한 디펑처 구조와 방법은 라딕스-2 에는 적합하였다. 그러나 이러한 방식을 라딕스-4 방식에 적용하기는 힘들고 복잡한 문제점이 있다.본 발명은 4 개의 FIFO와 4 개의 다중화기(Mux), 1 개의 라딕스 4 가지 메트릭 연산기로 구성된다. 입력되는 I, Q 2 개의 비트 스트림은 각각 상위 2 개의 선입선출버퍼와 하위 2 개의 FIFO에 연결된다. FIFO의 출력은 다음 단의 상위 및 하위 다중화기 2 개씩에 연결되며, 각 다중화기의 출력은 라딕스-4 가지 메트릭 연산기로 각각 1 개씩의 출력이 연결되는 구조를 가진다. 이러한 구조를 가질 경우, 입력되는 I, Q 비트 스트림의 클럭 속도와 동일한 클럭을 사용하여 라딕스-4 가지 메트릭 연산이 가능하며, 이 구조와 방법은 1/2 부호로부터 파생된 모든 펑처드 부호의 라딕스-4 가지 메트릭 연산을 위한 디펑처가 가능하다.라딕스, 메트릭 연산기, 디펑처구조, 비터비 복호기, 펑처드 부호
Int. CL H03M 13/41 (2006.01)
CPC
출원번호/일자 1020000083017 (2000.12.27)
출원인 한국전자통신연구원
등록번호/일자 10-0375823-0000 (2003.02.28)
공개번호/일자 10-2002-0054195 (2002.07.06) 문서열기
공고번호/일자 (20030315) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2000.12.27)
심사청구항수 8

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 최은아 대한민국 전라북도전주시덕진구
2 김진호 대한민국 대전광역시유성구
3 김내수 대한민국 대전광역시대덕구
4 오덕길 대한민국 대전광역시서구

대리인

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번호 이름 국적 주소
1 전영일 대한민국 광주 북구 첨단과기로***번길**, ***호(오룡동)(특허법인세아 (광주분사무소))

최종권리자

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번호 이름 국적 주소
1 대한민국(산업통상자원부장관) 세종특별자치시 한누리대
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 2000.12.27 수리 (Accepted) 1-1-2000-0281390-30
2 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2001.04.19 수리 (Accepted) 4-1-2001-0046046-20
3 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2002.08.08 수리 (Accepted) 4-1-2002-0065009-76
4 등록결정서
Decision to grant		 2002.11.29 발송처리완료 (Completion of Transmission) 9-5-2002-0425661-68
5 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
6 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
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번호 청구항
1 1

I 신호를 순차적으로 입력받아 저장하는 제 1, 제 2 FIFO와,

Q 신호를 순차적으로 입력받아 저장하는 제 3, 제 4 FIFO와,

상기 제 1, 제 3 FIFO로부터 신호를 입력받아 다중화하는 제 1, 제 2 다중화기와,

상기 제 2, 제 4 FIFO로부터 신호를 입력받아 다중화하는 제 3, 제 4 다중화기와,

상기 제 1, 제 2 다중화기로부터 신호를 입력받아 디펑처 기능을 수행하는 제 1 라딕스-2 가지 메트릭 연산기와,

상기 제 3, 제 4 다중화기로부터 신호를 입력받아 디펑처 기능을 수행하는 제 2 라딕스-2 가지 메트릭 연산기를 포함한 것을 특징으로 하는 고속 비터비 복호기에서 라딕스-4 가지 메트릭 연산을 위한 디펑처 구조

2 2

제 1 항에 있어서,

상기 제 1 내지 제 4 FIFO의 쓰기 또는 읽어내기를 제어하는 4 개의 제어신호와, 상기 제 1 내지 제 4 다중화기의 입력을 선택하는 4 개의 제어신호와, 상기 제 1 내지 제 2 라딕스-2 가지 메트릭 연산기의 디펑처된 비트의 위치를 선택하는 4 개의 제어신호를 출력하는 제어신호 발생기를 더 포함한 것을 특징으로 하는 고속 비터비 복호기에서 라딕스-4 가지 메트릭 연산을 위한 디펑처 구조

3 3

4개의 FIFO와, 4개의 다중화기와, 2개의 라딕스-2 가지 메트릭 연산기를 포함한 고속 비터비 복호기에서 라딕스-4 가지 메트릭 연산을 위한 디펑처 방법에 있어서,

(n-1)비트의 입력에 대해 n 비트의 펑처된 비트가 전송되는 부호율 (n-1)/n의 펑처패턴이 I와 Q 두 개의 행으로 배열되어 주기적으로 전송되는 제 1 단계와;

상기 펑처패턴 I와 Q 신호를 순차적으로 입력받아 상기 2개의 FIFO에 번갈아 가면서 저장하고, 상기 4개의 FIFO에 데이터가 저장되면 상기 4 개의 FIFO로부터 동시에 데이터를 읽어내는 제 2 단계와;

상기 4 개의 FIFO에서 읽어낸 데이터를 다중화하여 출력하는 제 3 단계와;

상기 다중화된 신호를 입력받아 라딕스-2 가지 메트릭 연산을 수행하는 제 4 단계를 포함한 것을 특징으로 하는 고속 비터비 복호기에서 라딕스-4 가지 메트릭 연산을 위한 디펑처 방법

4 4

제 3 항에 있어서,

펑처가 일어나지 않아 부호율 1/2 인 펑처패턴이 입력되면,

상기 제 1 단계는 tn 시점(n은 임의의 양의 정수)에서는 제 1 FIFO와 제 3 FIFO에 I1 비트와 Q1 비트를 쓰고, tn+1 시점에서는 제 2 FIFO와 제 4 FIFO에 다음 펑처패턴의 I1 비트와 Q1 비트를 쓰며, 상기 제 1 내지 제 4 FIFO에 데이터가 써지면 동시에 읽어내는 단계인 것일 특징으로 하는 고속 비터비 복호기에서 라딕스-4 가지 메트릭 연산을 위한 디펑처 방법

5 5

제 3 항에 있어서,

펑처 부호의 부호율이 2/3 인 펑처패턴이 입력되면,

상기 제 1 단계는, t2n-1 시점(n은 임의의 양의 정수)에서는 제 1 FIFO와 제 3 FIFO에 I1 비트와 Q1 비트를 쓰고, t2n 시점에서는 제 2 FIFO와 제 4 FIFO에 I2 비트와 Q2 비트를 쓰되, 펑처된 비트를 don't care 비트 상태로 쓰며, 상기 제 1 내지 제 4 FIFO에 데이터가 써지면 동시에 읽어내는 단계인 것을 특징으로 하는 고속 비터비 복호기에서 라딕스-4 가지 메트릭 연산을 위한 디펑처 방법

6 6

제 3 항에 있어서,

펑처 부호의 부호율이 3/4 인 펑처패턴이 입력되면,

상기 제 1 단계는, t3n-2 시점(n은 임의의 양의 정수)에서는 제 1, 3 FIFO 또는 제 2, 4 FIFO에 I1 비트와 Q1 비트를 쓰고, t3n-1 시점에서는 제 2, 4 FIFO 또는 제 1, 3 FIFO에 I2 비트와 Q2 비트를 쓰며, t3n 시점에서는 제 1, 3 FIFO 또는 제 2, 4 FIFO에 I3 비트 또는 Q3 비트를 쓰되, 펑처된 비트를 don't care 비트 상태로 쓰고, 제 1 내지 제 4 FIFO에 데이터가 써지면 동시에 읽어내는 단계인 것을 특징으로 하는 고속 비터비 복호기에서 라딕스-4 가지 메트릭 연산을 위한 디펑처 방법

7 7

제 3 항에 있어서,

펑처 부호의 부호율이 5/6 인 펑처패턴이 입력되면,

상기 제 1 단계는, t5n-4 시점(n은 임의의 양의 정수)에서는 제 1, 3 FIFO 또는 제 2, 4 FIFO에 I1 비트와 Q1 비트를 쓰고, t5n-3 시점에서는 제 2, 4 FIFO 또는 제 1, 3 FIFO에 I2 비트와 Q2 비트를 쓰며, t5n-2 시점에서는 제 1, 3 FIFO또는 제 2, 4 FIFO에 I3 비트 또는 Q3 비트를 쓰고, t5n-1 시점에서는 제 2, 4 FIFO 또는 제 1, 3 FIFO에 I4 비트와 Q4 비트를 쓰며, t5n 시점에서는 제 1, 3 FIFO 또는 제 2, 4 FIFO에 I5 비트 또는 Q5 비트를 쓰되, 펑처된 비트를 don't care 비트 상태로 쓰고, 제 1 내지 제 4 FIFO에 데이터가 써지면 동시에 읽어내는 단계인 것을 특징으로 하는 고속 비터비 복호기에서 라딕스-4 가지 메트릭 연산을 위한 디펑처 방법

8 8

제 3 항에 있어서,

펑처 부호의 부호율이 7/8 인 펑처패턴이 입력되면,

상기 제 1 단계는, t7n-6 시점(n은 임의의 양의 정수)에서는 제 1, 3 FIFO 또는 제 2, 4 FIFO에 I1 비트와 Q1 비트를 쓰고, t7n-5 시점에서는 제 2, 4 FIFO 또는 제 1, 3 FIFO에 I2 비트와 Q2 비트를 쓰며, t7n-4 시점에서는 제 1, 3 FIFO 또는 제 2, 4 FIFO에 I3 비트 또는 Q3 비트를 쓰고, t7n-3 시점에서는 제 2, 4 FIFO또는 제 1, 3 FIFO에 I4 비트와 Q4 비트를 쓰며, t7n-2 시점에서는 제 1, 3 FIFO 또는 제 2, 4 FIFO에 I5 비트 또는 Q5 비트를 쓰고, t7n-1 시점에서는 제 2, 4 FIFO 또는 제 1, 3 FIFO에 I6 비트와 Q6 비트를 쓰며, t7n 시점에서는 제 1, 3 FIFO 또는 제 2, 4 FIFO에 I7 비트 또는 Q7 비트를 쓰되, 펑처된 비트를 don't care 비트 상태로 쓰고, 제 1 내지 제 4 FIFO에 데이터가 써지면 동시에 읽어내는 단계인 것을 특징으로 하는 고속 비터비 복호기에서 라딕스-4 가지 메트릭 연산을 위한 디펑처 방법

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