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활성 영역 하부에 산화층을 가지는 반도체 소자를제조하는 방법

  • 기술번호 : KST2015078570
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 활성 영역 하부에 산화층을 가지는 반도체 소자를 제조하는 방법을 제공한다. 본 발명의 일 관점에 의한 방법은, 반도체 기판 상에 실리콘 게르마늄층의 완충층을 성장시키는 단계와, 완충층 상에 실리콘층의 활성층을 형성하는 단계와, 활성층에 선택적 산화에 의한 소자 분리층을 형성하는 단계, 및 소자 분리층 아래에서 활성층에 대해 완충층을 선택적으로 측면 방향으로 산화시켜 활성층의 하부에 완충층의 산화층을 형성하는 단계를 포함하여 이루어진다.
Int. CL H01L 29/737 (2006.01)
CPC H01L 29/66477(2013.01) H01L 29/66477(2013.01)
출원번호/일자 1020020047348 (2002.08.10)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2004-0014716 (2004.02.18) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 거절
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2002.08.10)
심사청구항수 12

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 심규환 대한민국 대전광역시유성구
2 송영주 대한민국 대전광역시유성구
3 김상훈 대한민국 대전광역시중구
4 강진영 대한민국 대전광역시유성구
5 박경완 대한민국 대전광역시유성구

대리인

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번호 이름 국적 주소
1 이영필 대한민국 서울 강남구 언주로 **길 **, *층, **층, **층, **층(도곡동, 대림아크로텔)(리앤목특허법인)
2 이해영 대한민국 서울 강남구 언주로 **길 **, *층, **층, **층, **층(도곡동, 대림아크로텔)(리앤목특허법인)

최종권리자

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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2002.08.10 수리 (Accepted) 1-1-2002-0258788-37
2 선행기술조사의뢰서
Request for Prior Art Search
2004.02.11 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2004.03.12 수리 (Accepted) 9-1-2004-0015517-27
4 의견제출통지서
Notification of reason for refusal
2004.09.23 발송처리완료 (Completion of Transmission) 9-5-2004-0396235-20
5 거절결정서
Decision to Refuse a Patent
2004.11.30 발송처리완료 (Completion of Transmission) 9-5-2004-0512656-27
6 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
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번호 청구항
1 1

반도체 기판 상에 실리콘 게르마늄층의 완충층을 성장시키는 단계;

상기 완충층 상에 실리콘층의 활성층을 형성하는 단계;

상기 활성층에 선택적 산화에 의한 소자 분리층을 형성하는 단계; 및

상기 소자 분리층 아래에서 상기 활성층에 대해 상기 완충층을 선택적으로 측면 방향으로 산화시켜 상기 활성층의 하부에 완충층의 산화층을 형성하는 단계를 포함하는 것을 특징으로 하는 반도체 소자 제조 방법

2 2

반도체 기판 상에 실리콘 게르마늄층의 완충층을 성장시키는 단계;

상기 완충층 상에 실리콘층의 활성층을 형성하는 단계;

상기 활성층을 패터닝하여 상기 활성층의 측면 및 상기 완충층의 표면 일부를 노출하는 단계;

상기 활성층에 대해 상기 완충층을 선택적으로 측면 방향으로 산화시켜 상기 활성층의 하부에 완충층의 산화층을 형성하는 단계를 포함하는 것을 특징으로 하는 반도체 소자 제조 방법

3 3

제1 또는 2항에 있어서,

상기 완충층의 산화층을 형성하는 단계는 습식 열 산화로 수행되는 것을 특징으로 하는 반도체 소자 제조 방법

4 4

제1 또는 2항에 있어서, 상기 완충층은

중간 부위에서의 게르마늄의 몰 농도가 최대인 두께 방향으로의 게르마늄 몰 농도 구배를 가지며 성장되는 것을 특징으로 하는 반도체 소자 제조 방법

5 5

제4항에 있어서, 상기 완충층은

대략 0

6 6

제1 또는 2항에 있어서, 상기 완충층을 성장시키는 단계는

상기 반도체 기판 상에 하부 완충층을 게르마늄 몰 농도를 증가시키며 성장하는 단계;

상기 하부 완충층 상에 상기 하부 완충층에 비해 높은 게르마늄 몰 농도로 중간 완충층을 성장시키는 단계; 및

상기 중간 완충층 상에 상기 중간 완충층에 비해 낮은 게르마늄 몰 농도로 감소시키며 상부 완충층을 성장시키는 단계를 포함하는 것을 특징으로 하는 반도체 소자 제조 방법

7 7

제6항에 있어서,

상기 중간 완충층은 대략 0

8 8

제1 또는 2항에 있어서,

상기 완충층의 측면 방향으로의 선택적인 산화를 촉진하기 위해 상기 완충층 내에 불순물을 주입하는 이온 주입 과정을 더 포함하는 것을 특징으로 하는 반도체 소자 제조 방법

9 9

제8항에 있어서,

상기 이온 주입되는 불순물로 산소 이온, 인 이온, 비소 이온 또는 보론 이온을 사용하는 것을 특징으로 하는 반도체 소자 제조 방법

10 10

제1 또는 2항에 있어서,

상기 완충층의 산화층은 상기 활성층의 아래를 완전히 감싸거나 또는 상기 활성층의 아래에 일부의 상기 완충층을 잔류시키도록 형성되는 것을 특징으로 하는 반도체 소자 제조 방법

11 11

제1항에 있어서,

상기 완충층과 상기 활성층 사이에 저농도의 분리층을 성장시키는 단계;

상기 소자 분리층 사이에 제2소자 분리층을 형성하는 단계; 및

상기 제2소자 분리층과 상기 소자 분리층 사이의 상기 활성층에 불순물을 이온 주입하여 상기 저농도 분리층에 도달하는 깊은 불순물층을 형성하여 상기 저농도 분리층을 통해 상기 활성층 아래에 연결되는 하부 전극을 형성하는 단계를 더 포함하는 것을 특징으로 하는 반도체 소자 제조 방법

12 12

제2항에 있어서,

상기 완충층과 상기 활성층 사이에 상기 고농도의 하부 게이트층을 성장시키는 단계; 및

상기 하부 게이트 상에 하부 게이트 산화층용 실리콘 게르마늄층의 제2완충층을 성장시키는 단계를 더 포함하고,

상기 하부 게이트층은 상기 활성층의 패터닝에서 자기 정렬로 하부 게이트로 패터닝되고,

제2완충층은 상기 완충층의 측면 방향으로의 선택적인 산화에서 함께 측면 방향으로 산화되는 것을 특징으로 하는 반도체 소자 제조 방법

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패밀리정보가 없습니다
국가 R&D 정보가 없습니다.