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상보적 클럭킹을 이용한 플립플롭 및 그를 이용한프리스케일러

  • 기술번호 : KST2015078827
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 TSPC 다이나믹 방식의 플립플롭에서 트랜지스터의 문턱전압으로 인해 발생되는 전류구동능력의 저하를 개선하기 위하여 클럭을 입력받는 트랜지스터에 상보적 클럭에 따라 동작되는 트랜지스터를 병렬로 부가함으로써 두 트랜지스터 간의 상보적 관계로 인해 안정적이고 빠른 동작이 가능해지며 노이즈의 감소를 이룰 수 있다. 또한, 본 발명은 상기와 같이 이루어진 플립플롭을 이용하여 종래보다 더 높은 주파수에서도 고속의 동작을 이룰 수 있는 프리스케일러를 구성한다.TSPC, 플립플롭, 상보적 클럭킹, 프리스케일러, 고속동작
Int. CL H03K 3/027 (2006.01)
CPC H03K 3/356104(2013.01) H03K 3/356104(2013.01) H03K 3/356104(2013.01)
출원번호/일자 1020020081477 (2002.12.18)
출원인 한국전자통신연구원
등록번호/일자 10-0452948-0000 (2004.10.05)
공개번호/일자 10-2004-0054439 (2004.06.25) 문서열기
공고번호/일자 (20041014) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2002.12.18)
심사청구항수 4

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 한선호 대한민국 대전광역시유성구
2 윤용식 대한민국 대전광역시유성구
3 김성도 대한민국 대전광역시유성구
4 박문양 대한민국 대전광역시유성구
5 유현규 대한민국 대전광역시유성구

대리인

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번호 이름 국적 주소
1 신영무 대한민국 서울특별시 강남구 영동대로 ***(대치동) KT&G타워 *층(에스앤엘파트너스)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 2002.12.18 수리 (Accepted) 1-1-2002-0420991-12
2 선행기술조사의뢰서
Request for Prior Art Search		 2004.06.09 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search		 2004.07.14 수리 (Accepted) 9-1-2004-0043734-29
4 등록결정서
Decision to grant		 2004.09.30 발송처리완료 (Completion of Transmission) 9-5-2004-0410387-81
5 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
6 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1

전원전압 및 제 1 노드 간에 접속되며 게이트를 통해 데이터를 입력받는 제 1 p형 트랜지스터와,

상기 제 1 노드 및 제 2 노드 간에 접속되며 게이트를 통해 제 1 클럭을 입력받는 제 2 p형 트랜지스터와,

상기 제 2 노드 및 접지 간에 접속되며 게이트를 통해 상기 데이터를 입력받는 제 1 n형 트랜지스터와,

상기 전원전압 및 제 3 노드 간에 접속되며 게이트가 상기 제 1 노드에 접속된 제 3 p형 트랜지스터와,

상기 제 3 노드 및 제 4 노드 간에 접속되며 게이트를 통해 상기 제 1 클럭을 입력받는 제 2 n형 트랜지스터와,

상기 제 4 노드 및 접지 간에 접속되며 게이트가 상기 제 2 노드에 접속된 제 3 n형 트랜지스터와,

상기 전원전압 및 출력단자 간에 접속되며 게이트가 상기 제 3 노드에 접속된 제 4 p형 트랜지스터와,

상기 출력단자 및 접지 간에 접속되며 게이트가 상기 제 4 노드에 접속된 제 4 n형 트랜지스터와,

상기 제 1 노드 및 제 2 노드 간에 접속되며 게이트를 통해 제 2 클럭을 입력받는 제 5 n형 트랜지스터와,

상기 제 3 및 제 4 노드 간에 접속되며 게이트를 통해 상기 제 2 클럭을 입력받는 제 5 p형 트랜지스터를 포함하는 것을 특징으로 하는 상보적 클럭킹을 이용한 플립플롭

2 2

제 1 항에 있어서, 상기 제 1 및 제 2 클럭은 위상이 서로 반대인 것을 특징으로 하는 상보적 클럭킹을 이용한 플립플롭

3 3

다수의 플립플롭으로 이루어진 동기식 나누기 회로와, 다수의 토글 플립플롭으로 이루어진 비동기식 나누기 회로를 포함하는 프리스케일러에 있어서,

상기 동기식 나누기 회로의 플립플롭이 전원전압 및 제 1 노드 간에 접속되며 게이트를 통해 데이터를 입력받는 제 1 p형 트랜지스터와,

상기 제 1 노드 및 제 2 노드 간에 접속되며 게이트를 통해 제 1 클럭을 입력받는 제 2 p형 트랜지스터와,

상기 제 2 노드 및 접지 간에 접속되며 게이트를 통해 상기 데이터를 입력받는 제 1 n형 트랜지스터와,

상기 전원전압 및 제 3 노드 간에 접속되며 게이트가 상기 제 1 노드에 접속된 제 3 p형 트랜지스터와,

상기 제 3 노드 및 제 4 노드 간에 접속되며 게이트를 통해 상기 제 1 클럭을 입력받는 제 2 n형 트랜지스터와,

상기 제 4 노드 및 접지 간에 접속되며 게이트가 상기 제 2 노드에 접속된 제 3 n형 트랜지스터와,

상기 전원전압 및 출력단자 간에 접속되며 게이트가 상기 제 3 노드에 접속된 제 4 p형 트랜지스터와,

상기 출력단자 및 접지 간에 접속되며 게이트가 상기 제 4 노드에 접속된 제 4 n형 트랜지스터와,

상기 제 1 노드 및 제 2 노드 간에 접속되며 게이트를 통해 제 2 클럭을 입력받는 제 5 n형 트랜지스터와,

상기 제 3 및 제 4 노드 간에 접속되며 게이트를 통해 상기 제 2 클럭을 입력받는 제 5 p형 트랜지스터로 이루어진 것을 특징으로 하는 프리스케일러

4 4

제 3 항에 있어서, 상기 제 1 클럭은 전압제어발진기의 출력신호이며, 상기 제 1 및 제 2 클럭은 위상이 서로 반대인 것을 특징으로 하는 프리스케일러

지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.